[디지털시스템실험(Verilog)] Address Generator, PC Calculation Unit, Branch Handler 예비보고서
- 최초 등록일
- 2011.10.05
- 최종 저작일
- 2011.10
- 4페이지/ 한컴오피스
- 가격 1,500원
소개글
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디지털시스템실험 성적 : A+
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- 디지털시스템실험 예비레포트 기준 -
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A등급 : 모든 Verilog 예상 소스코드 첨부, 코드 동작 예상, 핵심 내용 요약 정리 (가격 1000원)
B등급 : Verilog 소스코드 첨부가 필요하지 않을 정도로 간단한 실험이거나 코드가 짧을 경우, 핵심 내용 요약 정리 (가격 800원)
이 레포트의 등급은 ■A+등급■ 입니다.
목차
① Address generator
② PC Caculation Unit
③ Branch Handler
본문내용
실험제목
PICO Processor - Address Generator, PC Calculation Unit, Branch Handler
실험목표
① PICO Processor의 Address Generator, PC Calculation Unit, Branch Handler를 구현한다.
실험준비물
ModelSim(HDL Simulator)
<중 략>
각 Boolean algebra formulation은 NOT, AND, OR 게이트를 이용하여 구현할 수 있다.
실험에 대비하여 실제 코딩을 해 보았다.
Boolean algebra formulation로 표현한 offset[31:0]을 각 게이트 소자들을 이용하여 gate level로 구현하였다.
주석에서 알 수 있듯이, offset의 각 부분을 따로 정의하고, 이 offset값의 결과와 입력된 memory address인 base값을 32bit full adder를 이용하여 더하면 최종 output인 gen의 값, 즉 새로운 memory address가 출력되게 된다.
설계된 모듈은 다음을 만족해야 한다.
op = 0일 때 gen = base
op = 1일 때 gen = base+4
op = 2일 때 gen = base+2
op = 3일 때 gen = base+1
op = 4일 때 gen = base-1
op = 5일 때 gen = base-2
op = 6일 때 gen = base-4
op = 7(default)일 때 gen = base
시뮬레이션 결과는 아래와 같다.
아래의 시뮬레이션 결과는, 위의 설계 조건을 만족하고 있음을 확인할 수 있다.
참고 자료
없음