디지털 논리실험 8주차 예비보고서

소개글

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목차

1. 실험 준비
2. 실험 결과

본문내용

1.1 Gated D Latch의 동작에 대해 설명하시오.
Gated D Latch는 D와 EN을 입력 값으로 갖고, Q와 를 출력 값으로 가진 다. S-R Latch와 거의 유사하지만 EN이라는 가드를 세워 S와 R의 값이 1,1 이 되는 경우를 막는다는 점에서 차이가 있다. EN의 입력 값이 LOW일 때에 는 D 값과 상관없이 S와 R이 0,0인 경우와 같으므로 출력 값이 변하지 않으 며, EN의 입력 값이 HIGH일 때에는 D 값을 Q의 값으로 전달한다. 이때 D의 입력 값이 0일 때에는 Q=0, =1이 되고, D의 입력 값이 1일 때에는 Q=1,  =0이 된다.

1.2 D Flip-flop의 동작에 대해 설명하시오.
D Flip-flop은 D Latch와 같이 D의 값을 Q의 값으로 전달해주지만 EN의 값 이 들어와 있는 내내 Q 값을 바꿀 수 있는 Latch와 달리 Flip-flop은 clock 이 변하는 타이밍에만 D 값을 Q 값으로 넘겨준다는 점에서 차이가 있다. 실험 에서는 확인할 수 없었지만 CLOCK의 스위치가 올라가는 그 순간에만 D가 0 이면 Q=0, =1이 되고, D의 1일 때에는 Q=1, =0이 된다.

참고 자료

없음