1bit full adder

*병*

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최초 등록일: 2008.09.19
최종 저작일: 2006.10; 10페이지/ 한컴오피스; 가격 3,000원

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소개글

송상헌 교수님 ASIC 설계 수업

MY CAD를 이용한 1bit full adder 회로 설계 홈워크입니다.

본문내용

**********************************************************
* MyAnalog V7.1 SPICE netlist generator
* Cell Name :: ader
* Flatten Extraction for Berkely SPICE 3
* Generated Date :: 2006/11/27 3:35.48
**********************************************************
.GLOBAL Carry Sum A B C
.GLOBAL VDD GND
**********************************************************
MT_I0 VDD A I4_PNS VDD PMOS
MT_I1 I4_PNS A I2_PND VDD PMOS
MT_I2 I2_PND B I8_NNS VDD PMOS
MT_I3 I4_PNS B VDD VDD PMOS
MT_I5 I8_NNS C I7_NND GND NMOS
MT_I6 I7_NND A GND GND NMOS
MT_I7 I7_NND B GND GND NMOS
MT_I8 I8_NND A I8_NNS GND NMOS
MT_I9 GND B I8_NND GND NMOS
MT_I10 Carry I8_NNS GND GND NMOS
MT_I11 VDD I8_NNS Carry VDD PMOS
MT_I12 VDD A I18_PND VDD PMOS
MT_I13 VDD B I18_PND VDD PMOS
MT_I14 VDD C I18_PND VDD PMOS
MT_I15 I15_PND A I18_PND VDD PMOS
MT_I16 I16_PND B I15_PND VDD PMOS

참고 자료

ASIC 설계 책
MY CAD 메뉴얼

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