"아주대 논리회로실험" 검색결과 301-320 / 447건

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  실험3예비 Adder&Subtracter

  [실험3] Adder & Subtracter1. ... 컴퓨터 내에서 2진 숫자(비트)를 덧셈하기 위해 사용되는 논리 회로의 하나. 반 덧셈기라고도 한다. ... (전감산기)- 전 감산기는 뒷단의 위치에 빌려준 1을 고려하며 두 비트의 뺄셈을 수행하는 논리회로- 빌림수 입력을 취급하기 위해 변수 A,B에 추가로 C의 입력이 한 개 필요3.

  리포트 | 4페이지 | 2,000원 | 등록일 2014.05.13

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  실험8예비 Counter

  이와 연관지어 Counter를 구성해본다.- 회로상에 Counter가 존재함으로써 회로는 다양한 역할을 할 수 있다. ... 그 동작원리를 이해한다.- 카운터는 회로 동작에 시간적 분절을 통한 순차적 연산을 가능하게 한다. ... 요약실험 1) 실험 1) 2단 2진 Counter ?

  리포트 | 5페이지 | 2,000원 | 등록일 2014.05.13

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  실험9예비 DAC&ADC

  [실험9] D/A & A/D converter1. ... 우리가 사용하는 대부분의 물리량들이 모두 아날로그신호로 표현되기 때문이다. 이러한 아날로그 신호를 변환하고 데이터를 저장하는 것은 디지털 세상에서 반드시 필요로 하는 부분이다. ... 목적- D/A와 A/D 변환기(converters) 회로의 구성과 동작 원리에 대해 이해한다.- DAC 회로에서는 저항의 크기와 개수가 회로의 성능을 좌우한다.

  리포트 | 7페이지 | 2,000원 | 등록일 2014.05.13

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  실험5예비_DEC&ENC

  대부분의 MSI디코더들은 회로의 동작을 제어하기 위해 구동입력(enable input)을 가지고 있다.3. ... 예를 들어 10진수나 8진수를 입력으로 받아들여 2진수나 BCD와 같은 코드로 변환해 주는 조합논리회로이다. ... 실험 중 실제로 두 회로를 묶어보아 제대로 작동하는지 확인한다.

  리포트 | 6페이지 | 2,000원 | 등록일 2014.05.13

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  실험6예비 Latch&FF

  이론1) Latch하나 이상의 비트들을 저장하기 위한 디지털 논리회로이다. ... [실험6] Latch & Flip-Flop1. ... 반도체 회로로 구성되어 있다.

  리포트 | 5페이지 | 2,000원 | 등록일 2014.05.13

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  VHDL STOPWATCH 설계보고서, QUARTUS STOPWATCH 설계보고서

  VHDL 이용한 STOPWATCH 설계 과제1.설계 목적-VHDL사용법과 VHDL의 코드구조인 계층구조를 익히고 설계해본다.2.설계과정≪ VHDL 소스코드를 계층 구조로 표현하기 위한 블록도 구상도 ≫VHDL 코드는 1개의 TOP모델과 3개의 SUB모델 1개의 테스트벤..

  리포트 | 16페이지 | 5,000원 | 등록일 2014.02.28

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  실험7결과 Shift Register

  SIPO(Serial Input Parallel Output) 회로를 만들 때 특별히 주의할 부분이 있다. 8 bit 병렬 출력을 할 경우, 8 bit의 정보가 병렬 I/O 인터페이스에 ... 첫 번째는 회로상에서 buffer와 AND gate를 조합하는 방법이다. clock signal T0~T6까지 해당하는 동안 buffer를 이용해 데이터를 지연시키고, AND gate에 ... 고찰1) 6 bit shift register이전 실험에서 구성한 F/F을 여러 개 이어 shift register를 구현하는 실험이다.

  리포트 | 6페이지 | 3,000원 | 등록일 2014.05.13

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  실험7예비 Shift Register

  [실험7] Shift Register1. ... 다른 두 방식의 shift mechanism과 어떤 차이가 있는지 확인한다.- 병렬비트로 동작하는 인터페이스를 직렬비트에 대응시킬 때 shift를 시킨다.- 간단한 delay 회로를 ... 그러나, 클럭 주기의 횟수가 데이터 열의 길이보다 클지 않으면, 데이터 출력, Q는, 순서대로 병렬 데이터를 읽을 것이다.n비트 레지스터 → n개의 플립플롭회로입력1101이 클록 펄스에

  리포트 | 7페이지 | 2,000원 | 등록일 2014.05.13

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  [결과]실험5. Decoder & Encoder & 실험6. Latch & Flip-Flop

  실험6-2. JK Flip-Flop실험6-2에서는 74HC76 IC를 이용하여 위의 회로대로 J, C, K 입력을 주고 Q와 Q’의 출력을 나타내도록 회로를 구성한다. ... 고찰이번 실험을 통해 Decoder와 Encoder를 logic gate로 구성해 보아 구조와 동작원리에 대해 알 수 있었고 Flip-Flop의 회로와 입력 값에 따른 상태변화를 알 ... 이 실험도 1개의 소자로 구성한 회로여서 어려움이 없었다. 74HC148 소자는 active low에서 작동하는 8x3 encoder이므로EI가 0으로 들어갈 때 작동하게 되고 입력

  리포트 | 7페이지 | 1,500원 | 등록일 2013.09.28

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  [아주대 논회실] 논회실 결과보고서 1

  방법을 숙달하는 실험이었는데 논리 회로 실험의 경우에 대부분의 IC 소자들의 데이터 시트는 인터넷상에서 구할 수 있었기 때문에 회로도를 구성하고 연결하는 것에는 문제가 없었다.IC ... 실험 고찰이 번 실험은 간단한 logic gate를 이용해서 회로도를 구성하는 실험이었다.첫 실험에서는 우선 가장 중요한 것은 bread board를 사용하는 방법과 IC 소자를 연결하는 ... 소자들에 대해서 배운 점은 우선 이 소자들도 구동하기 위해서는 각 소자 내에도V _{cc}와 ground를 연결해주어야 하는 것이었다.

  리포트 | 5페이지 | 2,000원 | 등록일 2015.01.09

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  논리회로실험 실험9 ram 결과보고서

  1를 통해서는 RAM의 기본 원리에 대해서 알 수 있었으며 그로인한 RAM의 특징을 이해할 수 있었다. ... 구성 사진 :- 74HC00과 74HC03을 사용하여 2BIT RAM을 결손도에 설계하고 설계를 참고하여 브레드보드에 회로를 설치했다.- 주의사항? ... 구성 사진 :- 74LS89를 사용하여 동기식 64BIT RAM을 결손도에 설계하고 브레드보드에 회로를 설치한다.- 64BIT RAM은 16개의 4bit word를 저장가능하다.?

  리포트 | 9페이지 | 1,000원 | 등록일 2013.09.08

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  논리회로실험 실험1 basic gate 결과보고서

  아직 논리 게이트에 익숙하지 않아 바로바로 연산이 되지 않아 헷갈리기 쉽다.처음에는 3-Input NOR Gate의 출력에 NOT gate만 붙이려 했으나 회로가 복잡하다고 생각했고 ... 있었다.◈ 실험 1 [3-Input OR Gate 과정]- 예비보고서에 작성한 결선도와 같이 회로를 구성하였다.- 74HC32 IC칩의 OR게이트 2개를 이용하여 회로를 구성했다.- ... 2주차 결과보고서실험 1 Basic Gates▶실험과정 및 결과◈ 실험 1 [3-Input AND Gate 과정]- 예비보고서에 작성한 결선도와 같이 회로를 구성하였다.- 74HC08

  리포트 | 9페이지 | 1,000원 | 등록일 2013.09.08

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  예비 RAM

  나머지 동작들에 대해서도 각각 진리표의 결과와 같게 나올 것이다.실험2. 64-bit IC RAMME (CE) : Memory Enable (Chip Enable)WE : Write ... 기록과 해독의 두 회로가 있어서 정보의 기록, 해독이 가능하고 컴퓨터나 주변 단말기기의 기억장치에 널리 쓰인다. ... 실험목적: 반도체 memory의 기본적인 동작 원리를 알아보고 64-bit 기억 소자의 동작을 실험을 통해 확인한다.2.

  리포트 | 4페이지 | 1,500원 | 등록일 2013.12.26

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  결과 RAM

  그림과 같은 2-bit RAM 회로를 구현한다.2. Breadboard의 세로 노드의 왼쪽라인을 High로 오른쪽 라인을 Low로 설정한다.3. ... 따라서 chip 내부에 집적하는 기술의 중요성에 대해서 다시 생각해 볼 수 있었다. chip의 크기는 일정하지만 집적도가 좋아져 더욱 많은 비트를 칩 한 개로 다룰 수 있다면 그 효율이나 ... 모든 경우에 대하여 결과가 일치하기 때문에 실험이 잘 이루어졌다.실험2. 64-bit IC RAM 실험은 진행하지 않았다.[ 실험 분석 및 고찰 ]이번 주의 실험은 데이터를 기억하고

  리포트 | 3페이지 | 2,000원 | 등록일 2013.12.26

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  논리회로실험 실험10 converter 결과보고서

  이와 같은 전압의 크기로 파형이 나타났다.앞선 경우와 마찬가지로 12, 13 의 표현형에 대해서 open하기 전의 출력보다 더 큰 전압의 크기를 가진 표현형이 나타난다.- 10.5KΩ ... 따라서 2개 조가 함께 실험을 진행하였다.- 여러 종류의 저항을 사용하기 때문에 표시저항 값을 정확히 읽어서 회로를 구성했다.- 실험과정Single pulse clock으로 single ... 변화 값이 오실로스코프 노이즈와 분간 할 수 있을 만큼 크지 않아서 확인할 수 없었다.◈ 실험 2 : ADC구성 사진 :- 실험 1 회로의 출력에 LM74한 1개의 계단을 가진 파형으로

  리포트 | 9페이지 | 1,000원 | 등록일 2013.09.08

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  논리회로실험 실험2 Electrical feature of CMOS semiconductor 결과보고서

  회로는 실험1에서 사용한 회로에서 IC만 74HC14로 교환하여 실험하였다. Schmow로 변했다. 마찬가지로 abnormal영역이 없이 거의 수직으로 변화하였다. ... 실험 결과 :- 회로에서 두 채널 사이에 Not gate를 2개 통과한다. ... 회로구성 사진 :- 결손도와 같이 회로를 구성하였다.- 74HC04를 사용한다.

  리포트 | 9페이지 | 1,000원 | 등록일 2013.09.08

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  논리회로실험 실험6 Latch & Flip-Flop 결과보고서

  4 : J-K F/F (Gate 이용)- 실험 과정 및 이론 :이 실험은 실험 1의 회로에서 74HC00을 74HC10으로 두 개를 대체하여 위에 첨부된 사진과 같이 회로를 구성하였다.실험 ... 7주차 결과보고서실험 6 Latch & Flip-Flop▶실험과정 및 결과◈ 실험 1 : R-S F/F구성 사진 :- 74HC00게이트 4개를 사용하여 결손도를 참고하여 회로를 구성하였다 ... D F/F을 74HC574 IC칩을 사용하여 구현하려 했으나 실험 사정 상 같은 기능을 가진 74HC74로 대체하여 실험하였다.실험실에서 직접 데이터시트를 보고 즉석으로 회로를 설계하여

  리포트 | 9페이지 | 1,000원 | 등록일 2013.09.08

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  논리회로실험 실험4 Multiplexer & Demult 결과보고서

  따라서 이 회로에서 Enable이 low 0V일 때 회로가 정상적으로 멀티플렉서로 기능하는 것을 알 수 있었다.◈ 실험 1-2 : Multiple- 실험 과정 및 이론 :이번 실험은 ... 74HC20과 74HC04를 이용하여 결손도를 바탕으로 브레드보드에 회로를 구성하였다.- 도선을 서로 구분하기 쉽도록 양쪽 수직노드에 5V와 접지를 모두 연결하여 회로가독성을 향상시켰다.실험 ... 다만 입력신호가 active low로 작동하기 때문에 그전의 실험과는 달리 입력이 high일 때는 회로가 작동하지 않고 입력이 low일 때 회로가 정상적으로 기능한다.74HC139의

  리포트 | 9페이지 | 1,000원 | 등록일 2013.09.08

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  논리회로실험 실험8 counter 결과보고서

  다만 실험과정에서는 두 개의 플립플롭을 사용했기 때문에 지연시간이 아주 짧을 것이다. ... 또한 이 회로는 동기식 회로로 실험 1의 비동기식 회로에 비해서 지연시간이 짧은 장점을 가진다. ... 회로에 문제가 없는데 제대로 회로가 작동하지 않는 것을 볼 수 있었다.

  리포트 | 9페이지 | 1,000원 | 등록일 2013.09.08

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  예비 counter

  실험이론Counter: 디지털 시스템에 있어서 카운터는 계수능력을 갖는 회로로서 주로 계수에 사용된다. ... 7490을 이용한 BCD Counter를 통해 0~9 까지의 값을 얻음- 스위치를 이용해 2, 3번 핀이 GND에 연결된 후부터 동작: 펄스의 인가에 따라서 카운트가 하나씩 되고 회로가 ... 관해 실험하고 그 동작원리를 이해2.

  리포트 | 5페이지 | 1,500원 | 등록일 2013.12.26

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