"아주대학교 논리회로실험" 검색결과 341-360 / 447건

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  아주대 논회실 실험4 결과보고서

  IC인, 74HC153을 이용하여 Multiplexer 만들어서 Truth table을 비교하고, 실제로 논리적 연산이 맞는지 확인하는 실험이었다.실험은 큰 문제 없이 잘 진행 되었고 ... 만든 먹스보다, 멀티플렉서 회로인 74153을 쓰니 훨씬 더 파워풀 한 것을 알 수 있었으며, 역으로 기본게이트로 멀티플렉서도 만들 수 있는 것을 알게 되었다.실험2. ... 이러한 enable값을 쓰면, 회로에 모든 입력값에 풀업이나 풀다운 저항을 달아서 플로팅을 막아줄 필요없이 Enable값을 반대로 넣어줌으로써 입력값에 들어오는 floating값을

  리포트 | 4페이지 | 1,500원 | 등록일 2014.03.10 | 수정일 2014.03.21

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  아주대 논회실 실험3 예비보고서.hwp

  실험과정 및 예상 결과이번실험은, data sheet에 맞게 회로를 연결하여 반가산기, 전가산기, 반감산기, 전감산기를 구현하는 것이다. ... 실험이론1) Half adder(반가산기)※ S는 합(sum)을 나타내고 C는 올림수(carry)를 나타낸다. 이때 불린 equation에서 ? ... 실험목적Logic gate 를 이용해서 가산기(adder) 와 감산기 (substractor)를 구성한다.디지털 시스템의 기본 요소인 가산기와 감산기의 기본 구조및 동작원리를 이해한다

  리포트 | 3페이지 | 1,000원 | 등록일 2014.03.10 | 수정일 2014.03.21

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  아주대 논회실 실험1 예비보고서

  논리회로에서 는, AND와 NOT, 또는 OR과 NOT을 이용하여 모든 논리 회로를 만들 수 있는데, NOR이나 NAND를 이용하면 NOT도 만들 수 있으므로 NAND 또는 NOR ... 실험과정 및 예상 결과실험1. 3-input AND gate.위 회로를 구성하고, 출력 결과를 토대로 Truth table을 작성하라3-input OR, NAND, NOR gate에 ... 실험목적1) Logic gates의 이해2) Logic 회로 구성 법칙의 이해3) Boolean equation의 이해4) De Morgan의 법칙 이해2.

  리포트 | 3페이지 | 1,000원 | 등록일 2014.03.10 | 수정일 2014.03.21

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  아주대 논회실 실험9 결과보고서

  근데, 우리가 실험한 회로에서 다이오드를 키게 하기 위해서는, 풀업저항값이1kΩ정도 되는 것이 맞는 것을 알 수 있다. ... 쓰겠고, 입력값은 1이며, 0번째 회로를 읽으면, 0번째 회로 출력값은 1이라는 의미이다. ... 회로마다 풀업저항의 값이 다르므로 주의하는게 좋을 것 같다.

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  아주대 논회실 실험10 결과보고서

  두 번째 실험, ADC Analog-Digital Converter1) 실험과정 및 결과? 74HC90과 74HC04, 74HC05 741을 이용하여 회로도를 구성한다. ... 실험은 대체로 회로를 구성할 때 실수 한 것을 빼고는 잘 되었는데. 문제는 8의 입력을 나타내는 밴드가 9번이랑 똑같이 나타난다는 점이었다. ... 74HC90과 74HC04, 74HC05 741을 이용하여 회로도를 구성한다.실험 1 D/A converter① Single pulse clock으로 single pulse를 가한

  리포트 | 5페이지 | 1,500원 | 등록일 2014.03.10 | 수정일 2014.03.21

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  아주대 논회실 실험8 결과보고서

  두 번째 실험에서 첫 번째 실험과는 다른점은 동기식 카운터이기 때문에 전달지연이 없으므로 빠르다는 장점이 있지만, 회로 설계가 복잡하다는 경향이 있다. 2단3진 카운터 이기 때문에, ... 또한 이 회로는 비동기식 카운터라는 것을 알 수 있는데, 출력값이 순차적으로 생기는 것을 알 수 있으며, 회로가 동기식에 비하여 간단하다.2. ... 다음처럼 쉽지만 3단이 넘어가게 되면 회로가 훨씬 더 복잡하게 된다.

  리포트 | 4페이지 | 1,500원 | 등록일 2014.03.10 | 수정일 2014.03.21

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  실험 4Multiplexer & Demultiplexer 결과

  실험1의 멀티플렉서 보다는 회로구성이 간단해서 실험 진행이 매우 빨랐고 결과 값도 한번에 나와 실험1에 비해 매우 적은 시간 동안에 실험을 완료할 수 있었다. ... 그리고 enable 단자를 통해 회로 전체를 (low일 때) on / (High일 때) off 시킬 수도 있었다.실험 2. ... 회로는 멀티플렉싱 기능을 정확히 수행하는 회로로 동작했다.

  리포트 | 7페이지 | 1,000원 | 등록일 2012.12.05

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  실험2 예비보고서 실험 2. CMOS 회로의 전기적 특성

  실험 2. CMOS 회로의 전기적 특성1. 목적High-speed CMOS logic family인 74HC시리즈의 전기적 특성을 이해하고 실험을 통해 동작을 확인한다.2. ... 입력으로 들어간 신호가 논리회로 내부의 복잡한 회로를 거치면서 출력까지의 지연되는 시간이며, transition time도 propagation delay에 포함된다. ... 이러한 특성을 AC특성 또는 Switching 특성이라고 한다.① Transition time : 논리회로의 출력 값이 하나의 상태에서 반대 상태로 전이될 때(H→L,L→H) 소요되는

  리포트 | 9페이지 | 1,000원 | 등록일 2013.01.01

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  실험 3. 가산기 & 감산기 예비

  실험 이론(1) 반가산기(Half adder)두 개의 2진수를 더하여 합(Sum) S 와 자리 올림(Carry) C를 출력하는 조합논리 회로입력출력xyCS0*************10 ... (3) 반감산기(Half-substractors)두 개의 2진수를 빼서 차(Difference) D와 빌림(Borrow) B를 출력하는 조합논리 회로입력출력xyBD0000011110011100 ... (4) 전감산기(Full-substractors)두 개의 2진수와 뒷단에서 빌려준 1을 고려하여 뺄셈을 수행하는 조합논리 회로입력출력xyzBD00000001110101101110100011010011000111112

  리포트 | 3페이지 | 1,000원 | 등록일 2012.12.05

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  결과 Basic Gates

  AND 실험이 끝나고 OR, NAND, NOR에 대해서 반복 실험을 해야 했다. 3-input OR gate는 그냥 AND gate대신 OR로 바꾸어 주면 되므로 쉽게 해결을 했지만 ... 논리게이트를 처음 접해보는 터라 실험을 하기전에 먼저 각각의 gate에 대한 개념과 정의를 공부하는 것이 우선이었다.첫 번째 실험은 3개의 입력단자를 가지는 논리게이트(3-input ... 실험1. 3-input 논리 게이트SETTING: 전압 공급기를 사용하여 소자에 5V의 공급전압 Vcc를 인가하였다.BCCBAAInputInputGNDGND3-input AND, OR

  리포트 | 8페이지 | 2,000원 | 등록일 2013.12.26

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  예비 Basic Gates

  실험이론< Logic gate(논리 게이트)란? >: 디지털 회로를 만드는 데 가장 기본적인 요소로서 대부분은 두 개의 입력과 한 개의 출력을 가진다. ... 실험2에서는 1개의 입력에 대해 그 출력이 반전되어 나오는 Inverter가 추가된 점이 실험1과는 다른 점이다.5. 회로 결선도 ... 실험목적- Logic gates의 이해- Logic 회로 구성 법칙의 이해 : Boolean equation의 이해, De Morgan의 법칙 이해2.

  리포트 | 5페이지 | 1,500원 | 등록일 2013.12.26

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  논리회로실험 설계 보고서

  1 논리회로실험설계과제·REPORT전자공학도의 윤리 강령 (IEEE Code of Ethics)`(출처: http://www.ieee.org)나는 전자공학도로서, 전자공학이 전 세계 ... 도우며, 이 윤리 헌장을 준수하도록 지원한다.위 IEEE 윤리헌장 정신에 입각하여 report를 작성하였음을 서약합니다.학 부: 전자공학부제출일: 2012. 12. 17과목명: 논리회로실험 ... 이형은 0과 1 뿐만 아니라 실제 논리 회로에서 논리 신호를 시뮬레이션하는 데 유용하다고 알려진 7개의 다른 값들도 포함한다.std_logic_vector전형적인 VHDL 프로그램에서

  리포트 | 24페이지 | 4,000원 | 등록일 2013.11.25 | 수정일 2013.11.28

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  실험2 결과보고서

  실험 2. CMOS 회로의 전기적 특성(결과보고서)실험 1. ... 이 값은 DATA SHEET의 IOH = 4mA 근처에서 3.98VOH이상에는 아주 약간의 차이가 있지만 실험환경을 고려한다면 만족스러운 결과라 생각한다. ... 하지만 이번 실험으로서 실험의 목적인 두 delay time(전달지연 및 천이시간)은 파형의 형태로서 뚜렷히 나와 이를 확인할 수 있었던 좋은 실험이였다.

  리포트 | 5페이지 | 1,000원 | 등록일 2013.01.01

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  결과 DAC & ADC

  opamp의 출력단(pin6)에서 계단형식의 step이 10개가 잘 나오도록 조절3) 클럭의 입력을 위하여 진폭이 5V, 주파수가 1kHz 인 사각 펄스파를 사용했다.4) 다음과 같은 회로 ... 실험1. ... 첫 번째와 두 번째 측정 모두 실험 예상과 일치하는 결과를 보인다.[ 분석 및 고찰 ]이번 실험의 주제는 컨버터에 관련된 실험이었다.

  리포트 | 4페이지 | 2,000원 | 등록일 2013.12.26

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  결과 Decoder & Encoder

  디코더는 컴퓨터가 사용하는 2진 코드를 사람이 실제로 잘 알아볼 수 있게 바꾸어주는 해독기의 역할을 하는 논리회로이다. ... On상태의 다이오드 밝기도 아주 밝아서 육안으로도 충분히 식별이 잘 되었다.다음으로 Encoder의 특성을 알아보는 실험이다. ... 입력이 2개이므로 각 비트의 조합으로 4(2 ^{2})가지의 경우에 대하여 실험해 볼 수 있었고 그에 따라 출력은 입력 조합에 대해서 각기 다른 다이오드의 on상태로써 나오게 된다.

  리포트 | 6페이지 | 2,000원 | 등록일 2013.12.26

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  예비 Decoder & Encoder

  실험이론Decoder & Decoding: Encoder 혹은 Encoding과 반대의 개념으로 n비트의 2진 코드를 2n개의 서로 다른 정보로 바꾸어 주는 조합 논리회로. ... Decoder Truth tableBooliean algebraEncoder & Encoding: 10진수나 8진수를 입력으로 받아들여 2진수나 BCD와 같은 코드로 변환 해주는 조합 논리회로 ... 회로 결선도

  리포트 | 8페이지 | 1,500원 | 등록일 2013.12.26

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  예비 DAC & ADC

  실험목적: D/A와 A/D 변환기(converters) 회로의 구성과 동작 원리에 대해 이해한다.2. ... 실험방법 및 예상결과실험1. ... Iout일 때도 일치한다.[ DAC block ]ADC(Analog Digital Converter): analog 신호를 digital 신호로 변환해주는 장치이며 아날로그 입력에 대해서

  리포트 | 5페이지 | 1,500원 | 등록일 2013.12.26

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  실험6 예비보고서

  실험 6. Shift Register & Counter (예비)1. 실험 목적시프트 레지스터와 링 카운터의 동작 원리와 특성을 이해한다. ... 이것은 카운터로써의 동작에서 더 이상 올림수가 없는 경우 나머지 자리에 대해서는 값의 변경이 필요치 않다는 점을 통해 쉽게 이해할 수 있다.같은 T 플립플롭으로 구현하였을 때 AND ... 이론이번실험의 대략적인 개요는 실험 5에서 배웠던 쌍안정 멀티바이브레이터인 J-K F/F 또는 D F/F의 출력과 입력을 연결하여 J, K입력과 Preset과 Reset 그리고 Clock을

  리포트 | 15페이지 | 1,000원 | 등록일 2013.01.01

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  실험4 예비보고서

  일컫는다.입력 측에 어떤 신호가 있는가를 탐지해서 표시해 주는 집적 회로 또는 논리소자로 구성된 회로를 통틀어 복호기라고 할 수 있다. ... 실험 목적멀티플렉서(Multiplexer)와 디멀티플렉서(Demultiplexer)의 원리를 이해하고 실험을 통해 동작을 확인한다.2. ... 실험 4. Multiplexer & Demultiplexer1.

  리포트 | 10페이지 | 1,000원 | 등록일 2013.01.01

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  실험2예비[1].CMOS회로의.전기적특성나중

  NML: Low로 동작하는 구간 Noise Margin (NML = VILmax - VOLmax)High와 Low 사이의 Abnormal 구간은 천이(transition)구간으로 논리값이 ... Rn 측정을 위한 회로회로 SEQ 회로 \* ARABIC 4. ... Rp 측정을 위한 회로= 193.462 ㎷= 4.3065 ㎃= 4.2796 V= 4.2796 ㎃Speed회로 SEQ 회로 \* ARABIC 5.

  리포트 | 10페이지 | 1,000원 | 등록일 2011.06.27

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