"pspice 시뮬레이션" 검색결과 421-440 / 2,263건

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  충북대 전자회로실험 실험 11 BJT 차동 증폭기 예비

  예비 실험3.1 전류 거울은 npn형 BJT(CA3046)을 이용한 전류 거울 회로이다.(1) PSpice를 이용하여 의 전류 거울 회로를 구성한다. 복사된 전류를 측정하시오. ... A로I _{REF} =937.5 mu A의 1/3보다 조금 더 큰 값으로 측정되었다.3.2 BJT 차동 증폭기는 npn형 BJT(CA3046)를 이용한 전류 거울 회로이다.(1) PSpice를 ... Transient 시뮬레이션을 통해서, 차동 입력( - )-차동 출력( - ) 전압 특성 그래프를 그리고 전압 이득을 구하시오.

  리포트 | 12페이지 | 2,000원 | 등록일 2022.03.03 | 수정일 2022.03.08

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  [A+][예비보고서] 중앙대 전자회로설계실습 9. 피드백 증폭기(Feedback Amplifier)

  (D) 단계 3.1(b)에서 입력 전압원을 2.0 V로 고정하고 전원 전압원을 0V에서 12V까지 증가시켜 가며 출력 전압이 어떻게 변하는지 시뮬레이션 결과를 보여라. ... (B) 단계 3.2(a)에서 그린 PSpice schematic에서 입력저항을 10kΩ으로 변경한 다. ... 설계실습 계획서3.1 Series-Shunt 피드백 회로 설계(A) 그림 1 회로를 simulation하기 위한 PSpice schematic을 그린다.

  리포트 | 5페이지 | 1,000원 | 등록일 2022.04.06

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  아주대학교 전자회로실험 실험7 Output stage회로 결과보고서

  .< 삼각파 발생회로 > < Pspice 설계 >Pspice simulation 과 실험결과값 비교각 node 에 걸리는 전압simulation실험결과오차 [%]V _{A} [V]- ... 시뮬레이션에서 측정한 값을 비율로 계산하여 보았을 때, 거의 유사한 비율로 Saturation이 나타나는 것을 확인할 수 있었다.4. ... 시뮬레이션 상에서는 small signalV _{P-P}의 인가전압의 제한이 걸려있지 않아서,5V _{P-P} 이상 인가 가능하지만, 오실로스코프에서 인가할 수 있는 최대V _{P-P

  리포트 | 6페이지 | 1,500원 | 등록일 2020.05.30 | 수정일 2020.06.08

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  [중앙대 전자회로설계실습 10 예비보고서] Oscillator 설계

  (시뮬레이션 설정 : Analysis type : Time Domain, Maximum step size : 50㎲, Run to time : 20ms ~ 100ms로 상황에 맞게 ... 사용한 수식 및 수치를 자세히 적어서 제출한다.이고를 풀면(B) PSPICE를 이용하여 위에서 설계한 oscillator의 의 파형을 제출하라. ... : 1개Op-Amp : UA741CP : 2개저항 (1 kΩ, 1/2W) : 4개가변저항 (5 kΩ, 1/2W) : 2개세라믹 커패시터 (0.47 ㎌) : 1개3.1 OrCAD PSPICE를

  리포트 | 7페이지 | 1,000원 | 등록일 2021.08.09

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  실험 10_MOSFET 바이어스 회로 예비 보고서

  시뮬레이션게이트 바이어스 회로[그림 10-3]은 증폭기의 게이트 단자의 DC 전압과 드레인 전류를 잡아주는 바이어스 회로이다.R _{1} `,`R _{2} `,`R _{3}에 의해서 ... [그림 10-4] PSpice 모의실험을 위한 게이트 바이어스 회로도[그림 10-5]는 PSpice를 이용한 게이트 바이어스 회로의 모의실험 결과이다. ... [그림 10-3] 게이트 바이어스 회로(실험회로 1)[그림 10-4]는 PSpice 모의실험을 위한 게이트 바이어스 회로도이다.

  리포트 | 9페이지 | 2,000원 | 등록일 2023.01.25

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  2주차 결과보고서 - 다이오드 기본특성

  OrCAD Capture를 통한 실험 회로도다음과 같이 실험 회로를 구성하여 0V부터 99V까지 0.01V 간격으로 변화시키며 시뮬레이션 하였다.2. ... 시뮬레이션으로 전압을 -200V부터 100V까지 1V 간격으로 증가시키며 측정하였다. 그 후 0V부터 1.2V까지 0.1V 간격으로 증가시키며 측정하였다.2. ... PSpice를 이용한 모의실험 결과3. 0과 2의 비교모의실험을 통해 확인한 실리콘 다이오드의 항복 전압은 약 -100V임을 확인할 수 있다.또한 0.7V부터 전류가 흘러 나감을 확인할

  리포트 | 20페이지 | 2,500원 | 등록일 2023.11.24

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  KVL , KCL 예비보고서

  따라서 pspice로 시뮬레이션을 돌리면 위와 같이 나오게 되며 이론값을 위와같이 얻을 수 있다. ... 따라서 pspice로 시뮬레이션을 돌리면 위와 같이 나오게 되며 이론값을 위와같이 얻을 수 있다.3.4.2 전압/전류 분배법칙(1) [그림 3]의 회로를 결선 여기에서V_s `=` ... ` 4.000 VV_3 `=` 4.000 V: 저항의 양단에 걸린 전압의 차이를 구해본 결과 KVL(V_s `=` V_1 + V_2 + V_3 `)이 성립함을 확인할 수 있었다. pspice시뮬레이션을

  리포트 | 7페이지 | 2,000원 | 등록일 2021.10.28

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  음성증폭기의 주파수응답 결과보고서

  Pspice 시뮬레이션? 부귀환이 없는 경우부귀환이 없는 경우 회로는 약 1kHz 이상부터 거의 일정한 출력값을 갖는 증폭기로 동작한다. ... Pspice 시뮬레이션 결과와 비교했을 때, 유사한 그래프를 얻을 수 있었으며 3.83%의 오차가 존재한다.2) 부귀환이 있는 경우실험 과정에서 1000Hz를 기준으로 Vout=2V가 ... Pspice 시뮬레이션 결과와 유사하며 10.92%의 오차가 존재한다.3) C5를 제거한 경우실험 과정에서 1000Hz를 기준으로 Vout=2V가 되도록 맞췄을 때, 신호발생기의 출력은

  리포트 | 7페이지 | 5,000원 | 등록일 2020.04.02

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  전자공학응용실험 - MOSFET기본특성 / MOSFET바이어스회로 결과레포트

  실험 9와 마찬가지로 시뮬레이션에서 Gate에는 전류가 없지만 실제로는 미세한 전류가 흐르기 때문에 측정값에 영향을 미친다. ... 이때 pspice 예측 값을 활용하여 RS, R1, R2를 세팅하고 VD, ID를 구해서 이론값과 비교해보니 거의 차이가 나지 않았으나 ID는 0.02mA, VD는 0.01V 정도의 ... 오차가 발생했다.10-2 실험은 실험회로2를 활용하여 ID=1mA가 되는 RD 값을 구하는 실험에서 10-1실험과 마찬가지로 pspice 예측 값을 활용하여 RD=9.82KΩ으로

  리포트 | 5페이지 | 2,000원 | 등록일 2021.12.20

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  (A+) 전자회로실험 선형 및 비선형 연산증폭기 회로 예비레포트 / 결과보고서

  실험 결과 (시뮬레이션)Pspice 모의실험 연산 증폭기 및 선형 연산 증폭기 회로PSpice를 통해 주어진 회로를 구성하여 시간 영역(과도)해석을 수행하라. ... 또한, 각 회로의 Schematic들과 입력-출력전압들의 파형을 해당 표에 포함하여 시뮬레이션 결과의 적절성을 보여라. 단, 두 주기의 입출력 파형이 출력되도록 설정하시오.

  리포트 | 16페이지 | 1,500원 | 등록일 2021.01.10

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  [기초전자실험 with pspice] 06 키르히호프의법칙 예비보고서 <작성자 학점 A+>

  출력전압 5V를 인가한다.4.전체 전류 I를 측정한다.5.전류 I2 와 I3를 측정하여 기록한다.6.두 전류의 합을 계산하여 기록한다.PSpice 시뮬레이션키르히호프의 전압 법칙키르히호프의 ... 회로의 접속점으로 들어오는 전류의 합은 나가는 전류의 합과 같다는 키르히호프의 전류 법칙에 따라 I = I2 + I3가 성립할 것이다.참고 문헌홍순관, 기초전자실험 with PSpice

  리포트 | 5페이지 | 1,500원 | 등록일 2023.01.28

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  (기초회로 및 디지털실험) 비 안정 멀티바이브레이터의 설계

  프로그램을 사용하여 도안2 회로를 구상해 본 후 시뮬레이션한 결과비 안정 멀티바이브레이터의 예시회로를 참고하여 Pspice프로그램을 이용하여 도안 회로를 구성한 후 회로의 시뮬레이션 ... }} =100[kHz] �� �禮꽃�(2) 결정된 저항과 커패시터를 이용하여 비안정 멀티바이브레이터를 설계한다.멀티 비안정 바이브레이터 회로 예시멀티 비안정 바이브레이터 회로 도안Pspice ... 발진 주파수는 시뮬레이션 결과 101.449KHz가 측정되었는데, 이는 시뮬레이션 데이터에서 커서로 시간을 측정한 값을 이용하여 발진 주파수를 계산하면 f= 공식을 이용하여 =100KHz가

  리포트 | 5페이지 | 1,500원 | 등록일 2021.07.13 | 수정일 2022.02.16

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  2019학년도 3학년 1학기 중앙대 전자회로설계실습 4. MOSFET 소자 특성 측정 예비

  시뮬레이션 하여라. ... (OrCAD PSPICE)(A) OrCAD를 이용하여 그림 1의 회로도를 설계하여라.(2N7000/FAI 이용, RG=1 MΩ으로 설정)(B) PSPICE를 이용하여 iD-vGS특성곡선을 ... (VDS=5V를 이용하여 측정)참고: [Current Marker : Drain단 위치, 시뮬레이션 세팅: Analysis type->DC Sweep, Sweep variable->

  리포트 | 4페이지 | 1,000원 | 등록일 2019.09.21

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  디지털 회로 실험 및 설계 - JK Flip Flop, D, T Flip Flop 실험 1

  PSpice 시뮬레이션 회로도 및 결과? ... JK Flip-Flop 실험실험1) 다음 회로도를 구성하고, 표를 완성하시오.실험1 회로도실험1 시뮬레이션실험2) 다음 회로도를 구성하고, 표를 완성하시오.실험2 회로도실험2 시뮬레이션실험3 ... ) 다음 회로도를 구성하고, 표를 완성하시오.실험3 회로도실험3 시뮬레이션JKQQ'0*************101110?

  리포트 | 14페이지 | 3,000원 | 등록일 2023.09.22

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  중앙대학교 아날로그및디지털회로 예비보고서6

  변화에 따른 Vout 전압의 평균값 특성을 확인한다.pspice로 설계한 회로는 다음과 같다. ... loop filter, VCO 각 단의 출력 파형)설계한 회로는 아래와 같다.파형 관찰을 위해 Vco, phase detector, loop filter의 각 출력단에 핀을 꼽고 시뮬레이션을 ... 설계실습 계획서6-3-3 위상검출기Simulation tool (PSpice)를 이용하여 아래 그림 6-1의 XOR를 이용한 위상 검출기의 특성을 파악하고 V1과 V2의 위상 차이

  리포트 | 10페이지 | 2,000원 | 등록일 2024.08.06

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  실험 08_공통 베이스 증폭기 예비보고서

  시뮬레이션[그림 8-5]는 입력에 DC 바이어스 전압V _{BB}와 소신호 전압v _{sig}가 인가된 공통 베이스 증폭기 회로이다. ... [그림 8-6] PSpice 모의실험을 위한 공통 베이스 증폭기 회로도[그림 8-7] 공통 베이스 증폭기의 PSpice 모의실험 결과［그림 8-기은 공통 베이스 증폭기의 PSpice ... [그림 8-5] 공통 베이스 증폭기 회로(실험회로 1)[그림 8-6]은 PSpice 모의실험을 위한 공통 베이스 증폭기 회로도이다.

  리포트 | 11페이지 | 2,000원 | 등록일 2023.01.25

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  [전자공학응용실험] 다단 증폭기(Multistage Amplifier) 결과레포트

  Discussions우선 실험에 앞서 Pspice를 통해 시뮬레이션했던 소자와 실제 사용된 MOSFET은 Vth와 gm의 값이 다르게 측정되었다.

  리포트 | 4페이지 | 1,500원 | 등록일 2022.12.19

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  [전자회로실험2]보고서5주차- MOSFET CS Amplifier

  [PSpice 시뮬레이션]시뮬레이션 회로ⅰ) f=1kHz일 때ⅱ) f=5kHz일 때ⅲ) f=10kHz일 때[시뮬레이션 결과표]시뮬레이션 실험결과V _{i[mV]f[kHz]V_0[mV

  리포트 | 7페이지 | 3,000원 | 등록일 2023.12.26

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  10장 RC 및 RL 병렬회로 결과

  _{R1}과i _{C1}의 위상차(각도)를 구하라.☞ 예비보고서에서 시뮬레이션 해보았다. 90도이다.※ PSpice 시뮬레이션3. ... .☞ Z의 이론값은 978[OMEGA ]이고 실험값은 853[OMEGA ]으로 약간의 오차가 발생하였음을 알 수 있었고, 12.8%의 오차가 발생하였다.(5) PSpice 시뮬레이션① ... R1을 추가한 이유를 설명하라.☞ 인덕터와 전원이 쇼트되는 것으로 인식하는 것을 막기 위해 회로에 영향을 미치니 않는 작은 저항을 추가하였다.② [그림 10-7]의 RC 병렬회로를 시뮬레이션하여i

  리포트 | 6페이지 | 1,500원 | 등록일 2021.01.06

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  충북대 전자회로실험 실험 8 MOSFET 공통 소스 증폭기 예비

  DC 바이어스가 인가된 공통 소스 증폭기 공통 소스 증폭기 (a) AC 특성 (b) Transient 특성(1) PSpice를 이용하여 과 같이 공통 소스 증폭기 회로를 구성하고, ... OMEGA 1.6k OMEGA 0%R _{out}16.7k OMEGA 12.3k OMEGA 26.3%3.2 축퇴된 공통 소스 증폭기 DC 바이어스가 인가된 축퇴된 공통 소스 증폭기(1) PSpice를 ... 결과R _{L}이 작아질수록 전압 이득이 감소하였다.R _{L} =14k OMEGA(5) 식(8.9)~식(8.11)를 이용하여, 시뮬레이션 값과 비교하시오.시뮬레이션 값A _{v}

  리포트 | 15페이지 | 2,000원 | 등록일 2022.03.03 | 수정일 2022.03.07

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