"preset counter" 검색결과 61-80 / 104건

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  비동기 및 동기 입력을 포함한 J-K 플립플롭의 여러 구성에 대한 레포트

  프리셋(preset)과 클리어(clear) 입력은 동기인가? 아니면 비동기인가? ... 종속 연결(cascade)된 플립플롭은 리플 카운터(ripple counter) 회로에서 주파수 분할을 수행하기 위해 사용된다.

  리포트 | 10페이지 | 3,000원 | 등록일 2015.06.03

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  카운터회로 (결과)

  and clear⑩74LS76A:Dial JK flipflops with preset and clear⑪ 74LS75 : 4-Bit D Latch5. ... 이 론BCD 카운터는 10개의 BCD 코드값(0000, 0001, 0010, ... , 1000, 1001)을 상태값으로 가지는 카운터를 말하며, 십진 카운터(decade counter ... Gate⑧ 74LS86 : Quad 2 - input XOR Gate⑨ 74LS74 : Dual D-type positive edge triggered flipflops with preset

  리포트 | 4페이지 | 1,000원 | 등록일 2012.07.03

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  전기전자기초실험 Flip-flop and Counter Design 결과보고서

  circuit, and 4-bit Up/down preset counter. ‣ Master/Slave JK Flip-flop Each master and slave are consist ... -Objective : To understand the operating principle of various kinds of flip-flops, and design counter ... the operations of Master/Slave JK Flip-flop, 4-bit bi-directional shift register, synchronous mod-10 counter

  리포트 | 12페이지 | 1,000원 | 등록일 2009.09.08

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  논리회로 실험 시프트레지스터와 카운터

  또한 down counter에서는 클럭 펄스가 들어오기 전에 Flip-Flop들은 1로 preset시켜 두고 1개의 클럭 펄스가 들어올 때마다 출력은 하나씩 감소하게 된다.ⓒ 동기식 ... 먼저 CLEAR 스위치를 ‘0’으로 하여 플립플롭들을 리셋하고 첫 번째 플립플롭의 PRESET 단자에 연결된 SET 스위치를 ‘1’로 두어 Q0을 1로 세팅한다. ... [그림 2] 비동기식 up counter 출력 파형ⓑ 비동기식 Down CounterDown counter는 입력 펄스의 수를 세어 내려가는 것으로 [그림 3]은 down counter

  리포트 | 17페이지 | 1,500원 | 등록일 2010.03.20

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  디지털로직실험 16장 J-K 플립플롭

  종속 연결(cascade)된 플립플롭은 리플 카운터(ripple counter) 회로에서 주파수 분할을 수행하기 위해 사용된다. ... 프리셋(preset)과 클리어 입력은 동기인가? 아니면 비동기인가? ... PRESET이 0일 때에는 Q의 출력이 0이 나오고CLREAR가 0일 때 에는 Q의 출력이 1이 나오는 것을 알 수 있었다.실험 순서 2.

  리포트 | 12페이지 | 3,000원 | 등록일 2013.06.22

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  논리회로 카운터 신호등 설계

  상태도011110011111000100100100010101101110110111001011101010000011◇ 카운터 타이밍도◇ 로직웍스 Simulation 신호등 타이밍도■ JK-입력, map등 입력설계, counter ... 사용 계기 및 부품TTL 소자 : 7476(Dual J-k Flip Flops with Preset and Clear) [2개]7404(Hex Inverter) [1개], 7408( ... ), 좌회전(10clock), 주의(3clock)현 신호등의 체계인 적황좌녹 의 순서대로 표현 하였습니다.

  리포트 | 5페이지 | 3,500원 | 등록일 2012.07.09

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  아주대 논리회로실험 예비6-시프트 레지스트와 카운터

  시프트 레지스터와 카운터(1) 시프트레지스터로 만들어진 링카운터의 구조와 동작원리에 대해 조사하라.링 카운터(ring counter)에 대한 설명을 위해 그림에 D 플립플롭으로 구성된 ... 그러므로 8단의 2진 카운터는개이다.(4) 2진 리플 카운터에 대해 알아보라.2진 리플카운터(binary ripple counter)는 각 플립플롭의 출력이 다음 상위 플립플롭의 CP ... 가장 손쉽게 생각할 수 있는 방법은 플립플롭의 비동기식 Preset, Clear 단자를 이용하는 것이다.

  리포트 | 6페이지 | 1,000원 | 등록일 2010.04.04

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  디지털회로 term project 2진수 곱셈기

  4-bit down-counter when inputsare 1 0. ... If inputsare either 0 0 or 1 1, the counter would stop counting and stay at its state. ... Design a synchronous sequential circuit that works as a 4-bit up-counter when inputsare 0 1, and as a

  리포트 | 14페이지 | 2,500원 | 등록일 2011.08.29

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  시프트 레지스터

  장점이 있다.③ 존슨 카운터존슨카운터회로도와타이밍도링 카운터를 약간 개조한 것으로, 꼬인 링 카운터 (twisted ring counter) 라고도 한다. ... 따라서 2의 N승 가지 출력을 내는 이진 카운터 (binary counter) 에 비할 때에 극히 비효율적인 카운터지만, 링카운터는 별도의 복호기(decoder)가 필요하지 않다는 ... CLR=0 으로 두어 Q ~Q 가 0001이 되도록 초기설정 (preset) 한 후 CLR=1로 되돌리고, CLK=0으로 둔다.

  리포트 | 2페이지 | 1,000원 | 등록일 2010.11.13

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  실험6 예비보고서

  이를 바탕으로 비동기식카운터(asynchronous counter)와 동기식카운터(synchronous counter)의 구조와 동작 원리에 대해 이해하고, 여러 가지 카운터의 구성 ... 이론이번실험의 대략적인 개요는 실험 5에서 배웠던 쌍안정 멀티바이브레이터인 J-K F/F 또는 D F/F의 출력과 입력을 연결하여 J, K입력과 Preset과 Reset 그리고 Clock을 ... 여기서 초기조건은 A,B,C,D 노드 중 적인 반응을 하기 위한 것은 아니다. 링 카운터에서 입력은 트리거 신호이며, 이것은 플립플롭의 CLK 단자에 연결된다.

  리포트 | 15페이지 | 1,000원 | 등록일 2013.01.01

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  [Lab#4]7-Segment LED Display 실습

  [실습#4]TTL 74LS90 Decade counter를 이용하여 펄스 입력을 십진수 한 자리 숫자로 표시하기? ... input to 1/5 section (하강에지 Active-low)MR1, MR2 : Master Reset(clear) inputsMS1, MS2 : Master Set(Preset ... line Encoder, 7-Segment LED Display, 74LS47 BCD to 7-segment LED Display Decoder-driver, 74LS90 Decade counter

  리포트 | 17페이지 | 1,000원 | 등록일 2011.06.02

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  연세대 전기전자 기초실험 10. 플립플롭과 카운터 설계 실험 (결과보고서)

  ① 실험을 통해 작성한 테이블과 파형을 참고하여 JK Master / Slave 플립플롭, 4비트 양방향 쉬프트 레지스터, 동기식 십진 카운터, 4비트 Up / down preset

  리포트 | 5페이지 | 1,000원 | 등록일 2007.12.30

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  디지털 논리회로 실험 텀 프로젝트 - 디지털 번호키

  toggle switch를 눌러서 counter의 값을 출력하게 되면 counter의 기능을 정지시킨다. ... 따라서 counter의 출력에 맞춰 논리 값 ‘1’이 나올 때 Clock은 D Latch에 입력되고 그에 맞춰 입력 번호는 선택된 Latch에 값이 저장된다. ... 설계 내요Asynchronous(비동기식) counter 74×161와 D Flip-flop을 통해 번호키를 크게 설정부분과 잠금 해제부분 그리고 입력 번호와 잠금 설정 번호와의 비교

  리포트 | 11페이지 | 2,000원 | 등록일 2008.11.27 | 수정일 2019.04.12

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  Lab(4) 7 Segment LED Display 실습

  input to 1/5 section (하강에지 Active-low)MR1, MR2 : Master Reset(clear) inputsMS1, MS2 : Master Set(Preset ... [실습#5]TTL 74LS90 Decade counter를 이용하여 펄스 입력을 십진수 두 자리 숫자로 표시하기? ... line Encoder, 7-Segment LED Display, 74LS47 BCD to 7-segment LED Display Decoder-driver, 74LS90 Decade counter

  리포트 | 14페이지 | 1,500원 | 등록일 2010.06.23

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  Lab(6) 카운터, 비교기, 포토 인터럽터 회로

  [실습#1]74LS76 JK-FF과 74LS00 NAND gate를 이용한 10진 ripple counter? ... 처음의 Preset을 활성화 시키면 111이 출력되고 111부터 000 (7~1)까지 하나씩 숫자가 다운되며 이가 반복되는 카운터 이다. ... 74LS76 JK-FF IC와 7432 2-Input OR gate를 이용하여 하향 카운터를 구성하고 Preset 동작 후의 CLK 입력에 따른 출력을 정리하시오. (3-Input

  리포트 | 15페이지 | 1,500원 | 등록일 2010.06.23

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  디지털전자실험 - counter 회로

  ), 74xx08(AND), 74xx160(동기식 BCD 십진 counter)논리상태 확인용 : LED, FND실험 3-1 4-bit 비동기식 업 카운터 회로회로도설치방법위의 그림과 ... : 74xx00(NAND), 74xx76(JK Flip-Flop), 74xx47(BCD-to-7 segment decoder), 74xx93(4-bit binary ripple counter ... 리플카운터(ripple counter)라고도 불리는 비동기 카운터는 첫 번째 플립플롭에만 외부의 클럭 펄스가 인가되며 두 번째 이후의 플립플롭은 앞단의 플립플롭의 출력이 클럭 펄스로

  리포트 | 12페이지 | 2,000원 | 등록일 2009.01.30

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  논리설계 - 카운터를 MAX-PLUS II 결과 보고서

  클럭의 영향이 물결처럼 후단으로 파급된다는 뜻에서 리플 카운터(ripple counter)라고도 한다. ... .- Johnson Counter에 대해 이해하고 설계 할 수 있다.관련 학습1. 16진 Ripple counter1) 정의 :비동기식 카운터라고 하며 일련의 플립플롭을 연결해서 주어진 ... Ring counter/Johnson Counter가.Ring Counter1)정의 : 첫단 플립플롭의 출력은 2단으로, 2단 플립플롭의 출력은 3단으로 연결되어 마지막단 플립플롭의

  리포트 | 10페이지 | 1,000원 | 등록일 2009.12.15

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  시프트레지스터와 카운터

  )와 동기식카운터(synchronous counter)의 구조와 동작 원리에 대해 이해한다.2. ... 동작 원리와 특성을 이해하고 어떤식으로 적용할 수있는지 생각해본다.2) 2진 시스템에서의 숫자표시를 이해하고 2진 카운터에 대해 알아본다.3) 비동기식카운터(asynchronous counter ... 펄스자리이동 레지스터A자리이동 레지스터BB의 직렬 출력초기치101100100T1후110110011T2후111011000T3후011101100T4후1011101112) 링카운터(ring counter

  리포트 | 20페이지 | 1,000원 | 등록일 2010.12.20

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  RC Circuit 예비레포트

  If your oscilloscope doesn't have Autoset Preset function, then set the controls to the standard position ... anything broken, report it.③Connect the output of the signal generator to the input of the frequency counter ... This frequency is called(3 dB) cutoff frequency.⑦ What is the capacitive reactance at the 3 dB cutoff

  리포트 | 6페이지 | 1,000원 | 등록일 2010.12.22

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  제 10장 (결과) 플립플롭과 카운터 설계 실험

  counting정하여주고 select변수 up_down을 통하여 up 또는 down counter로 동작하게 하였다. preset 값을 일정하게 4bit의 2진수로 설정하여 준 후 ... 돌아가 다시 1씩 증가하는 counting이 되도록 한다. down counter로의 작동은 1비트 2진수 1만큼 clock에 따라 현재의 값에서 1씩 감소하는 counting을 ... up counting하도록 하면, preset의 값부터 2진수 1씩 증가하여 1111까지 counting하게 되고 후 0000으로 돌아가는 것이 아니라 지정된 preset의 값으로

  리포트 | 9페이지 | 2,000원 | 등록일 2007.11.03

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