"디지털 논리실험" 검색결과 101-120 / 3,224건

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  디지털 논리회로 실험 7주차 JK-FlipFlop 예비보고서

  실험 이론디지털 시스템에서 클럭 (clock) 신호에 의해 각종 논리신호가 동작되는데, 플립플롭 역시 이 신호에 동기 되어 동작한다. ... 디지털 논리회로 설계 및 실험예비보고서주제 : JK FlipFlop소속: 공과대학 전자전기공학부수업: X X,X XXX 교수님 XXX 조교님제출 일자: 20XX년 X월 XX일 X요일X조 ... 안됨(a) 논리 기호 (b) 진 리 표(c) 타이밍 선도그림 5-1 상승 에지를 이용한 SR 플립플롭SR 플립플롭의 내부 구조를 그림 5-2에 나타내었다.

  리포트 | 10페이지 | 1,500원 | 등록일 2021.04.22

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  디지털 논리회로 실험 8주차 D-FlipFlop 결과보고서

  디지털 논리회로 설계 및 실험결과보고서주제 : D-FlipFlop소속: 공과대학 전자전기공학부수업: X X,X XXX 교수님 XXX 조교님제출 일자: 20XX년 X월 XX일 X요일X조 ... 실험 과정 및 실험 결과2. 실험 결과 분석3. 결론1. ... 실험 과정 및 실험 결과4.1.1 기본 실험(1) [그림 1]과 Gated D Latch를 결선하고, 아래 진리표를 완성하시오.END��bar { Q}00No change01No change10011110그림

  리포트 | 9페이지 | 2,000원 | 등록일 2021.04.22

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  홍익대 디지털논리실험및설계 6주차 예비보고서 A+

  디지털 논리실험 및 설계 6주차 예비보고서1. ... 실험 준비1.1 ALU 74181의 datasheet을 읽고 네 자리 이진수의 덧셈을 74181을 이용하여 어떻게 구현할 수 있는지 설명하시오.ALU는 산술 논리 연산 장치로(Arithmetic ... 따라서 두 개의 네 자리 이진수를 입력한 후 XOR 논리 연산을 수행하여 출력값이 0000이 나오는지 확인하는 방법을 이용한다.실험 준비 (1)에 첨부한 사진을 보면, XOR 연산을

  리포트 | 7페이지 | 1,000원 | 등록일 2023.09.18

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  홍익대 디지털논리실험및설계 8주차 예비보고서 A+

  디지털 논리실험 및 설계 8주차 예비보고서1. ... 결과적으로 Q의 값은 뒤집어진다.따라서 T Flip-flop은 T에 1이 들어올 때마다 Toggle이 일어난다.1.5 응용 실험 (1)과 응용 실험 (2)의 회로를 비교하시오.실험 ... 하지만 실험 (1)의 T Flip-flop은 T가 1인 상태에서 CLK가 0->1이 되는 순간에만 반전하고, 실험 (2)는 CLK의 값만 0->1이 되면 반전된다.즉, 응용 실험 (

  리포트 | 7페이지 | 1,000원 | 등록일 2023.09.18

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  홍익대 디지털논리실험및설계 7주차 예비보고서 A+

  디지털 논리실험 및 설계 7주차 예비보고서1. ... 실험 결과2.1 기본실험 (1)- 예상 결과QS’Q’R’S’R’QQ’00Invalid0110100111No ChangeS와 R이 Active-LOW 이기 때문에 S’, R이 0,1 ... 실험 준비1.1 S-R Latch와 S’-R’ Latch의 동작에 대해 설명하시오.Latch는 1비트의 문자를 보관하고 유지할 수 있는 회로이다.

  리포트 | 8페이지 | 1,000원 | 등록일 2023.09.18

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  홍익대 디지털논리실험및설계 4주차 예비보고서 A+

  디지털 논리실험 및 설계 4주차 예비보고서1. ... 실험 결과2.1 기본실험 (1)E’S1S0D3D2D1D0Y11*************000100111001100000100111101111001- 예상 결과- Enable은 Active-LOW ... 실험 준비1.1 멀티플렉서와 부호기(encoder)의 차이를 설명하시오.- 멀티플렉서는 n개의 입력값을 받고 그 중 하나의 값만 선택하여 출력하는 단자이다.

  리포트 | 7페이지 | 1,000원 | 등록일 2023.09.18

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  홍익대 디지털논리실험및설계 5주차 예비보고서 A+

  디지털 논리실험 및 설계 5주차 예비보고서1. 실험 준비1.1 기본 실험 (2)의 전가산기 [그림 2]는 반가산기 [그림 1] 두 개와 하나의 OR 게이트로 이루어져 있다. ... [그림 2]의 회로가 전가산기로 동작하는 원리를 설명하시오.가산기는 이진수의 덧셈 연산을 수행하는 논리회로이다. ... , (2)의 회로를 구현하시오.전가산기 두 개를 직렬로 연결하면 두 자리 이진수의 덧셈 연산을 할 수 있는 논리회로가 구현될 것이다.

  리포트 | 5페이지 | 1,000원 | 등록일 2023.09.18

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  홍익대 디지털논리실험및설계 10주차 예비보고서 A+

  디지털 논리실험 및 설계 10주차 예비보고서1. ... 실험 결과2.1 기본실험 (1)※모든 Q0-Q3 값을 LOW(0)로 설정 후 진행. 응용 실험 (1)을 이어서 진행.< 예상 실험 결과 >CLKQ0Q1Q2Q3??1000?? ... (1)의 비동기식 카운터와 마찬가지로 주파수가 절반이 되는 특징이 있다.2.3 응용실험 (1)※실험 전 Q0=1, Q1=1, Q2=1, Q3=0 으로 설정 후 진행.< 예상 실험

  리포트 | 6페이지 | 1,000원 | 등록일 2023.09.18

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  [A+, 에리카] 2021-1학기 논리설계및실험 디지털IC 개요, 조합논리회로 실험결과보고서

  특히 논리적이고, 계산이 가능한 쉬운 모델 로 설계가 용이하기에 아날로그보다 디지털을 이용하여 대부분의 설계가 이루어짐을 알 수 있다.  회로의 종류 - 논리회로 : 논리 게이트를 ...  아날로그와 디지털의 가장 큰 차이점 아날로그는 연속적인 값이지만 디지털은 불연속적인 값이다. 따라서 디지털은 아날로그에 비해 장점이 많다. ... 이용하여 구성된 회로이다. - 조합논리회로 : 오로지 입력에 의해서만 출력이 결정되며 따로 메모리를 갖고 있지 않은 회로이다. - 순차논리회로 : 입력과 현재의 상태에 의해 출력이

  리포트 | 11페이지 | 2,500원 | 등록일 2023.02.28

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  홍익대 디지털논리실험및설계 1주차 예비보고서 A+

  디지털 논리실험 및 설계 1주차 예비보고서1. ... 실험 결과2.1 기본실험 (1)-예상 실험 결과ABX000010100111- AND 게이트는 두 개의 입력 단자가 모두 1일때만 1을 출력하므로 X는 마지막에만 1이 출력되고 00, ... 응용 실험 (2)의 회로를 구현하시오.1.5 응용 실험 (3)의 결과를 예상해보고 본인의 생각을 서술하시오.

  리포트 | 6페이지 | 1,000원 | 등록일 2023.09.18

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  홍익대 디지털논리실험및설계 2주차 예비보고서 A+

  디지털 논리실험 및 설계 2주차 예비보고서1. 실험 준비1.1 NAND 게이트 7400, NOR 게이트 7402, XOR 게이트 7486의 datasheet를 확인하시오. ... -응용 실험 (1)-응용 실험 (2)-응용 실험 (3)1.4 응용 실험 (3)의 결과를 예상하고 이유를 서술하시오. ... 실험 결과2.1 기본실험 (1)-예상 실험 결과ABX001011101110-NAND 게이트는 AND 게이트에 NOT 게이트(인덕터)를 연결한 것과 같은 출력값을 가지므로 (1, 1)

  리포트 | 6페이지 | 1,000원 | 등록일 2023.09.18

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  홍익대 디지털논리실험및설계 9주차 예비보고서 A+

  디지털 논리실험 및 설계 9주차 예비보고서1. ... 실험 결과2.1 기본실험 (1)CLKDQ0Q1Q2Q3??11000??00100??11010??00101??11010?? ... 결과는 응용 실험 (1)의 존슨 카운터와 동일하다.

  리포트 | 5페이지 | 1,000원 | 등록일 2023.09.18

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  서강대학교 디지털논리회로실험 5주차 - 비교 및 연산 회로

  실험 목적Exclusive-OR회로를 이용한 비교/연산회로의 구현 및 동작원리를 이해하고, 기본 논리 gates를 이용한 half-adder 및 fill-adder의 구현 및 동작원리를 ... 이번 실험에서 사용하는 ’COMPM4’가 이에 해당한다. ... 실험 이론● 비교회로 (Comparators)XOR gate(Exclusive-OR)는 입력이 같을 경우 0을, 다를 경우 1을 출력하는데, 비교회로는 이러한 XOR gate와 AND

  리포트 | 23페이지 | 1,500원 | 등록일 2024.08.17

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  디지털 회로 실험 및 설계 - 기본 논리 게이트(Gate) 및 TTL, CMOS I.F 실험 2

  디지털회로실험및설계 결과 보고서 #1( 기본 논리 Gate 및 TTL, CMOS I/F 실험 )과 목담당교수제 출 일학 번이 름1. ... 실험하며 측정했던 전류의 값도, 디지털 멀티미터에 표시된 계속해서 바뀌는 전류의 값에서 소수점 한 ~두자리까지만 보고 대략적인 값을 측정한 것이다.- 둘째로, 점퍼선에서도 저항은 존재한다는 ... 회로도, 이론값, 실험결과실험 1) 전압 Level 측정실험 : 입력전압 변화에 따른 출력전압의 상태를 측정하고 기록하시오.이론값)입력전압0.0V0.5V1.0V1.5V2.0V2.5V3.0V3.5V4.0V4.5V5.0V출력전압4.4V4.4V3V0V0V0V0V0V0V0V0V논리레벨HHLLLLLLLLL실험결과

  리포트 | 14페이지 | 3,000원 | 등록일 2023.09.22

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  디지털 실험 4장(논리대수와 드모르간 정리, 간소화) 결과 보고서

  실험 4장 논리대수와 드모르간 정리, 간소화1. 실험목적-실험적으로 Boolean 대수의 여러 법칙을 증명한다.-규칙 10과 11을 증명할 회로를 구성한다. ... 1학기때 배웠던 디지털공학을 복습할 수 있는 계기가 되었고, 수학적으로 등가인지를 증명하기 위해 드모르간의 정리를 이용해보고 이해하게 되는 계기가 되었으며, 실험도구를 이용해보는 좋은 ... 디지털 신호의 타이밍을 비교할 때마다 스코프를 하나의 채널에서만 트리거 시켜야 하는데, 이것은 매우 중요하다.

  리포트 | 4페이지 | 3,000원 | 등록일 2019.12.17

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  서강대학교 디지털논리회로실험 7주차 - Counter와 State Machine 설계

  실험 목적비동기/동기 Counter의 구조와 동작원리를 이해한다. ... 우선 동기 직렬 Counter는 FF의 입력이 이전 FF의 입력과 출를 세는 것처럼  개의 상태를 반복적으로, 차례대로 출력하는 순차 논리회로로서, 보통 n개의 flip-flop을 ... 실험 이론● CountersCounter는 일정한 주기를 가지고 0과 1의 신호를 반복하는 Clock 신호에 따라 0부터   까지, 혹은   부터 0까지 숫자 병렬 Counter로

  리포트 | 32페이지 | 1,500원 | 등록일 2024.08.17

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  서강대학교 디지털논리회로실험 - 실험 8. Multiplier Design 결과 보고서

  디지털논리회로실험(EEE2052-01)서강대학교 전자공학과2017년 2학기 결과레포트실험8. Multiplier Design1. ... 실험개요1) 4비트 곱셈기의 구조와 원리를 이해한다.2) 팀 단위로 디지털 회로 설계하는 방법을 이해 한다2. 퀴즈 답안지 및 정답-퀴즈 없음3. 실험노트-실험 노트 없음4. ... 실험 결과 및 분석1) 각자가 설계한 Block을 Xilinx ISE로 합성하고, FPGA에 다운로드 한 후 동작을 검증한다.

  리포트 | 4페이지 | 1,000원 | 등록일 2020.04.20 | 수정일 2020.04.24

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  VHDL과 FPGA 실습 키트를 이용한 묵찌빠 게임 [디지털논리회로 실험 Term Project]

  세계적인 추세에 힘입어 우리는 묵지빠 게임에 인공지능을 넣고 실험 키트를 이용하여 게임을 하 면 재밌을 것이라 생각하게 되었고, ‘Alpha 묵지빠 2017‘을 기획하게 되었다 ... 실험 키트를 통한 데이터 학습이 가능하지 않아 초기에 기획한 대로 진행되지는 않았지만 인공지능의 기초인 ‘규칙 기반 모 델’ 을 사용하여 묵찌빠 게임을 구현하였다.

  리포트 | 28페이지 | 4,000원 | 등록일 2020.04.24 | 수정일 2020.04.27

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  홍익대학교 디지털논리실험및설계 4주차 예비보고서 A+

  이해할 수 있는 형태의 비트 조합들을 입력으로 주고 그것을 어떤 특정 비 트 조합들과 각각 mapping 시켜서 부호화하는 것이고, 멀티플렉서는 데이터 선택기라고도 불리는데 여러 디지털

  리포트 | 5페이지 | 1,500원 | 등록일 2023.03.21 | 수정일 2023.04.03

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  홍익대학교 디지털논리실험및설계 7주차 예비보고서 A+

  1.1 S-R Latch와 S’-R’ Latch의 동작에 대해 설명하시오.S’-R’ Latch는 일종의 메모리 역할을 할 수 있는 device라고 볼 수 있습니다. 즉, 두 가지 상 태 (Set, Reset)를 Q에 쓰기도 하고 그 상태를 저장할 수도 있습니다. 예를 ..

  리포트 | 7페이지 | 1,500원 | 등록일 2023.03.21 | 수정일 2023.04.03

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