"PLL 설계" 검색결과 101-120 / 154건

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  VLSI 설계의 여러가지 현상들

  내부에 다수의 LUT(Look Up Table), D-FF, 라우팅 자원뿐만 아니라 최근에는 이것이 조합된 S-RAM 블록, 곱셈기, PLL, 클럭 드라이버등을 탑재하여 복잡한 응용에 ... 자산을 다른 곳에 쓸 수 없고 설계하는 데 많은 시간이 들며 조금의 실수도 용납되지 않아 개발자에게 부담이 될 수 있다. ... 그러나 일반적으로 주문형 반도체(ASIC) 대용품보다 속도가 느리고 복잡한 설계에 적용이 불가능하며 소비전력이 크다는 단점이 있다.

  리포트 | 9페이지 | 1,500원 | 등록일 2013.06.20

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  위상 제어 루프

  설계실습 7. 위상 제어 루프1. ... ⇒이므로 이득이 절반일 것이다.(5) Loop Filter의 cutoff frequency (1/2RC)가 높아질 경우와 낮아질 경우에, PLL응답특성의 변화를 예상하고 그 이유를 ... 설계 실습 계획서(1) 실험에 사용될 IC의 Datasheet를 참조하여, 중요한 전기적 특성을 확인하시오.1) uA7412) 74HC043) 74HC86(2) Simulation

  리포트 | 9페이지 | 1,000원 | 등록일 2010.03.12

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  INFINEON 제품분석 보고서

  , 높은 모듈식 및 비용 최적화 설계를 위한 유연성과 신속한 개발 주기를 제공 . ... 민감도 (4kbit/s 데이터 전송속도 조건 ) - 파워다운 모드에서의 매우 낮은 공급 전류 특성 ( 일반적으로 5nA) - 공급 전압 범위 : 2.1V ~ 5.5V - VCO, PLL ... 커버리지를 위한 다중 - 대역 (300-320MHz, 425-450MHz, 863-870 MHz, 902-928MHz) 제공 - 10.5Hz 고해상도 시그마 - 델타 Frac -N PLL

  리포트 | 43페이지 | 3,500원 | 등록일 2011.01.19

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  WiBro System을 위한 Mixer Design

  따라서 Down-conversion mixer는 무선 통신 시스템에서 입력되는 RF 신호를 baseband 주파수로 변환하고 LNA, PLL/VCO등의 다른 RF회로와 더불어 수신단의 ... 하는 회로 이다. mixer에는 Down-conversion mixer와 up-conversion mixer 가 있으며 이번 프로젝트에서는 Down-conversion mixer 설계에 ... 2.35GHz 대역의 응용에 적합한 low noise, high linearity, high port-to-port의 down-conversion mixer를 개발하고자 한다. 1) 설계조건

  리포트 | 11페이지 | 2,000원 | 등록일 2009.04.09

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  (실험보고서) 저주파 증폭 회로 실험 및 시뮬레이션

  PLL은 기본적으로 기준 주파수, 위상 검출기, LPF, VCO 로 구성되어 기준 주파수와 입력 주파수의 위상차를 끄집어 내어 이것을 LPF(또는 차지펌프)를 거쳐 다시 VCO에 넣어 ... Frequency)와 AF(Audio Frequency)로 구분하는 경우 수백khz이상은 RF라 하고 20khz이하는 AF로 구분하였지만 이 또한 그다지 명확한 기준은 없습니다.그런데 PLL ... 고주파의 정의는 정확히 지정된것은 아니라는 것입니다.고주파설계는 회로 또는 PCB 설계(패턴)시 설계자의 능력, 경험, 신호선의 패턴 두께, GND 분리, 위치 등에 따라 성능에 많은

  리포트 | 7페이지 | 1,500원 | 등록일 2008.12.14

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  주파수 변조(Frequency Modulation) 를 통한 잡음의 감소

  : Slope 검파기의 선형성 단점을 보완한 것 예) Radio 검파기- Zero-crossing검지기(detector):신호가 0점을 통과하는 율이 신호의 순시 주파수로 판명- PLL ... 설계 검증FM 시스템을 설계하고, MATLAB을 이용하여 변조신호와 복조신호의 파형과 스텍트럼을 그리시오.설계 조건반송파 주파수1kHz의 사각파반송파 주파수fc = 20kHz샘플링 ... 설계 이론?주파수 변조 (FM ; Frequency Modulation) 과정?

  리포트 | 9페이지 | 1,500원 | 등록일 2009.07.19

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  PLL(phase locked loop) 매틀랩 소스 및 보고서

  %%Low Pass Filter implementation%%%%%%%%%%%%%%%%%%%%%%%%%%%%%%%%% 곱셈기에서 나온 값의 고주파성분을 제거하기 위한 저역통과필터 설계 ... Pll system is useful to operate on 'out put'2. ... Basic PLLGenerally, the above block diagram is demonstrating principle of driving PLL, and these are

  리포트 | 5페이지 | 1,500원 | 등록일 2007.12.23

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  PLL -Phase Lock Loop

  PLL 이 무엇인가??? ... 따라서 설계할 때는 많은 주의가 필요하다.1-4. ... PLL이란 (Phase Lock Loop) : 위상고정루프를 말한다1.우선 위상고정루프의 기본 구조부터 살펴보겠다.위상고정루프의 기본 구조는 아래 그림과 같이 기본적으로 위상 검출기

  리포트 | 6페이지 | 1,000원 | 등록일 2009.12.07

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  PLL 실험

  < PLL 실험 >과목명 : 고급전자회로실험1. ... 실험목적1) PLL의 중심 주파수를 조절한다.2) 로크 범위를 관찰한다.3) 캡쳐 범위를 측정한다.4) FM출력의 직류전압을 측정한다.2. ... 자유발진모드 실험전위차계f _{calc}, kHzf _{meas}, kHzf _{meas}, 파형0Ω6.38kHz6.76kHz5kΩ3.09kHz3.4kHz1.9kΩ5kHz565를 이용하여 PLL을

  리포트 | 5페이지 | 1,000원 | 등록일 2008.05.04 | 수정일 2019.04.11

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  실험8. 전압제어 발진기 회로(예비)

  VCO는 흔히 PLL에 속해있는 것처럼 여겨지지만 전체적인 입장에서 순서를 따지자면 PLL은 VCO의 주파수가변과 고정을 원활하게 하기 위한 강력한 도구이자 방법론의 하나로 볼 수 ... 계산식에 의하면 T1과 T2가 각각 R1과 R2에만 영향을 받으므로 임의로 듀티비(T1/T, T2/T)를 설계하고 싶을 때 사용하는 회로다. ... 회로를 설계하고 동작을 확인해야 하는 입장에서 보면, 555의 정확도와 신뢰성은 백만원군의 가치와 크게 다르지 않다.3) VCO(Voltag Controlled Oscillater)

  리포트 | 9페이지 | 1,500원 | 등록일 2008.08.07

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  [예비]위상 제어 루프 PLL

  설계실습 7. ... Vc의 변화 는13948.363Hz/2.5V = 5579.3452Hz/V(5)Loop Filter의 cutoff frequency (1/2πRC)가 높아질 경우와 낮아질 경우에, PLL ... 1개Bipolar Junction Transistor : 2N3006(NPN)IC:uA741 OP amp 3개74HC04 inverter 1개74HC86 XOR gate 1개3.설계실습

  리포트 | 9페이지 | 1,500원 | 등록일 2008.11.03

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  [전자회로] 2stage OP AMP 설계 (PSPICE를 이용한 2단 CMOS 연산 증폭기 설계)

  서론아날로그 IC에는 연산 증폭기, 아날로그 곱셈기, 아날로그-디지털(A/D) 변환기와 디지털-아날로그(D/A) 변화기, 위상 동기 루프(PLL), 그리고 이들보다 좀더 특수한 목적으로 ... 설계한다. ... 설계된 기능 블록들이 있다.

  리포트 | 10페이지 | 2,000원 | 등록일 2011.01.01

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  SQUARING LOOP과 COSTAS LOOP를 이용한 PSK/DSBSC 복조방법

  여기서alpha 와beta 는 루프의 대역폭을 제어하는 설계 변수이다. 루프 여파기의 출력은 VCO에 대한 제어 전압v(t)가 된다. ... PLL의 입력에서 신호의 2배의 주파수 항을 무시하고 위상 성분만을 고려해 주면, 수신된 반송파 위상의 2배인2 phi 와 VCO의 출력 정현파의 위상인2 hi }- 그림 2 PLL에 ... 대역통과 여파기는 PLL을 구동하기 위해 고조파cos(2 pi Mf _{c} t+M hat{phi } )를 선택한다.

  리포트 | 7페이지 | 1,500원 | 등록일 2008.03.09

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  Design of a ‘InGaAsP Multi Quantum Wells Laser Diode’ and ‘10Gbps clock and data recovery’ circuit Pspice

  참조 모델*다음은 CDR에서 PLL의 참조 모델이다 : (단위 피드백, 1 차 또는 2 차, 유형 1 또는 2) CDR 내의 PLL은 모든 피드백 유형의 경우가 있는데, 회로의 입력은 ... 위상 주파수 검출기 설계183.2.2 전하펌프 루프 필터 설계193.2.3 전압제어 발진기 설계203.2.4 데이터 복원단 설계20제 4 장 전체 회로 설계 및 시뮬레이션214.1 ... Model82.2.2 LD PSPICE Circuit 9제 3 장 10Gbps clock and data recovery103.1 클럭 / 데이터 복원회로(CDR)103.1.1 위상 동기 회로(PLL

  논문 | 43페이지 | 3,500원 | 등록일 2019.01.23 | 수정일 2019.01.25

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  Modified Delta Modulation, New M-ary Modulation 설계 (코드포함)

  디지털 통신 설계과제2. Modified Delta Modulation3. ... 실제 FSK의 경우는 PLL을 활용한 회로를 구성하여 구현하는데 반하여 이렇듯 조건이 지속적으로 변화하는 경우에는 특성화된 Digital Signal Processing이 필요할 것으로 ... New M-ary Modulation디지털통신성원진 교수님2007.12.03.월전자공학과설계과제 #2Variable step size를 갖는 "modified delta modulation

  리포트 | 16페이지 | 5,000원 | 등록일 2010.11.05 | 수정일 2024.01.04

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  반도체 제조공정의 이해

  메모리 제품 ( MP3, 휴대폰 등에 사용 ) Nor Flash , NAND Flash LCD Panel 을 구동하는 구동 IC 마이크로 제품으로 STB, Bluetooth, RF PLL ... 200mm 300mm 생산력 2.5 배 상승반도체 제조과정 마스크 제작 설계된 전원회로를 각 츨별 목적에 따라 나누어 유리마스크에 그리는 과정 회로설계 웨이퍼상에 구현될 전자 회로를 ... Design ) 컴퓨터 시스템 (CAD) 을 이용해 전자회로 Pattern 을 설계한다 .

  리포트 | 54페이지 | 1,000원 | 등록일 2010.04.10 | 수정일 2021.06.17

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  전자회로 5.발진회로

  수정 발진기보다 내부 설계가 쉬워 소형화, 외부 충격에 강하게 만드는 것이 가능, 제작 비용도 저렴하여 주파수 안정성이 크게 필요하지 않은 리모컨 등의 전자제품에 넓게 사용되고 있다 ... 발진회로저가약 20%정도떨어짐작다저주파 측정용 발진기LC 발진회로저가약 20%정도떨어짐작다수신기(라디오,TV,FM등),고주파 측정용 발진기수정 발진회로고가수~수십ppm양 호크다시계,송신기,PLL회로등세라믹 ... 정도안정성Q용도RC 발진회로저가약 20%정도떨어짐작다저주파 측정용 발진기LC 발진회로저가약 20%정도떨어짐작다수신기(라디오,TV,FM등),고주파 측정용 발진기고가수~수십ppm양 호크다시계,송신기,PLL회로등세라믹

  리포트 | 9페이지 | 1,000원 | 등록일 2008.10.09 | 수정일 2018.12.29

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  [전자]VCO 설계

  이번 학기에는 대략적으로 VCO를 설계하고 ADS툴 사용이 주목적이 되기 때문에 우리가 제작 할 RFID의 주파수인 900MHz급 VCO를 제작하였다. ... #김영철 : VCO 설계담당실생활에 사용되는 제품을 만드는 공학도로서 통신 시스템 모듈 중 가장 기본이라고 할 수 있는 VCO(Voltage Controlled Oscillator) ... 학부과정동안 배우는 마이크로파 이론을 다시 한 번 숙지하고 실제적으로 어떻게 제조되는지 그 과정을 습득하고 ADS 시뮬레이터를 통해서 설계하고 시뮬레이션 작업을 거친 뒤, 제작에 임할

  리포트 | 3페이지 | 3,000원 | 등록일 2007.04.27

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  MCU와 MPU그리고 이를 활용할 수 있는 방안 및 현재 추세

  이에 비하여 미니 컴퓨터 이상의 중대형 컴퓨터에서는 CPU를 많은 소자를 사용하여 전용으로 설계하게 된다. ... 및 병렬 인터페이스, 타이머/카운터 등을 내장하는 정도에 불과하였으나, 최근에는 DMA제어기와 같은 고성능의 I/O 기능, 고속의 직렬통신 기능, A/D 컨버터, PWM 출력, PLL ... 마이크로컴퓨터에서처럼 마이크로프로세서를 사용하여 컴퓨터를 설계하면 CPU가 하나의 IC 소자로 간단히 구성되므로 전체 시스템이 소형경량화되고, 소비전력이 적어지며, 가격이 낮아질 뿐만

  리포트 | 4페이지 | 1,000원 | 등록일 2008.12.18

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  결과보고서-Exp 3. Digital Design Using Microcontroller (1st week).hwp

  등을 내장하고 있다.⑵ 8051의 특징- 제어 목적에 적합하도록 설계된 8비트 마이크로컨트롤러이다.- 111종의 명령을 가지며, 이중에서 64종은 단일 머신 사이클에 실행된다.- ... 제어기, 직렬 및 병렬 인터페이스, 카운터/타이머 등을 내장하는 정도였는데, 최근에는 DMA제어기와 같은 고성능의 I/O기능, 고속의 직렬통신 기능, A/D컨버터, PWM 출력, PLL회로

  리포트 | 10페이지 | 2,000원 | 등록일 2010.10.11

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