"논리회로설계실험" 검색결과 1-20 / 2,220건

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  논리회로실험 순차회로 설계

  논리회로설계 실험 예비보고서 #6실험 6. 순차회로 설계1. 실험 목표순차회로의 기본 회로인 Latch와 Flip ? ... 고찰이번 예비실험에서는 순차논리회로에 대해 학습하였다. 순차논리회로란 입력이 들어가서 출력이 되고 다시 그 출력이 입력이 되는 회로다. ... 또한 이번예비실험에서는 플립플롭과 래치에 대해 일부분의 회로밖에 설계하지 않았는데, 기회가 된다면 다른 순차회로도 설계해봐야겠다.

  리포트 | 6페이지 | 1,500원 | 등록일 2021.10.01

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  논리회로실험 카운터 설계

  논리회로설계 실험 예비보고서 #7실험 7. 카운터 설계1. ... 설계에 따라 설계할 수 있다.- 카운터의 동작 시 전파지연시간이 없다.- 아래의 그림은 4비트 mod - 16 리플 카운터의 논리회로도 이다.(3) 비동기식 카운터- 카운터 내의 ... 아래의 그림은 본 예비실험에서 사용되는 비동기식 업카운트의 상태도와 논리회로도이며, 4비트의 2진 카운터이다. 0부터 클록의 수가 증가하면 15까지 증가하게 되고, 16개의 상태를

  리포트 | 6페이지 | 1,500원 | 등록일 2021.10.01

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  논리회로설계 실험 기본게이트 설계

  논리회로설계 실험 예비보고서 #1실험 1. 기본게이트 설계1. 실험 목표CPLD와 FPGA에 대해 알아보고 그의 활용을 알아본다. ... 또한 전기전자 논리회로 교과목의 기초지식과 Xilinx tool을 사용하여 VHDL언어를 통해 기본적인 논리회로인 AND OR 게이트의 논리회로를 설계하고 진리표를 통하여 각 기본 ... 하드웨어에 대한 지식이 별로 없는 사람이 설계하거나 회로의 문서화를 하는 경우에 좋다.

  리포트 | 6페이지 | 1,500원 | 등록일 2021.10.01

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  논리회로설계실험 5주차 Encoder 설계

  이러한 과정에서 논리회로설계에서 중요한 Encoder에 대해 더욱 깊게 이해할 수 있었다. ... 1) Objective of the Experiment(실험 목적)이번 실습은 4:2 Priority encoder를 behavioral modeling, dataflow modeling ... 이를 이용하여 behavioral, dataflow, gate-level modeling으로 직접 설계해 보았다.

  리포트 | 6페이지 | 3,000원 | 등록일 2023.09.11

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  논리회로설계실험 4주차 MUX 설계

  1) Objective of the Experiment(실험 목적)이번 실험의 목적은 4:1 MUX와 1:4 DEMUX를 강의 시간에 배운 2:1 MUX와 1:2 DEMUX의 modeling

  리포트 | 8페이지 | 3,000원 | 등록일 2023.09.11

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  논리회로설계실험 3주차 Adder 설계

  이런 점들을 학습하는 과정에서 논리회로의 기본 개념인 1-bit adder와 4-bit adder에 대해 더욱 깊이 이해할 수 있었고, 이러한 부분에서 실습의 의의가 있다. ... 다음으로 구현한 1-bit full adder를 이용하여 4-bit adder를 설계한다. ... 1) Objective of the Experiment(실험 목적)이번 실습에선 우선 1-bit full adder를 W3 강의에서 다룬 half adder의 구현방법과 skeleton

  리포트 | 8페이지 | 3,000원 | 등록일 2023.09.11

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  논리회로설계실험 8주차 register 설계

  1) Objective of the Experiment(실험 목적)이번 실습에서는 8-bit register와 8-bit shift register를 structural modeling으로 ... register (Structural modeling)8-bit shift register도 마찬가지로 1-bit register를 이용하여 structural modeling으로 설계할 ... 이때 강의시간에 배운 1-bit register를 이용하여 구현할 수 있었다.또한 설계한 register들이 정상적으로 작동하는지 확인하기 위해 교수님께서 제공해주신 skeleton

  리포트 | 5페이지 | 3,000원 | 등록일 2023.09.11

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  [논리회로설계실험]VHDL을 활용한 LCD설계

  Discussion1)예측과 실제 실험 결과 대조 분석다음은 출력값의 실험값과 예측값을 대조하였다. ... 조건문에서 86개의 state가 돌아가도록 설계 한후, 비트수를 한자리 줄여 43개의 state만을 이용하도록 설정한다.2-4) process(lcd_state) – state별 데이터값 ... /실험값LCD_state예측/실험값0Function set1427/ (공백)410/0앞쪽의 0~5 state는 wave상에서는 “_”로 나타났지만, LCD의 설정 값이기 때문에, 동작

  리포트 | 7페이지 | 2,000원 | 등록일 2021.06.26

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  [논리회로설계실험]VHDL을 활용한 Calculator 설계

  추가적으로, 각 state마다, 다음 state값도 지정하여 준다.4)References및 확장방향Calculator 설계를 통해, 연산하는 방법과, 연산 후 나오는 값을 LCD에

  리포트 | 17페이지 | 2,000원 | 등록일 2021.06.26

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  [논리회로설계실험]VHDL을 활용한 CLOCK설계

  스탑워치, 카운터, 날짜표시등 우리의 일상에서 흔히 볼 수 있는 것들이 어떻게 논리회로적으로 코딩되고, 알고리즘화 되는지 알 수 있었다. ... 그대로 발생하고, 그 다음부터는 01:00:00으로 초기화 되어서 나타나는 것으로 보인다.2)Algorithm 설명 및 이해이번 실습에서는 자일링스의 사용법을 바탕으로 clock을 설계해보았다 ... 실험에 주어진 조건으로는 리셋값은 12시 58분 20초를 가리켜야하며, 12시 59분 59초 이후에는 13시가 아닌 01시 00분 00초로 넘어가야 한다는 조건(12시간제)이 주어졌다

  리포트 | 12페이지 | 2,000원 | 등록일 2021.06.26

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  논리회로설계실험 6주차 D Latch 설계

  1) Objective of the Experiment(실험 목적)이번 실습의 목표는 D Latch를 Behavioral modeling, Dataflow modeling, Gate-level ... 결과적으로 설계한 D Latch의 4가지 다른 모델링의 파형이 일치하는 것을 확인하였으며, 정상적으로 작동함을 알 수 있었다. ... 또한 설계한 4가지 방법이 정상적으로 작동하는지 testbench코드도 직접 작성하고 simulation을 하는 과정을 가졌다.

  리포트 | 5페이지 | 3,000원 | 등록일 2023.09.11

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  논리회로설계실험 2주차 XNOR gate 설계

  간단한 XNOR gate 하나를 설계하는 실습이었지만 프로그램 사용법을 익히고 논리회로설계실험에 이용될 기본 gate를 직접 구현해보았다는 점에서 의의가 있다. ... 1) Objective of the Experiment(실험 목적)이번 실험의 목적은 Truth table과 Boolean expression으로 나타내고 Verilog 코드를 구현하는 ... 미리 Truth table과 Boolean expression으로 이론적인 부분을 미리 설계하고 코딩하여 더 수월하게 진행할 수 있었다.

  리포트 | 5페이지 | 3,000원 | 등록일 2023.09.11

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  논리회로설계실험 9주차 counter설계

  1) Objective of the Experiment(실험 목적)이번 실습에선 강의에서 배운 내용을 바탕으로 Structural modeling으로 Ripple counter와 Ring ... 이런 작동이 반복되어 D flip flop을 이용한 ripple counter 설계가 가능한 것이다.2.2) Ripple counter (JK flip 알 수 있듯, 가장 왼쪽의 ... 강의자료에 제공된 D flip flop을 이용해 ripple counter를 설계하는 코드에서 RESET = 1임에도 불구하고 이전 값인 0100을 그대로 출력하는 문제점을 해결하기

  리포트 | 6페이지 | 3,000원 | 등록일 2023.09.11

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  (디지털 회로실험)8421 Encoder의 논리회로 설계

  디지털실험설계 01.실험제목 : 8421 Encoder의 논리회로 설계Ⅰ 설계과정Encoder의 기능을 익히고, 부호변환 회로의 설계방법을 익힌다.조건 : 디지털 논리소자를 이용하여 ... 디지털 논리소자를 이용한 회로도를 설계한다.Maxplus Ⅱ 프로그램을 이용해 회로를 구성한다.8421인코더는 논리소자 OR게이트로 구성된다는 것을 알 수 있다. ... 회로에서는 오직 신호의 ON과 OFF만을 갖고 논리를 결정짓기 때문에 2진수의 개념을 도입하면 회로를 통해 2진 연산이 가능해진다.

  리포트 | 5페이지 | 1,500원 | 등록일 2020.08.18 | 수정일 2022.02.16

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  논리회로설계실험 7주차 Flip flop 설계

  1) Objective of the Experiment(실험 목적)이번 실험에서는 두 가지 모델링 방식인 Behavioral modeling과 Structural modeling 방법으로 ... Sequential Circuit의 특징인 Clock edge에서 동작하는 부분을 설계하는 것이 어려움을 알게 되었다. ... 마지막으로 testbench code를 작성하여 직접 설계한 두가지의 flip flop이 정상적으로 작동하는지 Modelsim의 simulation을 이용하여 파형을 관찰함으로써 검증하였다

  리포트 | 6페이지 | 3,000원 | 등록일 2023.09.11

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  논리회로설계실험 라인트레이서 레포트

  논리회로설계 실험 설계프로젝트 보고서주제 : 라인트레이서 설계1. ... 설계 배경 및 목표1) 설계 배경지금까지 여러 VHDL표현 방식에 대해서 배우고 그에 따른 여러 조합회로와 순차회로를 설계하였다. ... 순차회로에서 설계한 분주기 설정, finite state machine 설계 등이 linetracer를 설계하는데 많이 사용될 수 있었다.

  리포트 | 15페이지 | 7,000원 | 등록일 2021.10.09

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  논리회로실험 병렬 가산기 설계

  논리회로설계 실험 예비보고서 #3실험 3. 병렬 가산기 설계1. ... wiki/2%EC%9D%98_%EB%B3%B4%EC%88%983) 병렬 가감산기 : http://blog.naver.com/k97b1114/1401592913964) 병렬 가산기 : 논리회로설계실험 ... 실험 목표1의 보수와 2의 보수에 대해 학습하고 병렬가산기, 병렬 가감산기를 논리기호를 사용하지 않고 설계하고 작동방법에 대해 알아보아 둘의 차이점에 대해 알아본다.

  리포트 | 6페이지 | 1,500원 | 등록일 2021.10.01

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  논리회로설계실험 BCD가산기 레포트

  논리회로설계 실험 설계과제 보고서주제 : #1 BCD 가산기 설계1. 설계 배경 및 목표1) 설계 배경컴퓨터는 2진법을 이용하여 계산을 한다. ... 입력 신호인 BCD와 출력 신호인 7 segment에 대해서 진리표로 나타낸 후, 카르노맵을 사용하여 가장 간단한 논리식을 찾는다면 BCD를 7 segment로 바꿔주는 디코더 논리회로를 ... 2진수에서 10진수로의 변환이 간단하고 이를 7 segment에 연결시키면 쉽게 10진수를 출력할 수 있다는 장점 때문에 주로 10진법으로 수를 표기하는 것이 필요한 프로세서나 회로에서

  리포트 | 14페이지 | 7,000원 | 등록일 2021.10.09

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  논리회로설계 실험 디코더 인코더

  논리회로설계 실험 예비보고서 #4실험 4. 디코더 & 인코더1. ... 5) 논리회로설계실험 국태용교수님 아이캠퍼스 강의자료http://terms.naver.com/entry.nhn? ... NOT게이트를 사용하면 더 많은 논리회로들을 그릴 수 있으나 본 실험에는 세 개의 논리회로만 그려보았다.2) 소스 코드동작적 모델링자료 흐름 모델링구조적 모델링구조적 모델링 內 AND

  리포트 | 6페이지 | 1,500원 | 등록일 2021.10.01

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  [논리회로 실험] 디멀티플렉서 verilog 설계

  =S1’S0’Y1=S1’S0Y2=S1S0’Y3=S1S0Schematic 회로도Verilog, VHLD설계1. if~else 또는 case 형식을 사용해 두 가지 방법으로 디멀티플렉서를 ... 따라서 이번 실습에서는 디멀티플렉서의 동작을 이해하고, Verilog 또는 VHDL이 회로로 합성되는 과정을 이해한다.실습 내용실습결과논리식과Schematic설계디멀티플렉서 진리표제어변수출력S1S0Y0Y1Y2Y300I000010I001000I011000IY0 ... 제목디멀티플렉서 설계실습 목적디멀티플렉서는 하나의 입력을 여러 개의 출력 중 하나로 전송한다. 4x1 디멀티플렉서는 하나의 입력을 4개의 출력 중 하나로 전송하며, 선택된 출력에 입력을

  리포트 | 2페이지 | 2,000원 | 등록일 2020.12.24

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