"ARM VERILOG" 검색결과 1-20 / 25건

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  한화시스템 회로설계 인턴직 합격자소서

  신속한 일 처리를 위해 노력하고 있습니다.2.지원분야 / 역량분야 (본인이 당사에 실질적으로 기여가능한 부분을 구체적으로 기재) [300자 이내]전공수업을 PIC, ATMEGA, ARM ... 자신감을 가질 수 있었습니다.또한, 누리인재사관학교 교육과 통신 관련 수업, 그리고 현재 진행 중인 졸업 프로젝트를 통해 C/C++프로그래밍 경험을 쌓아 왔으며, 실험 과목을 통해 Verilog ... 우수한 성적을 받을 수 있었으며, 누리인재사관학교 교육 참가를 통해 C/C++ 프로그래밍과 모바일 프로그래밍 능력을 더욱 향상 시킬 수 있었습니다.마이크로 프로세서와 컴퓨터 구조, Verilog

  자기소개서 | 2페이지 | 3,000원 | 등록일 2023.11.19

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  LG이노텍 CTD 전기전자직 합격자소서

  ARM Cortex-M 기반 STM 사의 프로세서를 사용하여 bare-metal 환경에서 슈팅 게임을 제작하였고, real-time OS 환경에서 Dot-matrix에 원하는 패턴을 ... 그리고 네트워크의 연산 종류에 따라 DMA를 사용하여 외부 메모리에서 FPGA 내부 메모리로 이동한 데이터와 파라미터를 병렬 연산으로 가속하는 시스템을 Verilog를 사용하여 설계하였습니다

  자기소개서 | 2페이지 | 3,000원 | 등록일 2023.11.16

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  연세대 전기전자공학부 20-2학기 기초디지털실험 6주차 예비보고서

  ObjectivesThe goal of this experiment is learn ARM processor and carry out the basic logic.

  리포트 | 3페이지 | 1,000원 | 등록일 2021.04.15 | 수정일 2021.10.06

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  연세대학교 전기전자공학부 20-1학기 기초디지털실험 week 7 보고서

  Here are the following codes written in Verilog.design_1_wrapper.v`timescale 1 ps / 1 psmodule top // ... ARM ProcessorAbstractThis report is about the experiment of an ARM processor. ... background related with an ARM processor.

  리포트 | 16페이지 | 3,000원 | 등록일 2020.08.18

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  연세대학교 전기전자공학부 20-1학기 기초디지털실험 week 8 보고서

  Protocol AMBA protocol, Advanced Microcontroller Bus Architecture, is a protocol specifications defined by ARM

  리포트 | 20페이지 | 3,000원 | 등록일 2020.08.18

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  현대자동차 2021년 전자제어시스템 개발 합격 자기소개서

  덕분에 RTOS(uC/OS-ii) 표준코드를 통해 ARM Cortex-M3 보드를 제어할 수 있는 역량을 쌓았습니다.2. ... 또한, Quartus와 Modelsim 사용법을 익히고, 하드웨어 기술 언어인 Verilog를 이용하여 디지털 시스템 및 Testcase를 만들고 이를 FPGA Board에 구현하는

  자기소개서 | 2페이지 | 3,000원 | 등록일 2022.10.17

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  현대오토에버 2021년 전장 SW 합격 자기소개서

  이후 대학에서 차량 디스플레이 시스템을 Verilog로 제어하거나 스마트키 FW를 개발하며, '자동차를 제어하는 SW 엔지니어'를 미래의 업으로 삼자고 확신하게 되었습니다.그러던 어느날 ... 교육 초기 C, RTOS, 자료구조, OSI 모델 및 MQTT 프로토콜 이론을 학습한 후, RTOS(uC/OS-ii) 표준코드를 통해 ARM Cortex-M3 보드를 제어하는 방법을

  자기소개서 | 2페이지 | 3,000원 | 등록일 2022.10.17

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  한화시스템 첨삭자소서

  대학원 시절에는 verilog 언어 조교와 ARM 어셈블리 조교를 수행했습니다. ... 학부 시절 공학인증을 이수하면서 하드웨어로는 verilog 언어를 활용하여 pipeline MIPS 설계, factorial machine들을 설계했습니다.

  자기소개서 | 7페이지 | 3,000원 | 등록일 2023.01.31

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  LG전자 합격 자소서

  컴퓨터구조에서는 전반적으로 MIPS Processor의 동작 원리와 컴퓨터구조에 대해서 배웠고 Verilog를 이용해서 MIPS Processor를 구현했습니다. ... 마이크로프로세서와 임베디드 하드웨어를 통해서 ARM프로세서의 전반적인 구조를 배웠고 이러한 지식을 바탕으로 학부 4학년 때부터 팀을 구성하여 ‘RPS_3000보드를 이용한 실시간영상처리

  자기소개서 | 2페이지 | 3,000원 | 등록일 2017.11.29

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  텔레칩스 합격자소서

  전공 프로젝트 경험[MIPS 프로세서 구현]3학년 때, multi-cycle MIPS design using Verilog 프로젝트를 진행했습니다. ... 또한, 이를 FPGA 보드에 올려 직접 덧셈을 해보았습니다.둘째, ARM 프로세서의 구조 이해. ... 그 결과, multi cycle로 인해 hazard가 발생하는 것을 볼 수 있었습니다.셋째, ARM 프로세스를 직접 구현.

  자기소개서 | 4페이지 | 3,000원 | 등록일 2019.04.08

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  Arm 기반의 디지털 시계

  ARM기반의 SOC kit로 구현한 디지털 시계 소스 코드 및 보고서 자료입니다.

  리포트 | 19페이지 | 3,000원 | 등록일 2012.05.30

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  연세대 전기전자응용실험 보고서, 코드, 강의노트 자료

  ObjectivesTo connect LED, 7-segment, push buttons in chapter 1 to APB and AXI bus, and use an ARM processor ... These settings are created as a module by ‘create Top HDL’, and bacome verilog source file ‘system_stub.v

  리포트 | 5페이지 | 2,000원 | 등록일 2018.08.21

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  반도체별 동향

  이러한 과정에서 ISP라는 기업군이 생겨났으며, 그 대표적인 기업이 영국의 ARM이다. 4세대인 현재는 스마트와 융합 열풍으로 인해 까다로워진 실을 구축하여 운영하고, 고액의 시스템반도체 ... )- 하드웨어 기술언어인 Verilog 에 관한 표준 정의OVISTIL(IEEE1450)- Standard Test Interface Language- 시뮬레이션, AT다. ... (IEEE1800)- 하드웨어 기술(Description)과 검증을 위한 verilog 확장 언어로 2002년 Accellera 에 의해 제안- 2005 년 IEEE1800 으로 승인

  리포트 | 20페이지 | 3,000원 | 등록일 2018.05.30

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  디지털 시계 설계 보고서

  설계목표Verilog HDL를 이용한 시계코드의 작성부터 포팅을 통한 동작의 확인을 목표로 잡았다. ... 고찰Verilog 소스코드 작성, Quartus를 이용한 회로구성, Modelsim을 사용한 시뮬레이션하는 과정을 모두 거쳐 SoC시스템 작동 파일을 만들 수 있었다. ... 이는 우리조가 기존 SoC 설계방법과 구현하는데 사용한 SoC Master 시스템에 대한 깊이 있는 이해 없이, verilog 소스코드 구현부터 서둘러 진행해 생긴 문제로 생각된다.

  리포트 | 19페이지 | 2,000원 | 등록일 2012.05.29

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  Verilog를 이용한 AMBA AHB 설계

  AMBA AHB의 동작을 이해하고 Verilog를 이용한 AMBA AHB 설계를 통하여 ARM 프로세서에서 이용한 BUS 프로토콜을 구현한다. 2개의 Master와 2개의 Slave가

  리포트 | 4,000원 | 등록일 2009.12.21

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  Full CPU 설계 프로젝트-Verilog HDL code 포함

  ARM Thumb CPU를 설계하고 Test한다.[2]1) mov r0, #0x11 //r0에 0x11을 저장mov r1, #0xaa //r1에 0xaa을 저장mov r2, #0 ... Introduction[1]1) Verilog HDL을 이용하여 Full Function CPU를 Design2) Partial CPU를 확장하여 Full Function을 지원하는 ... 연산결과의 sign bit가 1인 경우, z: 연산결과가 0인 경우 , c: 연산결과 Carry가 발생하는 경우, v: 연산결과가 Overflow가 발생한 경우)- Register는 Verilog

  리포트 | 29페이지 | 5,000원 | 등록일 2016.06.25

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  디지털 시계 설계 발표자료

  서론 및 설계 목표Altera사의 Excalibur칩을 사용한 SoC설계및 검증 도구인 Huins사 SoC Master에 알맞은 시계를 verilog코드 작성에서부터 실제 구현까지 ... 참고문헌(주)휴인스 기술연구소,「ARM922T Core를 이용한 SoC 설계 및 응용」,홍릉과학출판사 송태훈,「(ARM9 core를 이용한) 시스템온칩 및 임베디드시스템 설계」,홍릉과학출판사 ... 설계 과정2) 회로arm_top.bdf*3. 설계 과정2) 회로pld_slave.bdf*3. 설계 과정2) 회로clock.bdf*3. 설계 과정3) BFM검증(rtl)*3.

  리포트 | 15페이지 | 1,000원 | 등록일 2012.05.29

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  Example of Clock Division

  (ARM Study Group FPGA 보드 p156핀)clk : 클럭 소스가 입력으로 들어간다. ... (ARM Study Group FPGA 보드 p79핀)out_led : 출력용 시스템 LED로 0.5초마다 한번씩 점등한다. ... (ARM Study Group FPGA 보드 p150핀)그 외의 레지스터나 와이어에 대해서는 첨부하는 소스를 참고하면 됨.2.

  리포트 | 19페이지 | 1,000원 | 등록일 2010.04.10

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  “CPLD” 에 관한 조사

  아트멜의 제품은 마이크로컨트롤러와(8051 파생제품과 AT91SAM과 AT91CAP ARM 기반 코어가 추가된 제품을 포함), 아트멜의 아트멜 AVR과 AVR32 아키텍처, 라디오 ... 그러나, Verilog와 VHDL은 좀더 복잡한 구조 등에 타겟할 수 있기에 선호가 높다. ... LUT기반 구조를 사용하는 디자이너를 위해, VHDL 또는 Verilog는 거의 독점적으로 사용된다.

  리포트 | 7페이지 | 1,000원 | 등록일 2011.03.20

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  Xilinx를 이용한 7-Segment 제어

  미리 만들어두었던 모듈은 별도의 변환 작업 없이 다른 모듈에 붙여 이용할 수 있다.이번에는 ARM Study Group의 FPGA 보드에 부착되어 있는 7-Segments를 제어할 ... Verilog HDL and Xilinx ISE 8.1Design 7-Segment Controller[Using Clock Division Module]Contents TOC \o ... Xilinx Clock Division” 문서를 참고하면 쉽게 이해할 수 있을 것이다.2) Port Design설계용 개발 툴은 Xilinx社의 ISE 8.1버전을 이용하며, 언어는 Verilog

  리포트 | 14페이지 | 1,000원 | 등록일 2010.04.10

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