"jk" 검색결과 1-20 / 1,512건

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  JK롤링

  제목: 해리포터를 만든 jk롤링난 이 책에 적혀 있는 제목이 눈길을 끌어서 읽게 되었다.그리고 내가 해리포터 펜이기도 해서 이기도 하다.이 책에는 jk롤링이 나오는 데 줄거리는 이렇다.jk롤링은 ... 옛날부터 툭하면 상상을 많이 하곤 했다.어느날 jk롤링은 직장을 그만두고 포르투칼로 가서 어떤 남자를 만났습니다.그러다가 결혼을 했고 아이를 낳았습니다.어느날 jk롤링은 남편과 사이가 ... 도움을 받아 돈을 많이 얻게 되었다.그러자 jk롤링은 여유가 생겨서 글을 쓰게 되었다.jk롤링은 글을 써서 많은 출판사에게 보냈지만 모두 거절했습니다.그러다가 다른 출판사에게서 편지가

  리포트 | 1페이지 | 1,000원 | 등록일 2023.02.12

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  JK 플립플롭

  J-K 플립플롭실험목표▣ 비동기 및 동기 입력을 포함한 J-K 플립플롭의 여러 구성에 대한 테스트.▣ 토글 모드에서 주파수 분할 특성 관찰.▣ J-K 플립플롭의 전달 지연 측정.사용부품?74LS76A 2조 J-K 플립플롭?LED: 적색 1개, 녹색 1개, 황색 1개?저..

  리포트 | 18페이지 | 4,000원 | 등록일 2021.10.13

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  JK플립플롭을 이용한 학번 카운터기

  01001901001001004001000010150010101000801000000113000111000111000100010이때 J-K 플립플롭의 여기표를 사용하여 각각의 J,K의 값을 쉽게 구할 수 있다.현재 상태차기 상태JK000X011X10X111X0JAKAJBKBJCKCJDKDJEKE0X0X0XX10X0X0X0X0X1X0X1X0X0XX00XX11X0XX10X0XX00X1X0X1XX10XX10XX10X1X1X1X0X0XX1X0X10X0X1XX1카르노

  리포트 | 9페이지 | 1,500원 | 등록일 2022.12.04

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  JK flip flops 실험보고서

  JK FF의 진리표 (1)2. single chip JK FF2.1. IC 7476에는 2 개의 JK FF이 들어 있다. ... JK FF의 진리표 (2)multisim_JK flip-flops_IC 7476 gate2.2. ... 실험 4 : JK flip-flops1. JK FF1.1. NOR gate(7402)로 RS latch를 그림 1과 같이 회로를 완성한다.

  리포트 | 5페이지 | 1,000원 | 등록일 2021.04.06

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  SR-FF/JK-FF

  제 목 : SR-FF , JK-FF 실습2. ... 오늘은 배울 sr-ff과 jk-ff은 유사하지만 11을 입력했을 때 값의 차이가 다릅니다.코드 구현input값에는 r,s,clk값을 넣어주었고, output값 q, nq 에는 밑에서 ... )의 식을 보고 알수 있습니다.그리고 clk을 3ns주기로 값을 무한으로 반복해주면서 주었고 s,r의 초기값을 0 0으로 두었고 시간의 변화에 따라 값을 다르게 바꾸었습니다.2) JK-FF코드

  리포트 | 7페이지 | 1,000원 | 등록일 2021.01.11 | 수정일 2021.01.13

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  [A+] 디지털공학실험 JK 플립 플롭

  디지털공학실험JK 플립 플롭Ⅰ. ... 실험 개요 및 목적동기 및 비동기 입력 방식을 포함한 JK 플립플롭의 다양한 구성에 대한 시험토글 모드에서 주파수 분할 특성 관찰JK 플립플롭의 전달 지연 특성 측정Ⅱ. ... (S,R =1 , Q = undefined)(출처 : https://vlsiverify.com/verilog/verilog-codes/sr-flip-flop)JK 플립플롭: JK 플립플롭은

  리포트 | 7페이지 | 2,000원 | 등록일 2023.11.08

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  VHDL_3_RAM,ROM,JK Flip Flop, Register

  FlipFlop은 SR, D, JK, T FlipFlop등이 있다. rising edge에서 동작하는 JK FlipFlop의 회로도와 진리표는 다음과 같다.InputsOutputsCLKJKQQ ... 350nsaddress = 110, data 초깃값 = data_out = 010000008) 400nsaddress = 111, data 초깃값 = data_out = 10000000실습제목: JK

  리포트 | 13페이지 | 2,000원 | 등록일 2021.09.23 | 수정일 2022.04.04

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  JK flip-flop 결과보고서 A+ 레포트

  이번 실험에서 memory 소자의 기본 구성 요소인 JK flip-flop의 동작 및 특성에 대하여 살펴보았다.

  리포트 | 3페이지 | 2,000원 | 등록일 2023.11.15

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  VHDL 실습(D-FF, JK-FF, Counter) 결과

  JK-FF입력출력CLKJKQ↑(상승)00유지↑(상승)010↑(상승)101↑(상승)11반전↓(하강)00유지↓(하강)01유지↓(하강)10유지↓(하강)11유지☞ JK-FF은 어떠한 CLK이 ... VHDL실습(D-FF,JK-FF,Counter) 결과 보고서※ 모든 사진은 위에서부터 모듈, 테스트벤치, 시뮬레이션, 진리표 순서입니다.? ... 그리고 CLK이 하강에지가 작용하면 JK-FF 자체가 동작을 하지 않기 때문에 출력이 이전상태 그대로 나오게 되는 것을 확인할 수 있다.

  리포트 | 9페이지 | 1,000원 | 등록일 2021.01.06

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  실험4 JK flip-flop 결과보고서 A+ 레포트

  이 실험에서 파형발생기의 문제로 인해 0V, +5V 사각파를 정확히 만들기 힘들었고 파형의 모양도 비율이 맞게 조 정하기 힘들었다. 하지만 예상한 결과값과 같이 2배와 4배의 결과 값을 얻을 수 있었고 그냥 실험해도 무방하다는 허락받고 실험을 그대로 진행하였다. 먼저 ..

  리포트 | 3페이지 | 2,000원 | 등록일 2023.11.15

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  JK 플립플롭과 T 플립플롭 결과보고서A+

  T로 JK를 구현할 수도 있고, D플립플롭을 구현할 수도 있다. JK, T, D플립플롭은 모두 서로를 구현할 수가 있다. ... 간단하게 몇 개 구현해 보았다.T로 JK구현D로 T구현T로 D 구현D로 JK구현이와 같이 각 플립플롭은 서로를 구현할 수가 있다. ... 것으로 JK를 이용하여 T플립플롭을 구현하였다.

  리포트 | 8페이지 | 1,500원 | 등록일 2020.03.05 | 수정일 2020.03.12

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  디지털 논리회로 실험 7주차 JK-FlipFlop 예비보고서

  표(c) 타이밍 선도그림 5-3 하강 에지를 이용한 JK 플립플롭JK 플립플롭의 내부 구조를 그림 5-4에 나타내었다. ... JK 플립플롭은 J와 K가 모두 1인 때를 제외하고는 RS 플립플롭의 작동과 똑같다. ... JK 플립플롭은 J와 K가 모두 1인 때를 제외하고는 RS 플립플롭의 작동과 똑같다.

  리포트 | 10페이지 | 1,500원 | 등록일 2021.04.22

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  디지털 논리회로 실험 7주차 JK-FlipFlop 결과보고서

  디지털 논리회로 설계 및 실험결과보고서주제 : JK FlipFlop소속: 공과대학 전자전기공학부수업: X X,X XXX 교수님 XXX 조교님제출 일자: 20XX년 X월 XX일 X요일X조 ... ]의 J-K Flip-flop에bar{PRE}와bar { CLR}를 연결하지 말고 다시 실험하여 진리표를 작성하시오.bar{PRE}와bar { CLR}에 모두 1의 신호를 준다면 JK

  리포트 | 11페이지 | 2,000원 | 등록일 2021.04.22

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  디지털 회로 실험 및 설계 - JK Flip Flop, D, T Flip Flop 실험 1

  JK 플립플롭- JK 플립플롭의 'JK'는 집적회로를 최초로 발명한 미국의 물리학자 잭 킬비를 기념하기 위해 붙인 이름이다. ... 데이터시트※ DM7476M(JK 플립플롭), DM7474M(D 플립플롭)- JK 플립플롭의 핀넘버와 스펙- D 플립플롭의 핀넘버와 스펙? ... T 플립플롭은 JK 플립플롭의 입력 J와 K를 묶어 하나의 입력 'T'를 만든 것이다. 이렇게 하면, JK 플립플롭의 토글 동작만을 사용하게 된다.

  리포트 | 14페이지 | 3,000원 | 등록일 2023.09.22

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  VHDL 실습 (D-FF, JK-FF, 8-bit counter) 예비

  그림 4-5(a)에서 NOR 게이트로 구성된 RS 플립플롭을 이용하여 구성한 JK플립플롭을 나타내었다.JK 플립플롭의 동작을 기능표로 나타내면 그림 4-5(c)와 같다. ... VHDL 실습(D-FF, JK-FF, 8-bit counter) 예비보고서가. ... JK 플립플롭JK 플립플롭은 RS 플립플롭을 개선한 것으로 RS 플립플롭에서 R='H', S='L'인 경우에 금지 상태가 되어 사용되지 않는 경우에 출력이 반전되도록 외부회로를 추가한

  리포트 | 5페이지 | 1,000원 | 등록일 2021.01.06

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  기초전자설계및실험 예비보고서 JK Flip-Flop과 클락생성

  실험 제목: JK Flip-Flop과 클락생성조: 이름: 학번:실험에 관련된 이론2.1 JK Flip-Flop-JK Flip-Flop은 RS Flip-Flop의 변형된 형태로서 J입력은 ... 동기식 JK Flip-Flop역할 수행여부를 확인한다. ... JK Flip-Flop의 논리 회로는 그림 9.1과 같다.JK flip-flop operationHYPERLINK "https://en.wikipedia.org/wiki/Flip-flop

  리포트 | 5페이지 | 1,000원 | 등록일 2019.09.29 | 수정일 2019.09.30

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  디지털 회로 실험 및 설계 - Multiplexer, DeMultiplexer 실험, JK Flip Flop 순차회로 실험 1

  반면 회로가 복잡하다는 단점이 있으며, 단계적인 설계 과정이 필요하다- 동기 카운터는 JK 플립플롭, D 플립플롭, T 플립플롭 등으로 설계한다. ... 디지털회로실험및설계 예비 보고서 #4( Multiplexer, DeMultiplexer 실험 / JK Flip-Flop을 이용한 순차회로 실험 )과 목담당교수제 출 일학 번이 름1. ... 실험목표① 멀티플렉서의 회로 구성과 동작을 실험한다.② 디멀티플렉서의 회로 구성과 동작을 실험한다.③ JK F.F를 이용하여 동기/비동기 카운터를 실험하고 이해한다.2.

  리포트 | 19페이지 | 3,000원 | 등록일 2023.09.22

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  디지털 회로 실험 및 설계 - JK Flip Flop, D, T Flip Flop 실험 2

  디지털회로실험및설계 결과 보고서 #3( JK Flip-Flop 실험, D, T Flip-Flop 실험 )과 목담당교수제 출 일학 번이 름? ... Q'=1 J=1, K=1, Q=0JKQQ출력Q'Q'출력0100.15V14.5V0000.15V14.5V0100.15V14.5V1014.5V00.15V1100.5V14.5V결과분석- JK ... 때 완전 0이 아닌 0.15V 수준의 0에 매우 비슷한 값이 나왔으며, 논리레벨이 1일 때는 완전 5V가 아닌, 4.5V 수준의 5V에 매우 비슷한 값이 나왔다.)실험3) 다음 JK

  리포트 | 15페이지 | 3,000원 | 등록일 2023.09.22 | 수정일 2023.09.24

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  에지트리거형 플립플롭 (D-, JK-, T-)의 특성 비교 및 설명

  JK-플립플롭은 J 입력과 K 입력의 조합에 따라 출력 상태를 변경한다. 는 JK 플립플롭의 진리표를 나타낸 것이다. JK-플립플롭은 클록 신호의 상승 에지에만 반응한다. ... 은 D 플립플롭의 진리표를 나타낸 것이다.JK-플립플롭(JK Flip-Flop)은 디지털 논리 회로에서 사용되는 플립플롭의 한 종류이다. ... 에지트리거 플립플롭(D-, JK-, T-)의 상태도 비교Ⅲ.

  리포트 | 7페이지 | 4,000원 | 등록일 2023.07.18

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  A+받은 플립플롭 회로(flip-flop, JK, SR) 결과보고서 PSPICE

  이 러한 순서 논리 회로의 기본이 되는 회로가 flip-flop인데 이의 종류에는 RS, JK, D flip-flop이 있다.

  리포트 | 6페이지 | 1,000원 | 등록일 2022.12.28

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