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[전자회로실험] 접합 다이오드의 특성 예비보고서
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... ④ 다이오드 모델 <제1다이오드 모델> 이상적인 다이오드 모델이다. 보통 이를 사용하면 회로를 해석하기가 매우 쉬워지므로 회로가 어떻게 동작하는가를 빨리 알아보는데 적절하다. 순방향 바이어스에서 다..
공학/기술
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2011.10.05
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4페이지
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1,500원
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조회(223)
다이오드
,
전자회로실험
,
Diode
,
순방향 바이어스
,
역방향 바이어스
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[전자회로실험] MOSFET의 특성 예비보고서
... ② 전류 전도를 위한 채널의 형성 NMOS 트랜지스터의 경우, 게이트가 소스에 대하여 양의 전위를 가지고 있다면, 자유 정공들을 게이트 아래의 기판 영역(즉, 채널 영역)으로부터 밀어낼 것이다. 이..
공학/기술
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2011.10.05
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5페이지
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1,500원
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조회(317)
MOSFET
,
전자회로실험
,
모스펫
,
파라미터
,
특성 커브
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[전기회로실험] 전압분할 및 전류분할 회로 설계 결과보고서
① Part A(전압분할 회로)에 대한 회로도와 계산과정 그림과 같이 회로를 정의해 보자. 회로의 저항 : R1, R2, R3 각 저항 Rn(n은 숫자)에 걸리는 전압 : Vn 각 저항 Rn에 걸리는 전류..
공학/기술
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2011.10.05
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3페이지
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2,000원
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조회(362)
회로
,
결과보고서
,
전류
,
전기회로실험
,
전압분할 회로
,
전류분할 회로
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[전기회로실험] 중첩 정리 / 테브닌 정리 / 노튼 정리 (Superposition / Thevenin / Norton Theorem) 결과보고서
① 회로 해석에서의 중첩 정리의 이용 중첩 정리의 정의는 다음과 같다. 하나 이상의 전압원을 포함하는 선형회로에서 임의의 소자에 흐르는 전류는 단독으로 동작하는 개별 전압원에 의해 생성된 전류의 대수적 합과 같다..
공학/기술
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2011.10.05
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4페이지
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2,000원
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조회(303)
중첩정리
,
전기회로실험
,
superposition
,
테브닌정리
,
노튼정리
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[전기회로실험] 직렬 / 병렬 RLC회로의 임피던스 결과보고서
① 직렬 RLC 회로의 임피던스 ※ Case 1 인가전압 VAB(Vpp) = 10V 이고, 저항에 걸리는 전압 VR(Vpp) = 3.733V, 인덕터에 걸리는 전압 VL(Vpp) = 6.092V 이다. 직..
공학/기술
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2011.10.05
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2페이지
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1,500원
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조회(510)
임피던스
,
RLC회로
,
전기회로실험
,
직렬 RLC 회로
,
병렬 RLC 회로
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[전기회로실험] 직렬 RL / RC 회로에서의 전압관계 결과보고서
① 직렬 RL 회로 먼저 3.3kΩ의 저항과 100mH의 인덕터를 직렬로 연결한 후, 10Vp-p 5kHz의 출력을 회로에 인가한다. 이 때, 두 소자에 걸린 파형의 위상차는 다음과 같다. 사인파의 주기는 오..
공학/기술
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2011.10.05
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4페이지
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2,000원
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조회(513)
RC회로
,
전기회로실험
,
RL회로
,
RL RC
,
전압관계
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[전기회로실험] 망로 전류를 이용한 회로해석(Mesh Current) / 평형 브리지 회로 (Bridge Circuit) 결과보고서
... ② 각 저항에 흐르는 전류와 망로전류 계산값의 비교 회로는 다음과 같이 구성되며, 각 망로전류는 I1, I2, I3로 정의된다. 인가 전압은 10V이며, 각 망로전류를 계산하기 위해서 mesh c..
공학/기술
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2011.10.05
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3페이지
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2,000원
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조회(208)
전기회로실험
,
망로전류
,
평형 브리지 회로
,
Bridge Circuit
,
Mes..
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[디지털시스템실험(Verilog)] Verilog 기본 실습 예비보고서
① Verilog HDL(Verilog Hardware Description Language) 하드웨어 기술 언어로서 하드웨어를 설계하고 검증하는 데 사용된다. Verilog HDL(이하 Verilog)의 장점은..
공학/기술
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2011.10.05
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2페이지
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1,000원
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조회(447)
verilog
,
디지털시스템실험
,
베릴로그
,
Full Adder
,
Verilog..
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[디지털시스템실험(Verilog)] TTL 기본 실습 예비보고서
① TTL TTL은 Transistor - Transistor Logic의 약자이며, 회로의 기본 구성이 트랜지스터만으로 이루어져 있다. 표준형, 저전력형(L형), 고속형(H형), 쇼트키형(S형), 저전력..
공학/기술
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2011.10.05
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2페이지
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1,000원
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조회(107)
TTL
,
verilog
,
adder
,
디지털시스템실험
,
Oscilloscope
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[디지털시스템실험(Verilog)] Register 예비보고서
① SR Latch의 설계 이번 실험에서 쓰이게 될 SR Latch는 NAND게이트로 구현해야 하며, D Flip-Flop의 구현에 사용되어야 하므로, clock 입력이 있는 Clocked SR Latch를 구현해..
공학/기술
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2011.10.05
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3페이지
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1,500원
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조회(111)
레지스터
,
verilog
,
디지털시스템실험
,
Register
,
SR Latch
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