"TTL gate" 검색결과 181-200 / 457건

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  basic logic circuit design(예비)

  Also, understand the principle of half/full adder, materialize the half/full adder with TTL chip, and ... AND gate`s boolean expression is .③ OR operationOR gate outputs 1 when either of inputs is 1. ... OR gate`s boolean expression is .

  리포트 | 12페이지 | 1,000원 | 등록일 2011.07.09

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  서강대학교 전자공학과 4학기(2학년 2학기)의 디지털논리회로실험 레포트입니다

  Digital Logic Gates2. 실험 목적(1) TTL 및 CMOS logic gates의 동작 원리를 확인한다. ... 디지털 오실로스코프의 사용이 서툴러 실험 시간을 많이 지연시키기도 하였고, 이론적인 지식이 별로 없는 상태에서 실험을 하여 여러모로 아쉬운 실험이었다.이번 실험을 통해 TTL 소자와 ... 토의1학기 때 이론으로 배운 gate 와 소자들에 대해 직접 실험을 해보았다.

  리포트 | 9페이지 | 2,000원 | 등록일 2011.03.27 | 수정일 2021.09.20

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  기초실험및설계 : 기본 논리 게이트 예비보고서

  각 MOSFET은 gate 전압에 따라 ON/OFF되는 스위치로 볼 수 있는데, MOSFET의 gate 입력 신호에 따라 NMOS나 PMOS 중 하나는 ON이 되며 다른 하나는 OFF가 ... 이것을 Propagation delay 또는 Gate delay, 전달 지연이라 한다. ... BJT로 구현한 게이트를 TTL, MOSFET으로 구현한 게이트를 CMOS 논리 IC라고 한다.

  리포트 | 3페이지 | 1,000원 | 등록일 2011.12.28

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  디지털회로실험 전자주사위 텀프로젝트 (회로도 및 설명, 사진 첨부)

  디지털 회로를 구성하는 기본 소자 IC소자, 그리고 LED등을 이용하여 회로가 구성되어 있을 뿐 아니라, IC칩의 논리 gate를 이용하여 회로를 구현하였다.3. ... 전자주사위 제작 준비물전기인두, 납, 납 흡입기, 니퍼, 회로 연결용 전선,재료명규격 * 수량재료명규격 * 수량TTL IC74LS00 * 1 (NAND 2-Input)LED적색 *

  리포트 | 8페이지 | 2,000원 | 등록일 2015.01.27

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  555 타이머, not gate 실험 결과보고서

  TTL이나 연산증폭기 회로와도 같이 사용될 수 있다. ... ·Not Gate표 2 InputOutput1001그림 6 not gateNot gate는 그림 6과 같은 그림으로 표현된다. ... Not gate는 표 2를 통해 알 수 있듯이 입력을 하면 출력값은 입력값의 반대의 값이 나오게 된다.

  리포트 | 7페이지 | 1,500원 | 등록일 2013.11.09

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  전기전자기초실험-Basic Logic Circuit Design예비

  > NAND gate-> NOR gate-> AND gate , OR gate② Design XOR gate with 2 input AND, OR, NAND, NOR, NOT gates ... Pre-reportBasic Logic Circuit Design① Explain how to design logic gates with transistors.-> NOT gate- ... In TTL, transistors are used to both isolate inputs and perform the logic switching.

  리포트 | 6페이지 | 1,000원 | 등록일 2010.10.31

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  실험2 제04주 Lab02 Pre 4 Bit Full Adder

  Summarize지난 실험은 HBE-Combo Ⅱ-SE의 Board에 TTL을 이용하여 직접 논리 회로를 구현하는 실험이었다. ... Method1) Procedure of Lab 1① Xilinx ISE를 실행하여 New source에 2-input XOR gate와 2-input AND gate를 이용하여Schematic ... 저장한다.2) Procedure of Lab 2① Xilinx ISE를 실행하여 New source에 Lab 1을 통해 저장해놨던 Half adder Symbol과 2-inputOR gate를

  리포트 | 9페이지 | 1,500원 | 등록일 2014.03.11 | 수정일 2014.03.17

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  Lab#5]플립플롭 래치 IC 실습

  [실습 2]_NAND gate 회로를 이용한 CLK 있는 R-S Flip Flop 회로a)그림과 같은 회로에서 NAND gate 핀 번호를 기입하고 CLK있는R-S FF 회로를 구성한다.b ... .#5]Flip Flop, 4-bit Latch 실습[1]학습목표a)순차 논리회로의 개념, NAND gate R-S Flip Flop, D-type Flip Flop, J-K Toggle형 ... 74LS00 NAND gate IC의 전원, 입력, 출력 핀 번호를 먼저 기입하고 회로를 브레드보드에 구성한다.b)우측 표의 입력에 따라 출력 결과와 동작모드를 확인하면서 빈 칸을

  리포트 | 17페이지 | 1,000원 | 등록일 2011.06.02

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  기계공학기초실험 TTl-Logic 실험 예비보고서

  1.기본 논리 게이트(Logic Gate) 에 대해 설명 하시오.① 논리 게이트란? ... 디지털 시스템의 회로를 구성하는 가장 기본적인 요소는 0과 1로 대변되는 논리대수에의한 연산을 집적회로 형태로 구현한 논리 게이트(logic gate)이다. ... TTL동조출력 : 함수발생기의 주파수와 같이 동기 된 TTL파형은 20개의 TTL 부하로 이끌어 낼 수 있다.4) Oscilloscope(1) 오실로스코프?

  리포트 | 8페이지 | 1,000원 | 등록일 2012.01.10

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  실험 8. RAM (Random Access Memory)

  R A M (Random Access Memory) >< 목 적 >반도체 memory의 기본적인 동작 원리를 알아보고 MSI(TTL) 64-bit 기억 소자의 동작을 실험을 통해 확인한다 ... ”인 경우 출력선이 연결된 AND gate의 출력은 “0”이 되며, reading/writing 선이 연결된 NOT gate 출력이 “1”이 되므로 AND gate의 3개 입력 중 ... 선이 “1”이기 때문에 Flip-Flop 출력 결과가 AND gate의 결과이다. reading/writing 선이 연결된 NOT gate 출력이 “0”이 되므로 R-S Flip-Flop

  리포트 | 4페이지 | 2,000원 | 등록일 2012.03.11

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  TTL_NAND_NOR_게이트의_정의와_동작

  TTL NAND/NOR게이트의 정의와 동작 ( 예비레포트용 )1) 실험 목적TTL/NOR 게이트의 정의와 동작에 대하여 다음과 같은 내역으로 학습한다.① TTL 게이트의 동작② TTL ... 게이트의 부하법의 결정③ 논리 1과 0의 레벨정의④ TTL 게이트의 잡음내력⑤ 정논리와 부논리의 비교⑥ TTL의 동작전환 속도에 미치는 용량성 부하의 효과2) 관련 이론① TTL ... 예를 들면, 74L은 저전력(low-power) TTL로서 회로내의 저항값을 증가시킴으로써 TTL의 전력 소모를 90%정도 줄였으며, 74H는 고속(high-speed) TTL로서

  리포트 | 8페이지 | 1,000원 | 등록일 2010.05.21

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  아주대 전자회로실험 설계예비2 CMOS OP AMP 설계

  이런 방식으로 제조된 CMOS는 TTL에 비해 소비 전력이 적고 직접도가 높은 논리회로를 구현할 수 있다.MOSFET은 Gate와 Source간의 전압차로 인해 발생하는 Drain-Source간의 ... 이때 Gate로 들어오는 하나의 전압에 의해 P-MOS가 작동할 수도 있고 N-MOS가 작동할 수도 있다. ... SRAM 등의 디지털 회로를 구성하는데 이용된다.CMOS는 P channel과 N channel의 MOSFET을 전원 전압 V_dd와 V_ss간에 직렬로 구성하고 입력을 두 소자의 Gate에

  리포트 | 4페이지 | 1,500원 | 등록일 2014.10.05 | 수정일 2017.08.03

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  Positive edge triggered master-slave D flip flop 설계결과보고서

  (진리표 및 time analysis 작성)3.TTL chip 을 이용한 회로도를 설계한다.4. ... flop을 register라 하는 것 또한 미리 배웠으므로 익숙하게 알고 있는 소자라서 회로 구성상 큰 어려움이 없었다.그리고, master slave D flip flop은 두 개의 gate

  리포트 | 6페이지 | 1,000원 | 등록일 2014.06.03

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  [토끼] 기본논리회로 및 부울 대수, 회로의 간소화 및 Exclusive OR 회로

  -> 고성능 TTL 처리속도가 가장빠름(전파지연시간이 가장 짧음)74LS00 -> 저전력 쇼트키 TTL(처리속도도 빠르면서 소모전력도 적음)74HC00 -> 시모스 호환TTL,(처리속도가 ... 회로를 제작 하여 XOR Gate에 대하여 직접 확인해보고, k-map을 이용해 부울 함수를 유도 하고 NAND GATE로 회로를 제작하여 일반 게이트를 썼을 때와의 차이점을 알아 ... 카르 맵은 2변수, 3변수, 4변수 및 5변수로 이루어진 식 모두에 적용할 수 있다.부울 함수의 수학적 표현- product 있다.참고로, 일반적으로 많이 쓰는 TTL씨리즈를 보면74AS00

  리포트 | 42페이지 | 5,000원 | 등록일 2011.04.10 | 수정일 2020.07.10

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  Lab(2) 논리게이트 회로 실습

  TTL7486 XOR - TTL7432 OR gate 조합회로 -> XOR gate· 실험 결과 : 홀수개의 입력이 High일때에만 LED가 켜진다.· 실험 분석 : 1) 홀수개의 ... [실습1]TTL7408 AND gate - 2N3904 NPN TR - LED Interface 회로? ... TTL7400 NAND gate 조합회로 -> XOR gate· 실험 결과 : 홀수개의 입력이 High일때만 LED가 켜진다.· 실험 분석 : 1) 홀수개의 입력이 High일때만 출력이

  리포트 | 16페이지 | 1,500원 | 등록일 2010.06.23

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  실험2 예비보고서 실험 2. CMOS 회로의 전기적 특성

  이론CMOS와 TTL을 이용한 Schmitt-Trigger의 회로의 구성과 동작원리를 통한 히스테리시스를 살펴본다.Schmitt-Trigger inverter의 특징Schmitt-Trigger ... 이처럼 N1, N2(P1, P2)의 동작 차이에 의해서 히스테시스 현상을 보이게 되는 것이다.② TTL을 이용한 Schmitt-Trigger그림과 같이 인버터 2개를 종속 접속하고 ... 즉 P채널과 N채널의 상호 유기적인 동작을 통하여 CMOS는 Inverter의 동작을 수행한다.② NAND GateNOR Gate처럼 입력하여 출력을 알아보는 과정을 통해 Truth

  리포트 | 9페이지 | 1,000원 | 등록일 2013.01.01

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  TTL을 이용한 Full Adder Design

  위의 Boolean Expression 로 표현한 Function을 구성하기 위해서 필요한 Gate는 XOR, AND, OR Gate 세 종류이다. ... 여기서 품번에 따른 게이트들을 살펴보면, 00은 NAND, 02는 NOR, 04는 NOT, 08은 AND, 32는 OR, 86은 XOR Gate 이다. ... Supply의 (-)에 연결시키고, Vcc는 (+)에 연결시키면 된다.위의 원리대로 회로를 설계하면, 아래의 왼쪽에 있는 그림과 같이 설계가 가능하다.그리고 실제로 XOR, OR, AND Gate를

  리포트 | 3페이지 | 3,000원 | 등록일 2010.01.29 | 수정일 2023.06.21

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  디지털로직실험/최신 디지털 공학 실험 14 D래치와 D플립플롭

  D 입력을 1 Hz 설정된 TTL 레벨 펄스 발생기에 연결하여라. ENABLE 입력을 1.0kΩ 저항을 거친 HIGH로 연결하여라. ... 이 회로를 게이트된(gated) D 래치라고 한다. ENABLE 입력은 ENABLE이 참일 때 D 입력의 데이터가 출력으로 전달되게 한다. ... 실험 14D래치와 D플립플롭실험 목표래치(latch)가 SPDT 스위치의 바운스(bounce)를 제거하는 방법에 대한 증명.4개의 NAND 게이트와 하나의 인버터로부터 게이트된(gated

  리포트 | 18페이지 | 1,000원 | 등록일 2014.06.29

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  브랜드의 마케팅 전략/ 마케팅 전략/ 문화마케팅/문화 마케팅/패션 문화 마케팅

  이번 행사에서는 국내에도 잘 알려진 프랑스 감독 레지스 바르니에의 신작 ‘고백의 시간(THE GATE)’이 상영됐다. ... TTL카드는 주로 젊은 타깃의 감성과 라이프스타일에 부합되는 공연, 영화, 여행 등의 문화생활을 즐길 수 있는 혜택으로 구성되어있는데 젊은 세대의 감성에 어필하는 커뮤니케이션 전략을 ... 이미지와 연관시켜 광고, 홍보, 상품판매에 이용하는 것.기업의 문화판촉 전략은 고객을 유인하는 요소로 작용하여 새로운 이미지로 변화를 거듭하는 계기가 되기도 한다.ex) SK텔레콤의 TTL카드

  리포트 | 9페이지 | 1,000원 | 등록일 2014.11.25

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  실험 1. BASIC GATES

  적고 TTL과의 서로 연결을 할 수 있다. ... DCTL, RTL, RCTL, DTL,TTL, ECL 등이 있다. ... TTL의 2입력 NAND 게이트를 그림 2과 같이 결선하면 와이어드 AND가 되지 않는다.

  리포트 | 6페이지 | 1,000원 | 등록일 2009.09.29

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