"HDL" 검색결과 81-100 / 6,489건

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  HDL로 작성한 single cycle processor

  1.프로젝트 소개single cycle process 의 작동과정과 원리를 HDL로 짜서 나타내는 프로그램이다.

  리포트 | 13페이지 | 2,000원 | 등록일 2010.06.28

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  [기초전자회로실험1] "Verilog HDL을 이용한 Seven-segment display의 설계 및 FPGA를 통한 검증" 예비보고서

  실험제목Verilog HDL을 이용한 Seven-segment display의 설계 및 FPGA를 통한 검증2. ... 1Preliminary report Electronic Engineering기초전자회로실험1Verilog HDL을 이용한 Seven-segment display의 설계 및 FPGA를 ... Seven-segment display의 심볼 및 동작을 이해하고, 이를 응용하여 4-bit Adder의 설계 방법을 익힌다.③ Seven-segment display를 Verilog HDL을

  리포트 | 6페이지 | 1,000원 | 등록일 2019.03.23 | 수정일 2019.04.01

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  부울 대수 논리식의 간소화 - Verilog HDL 예비보고서

  기 본 이 론1) 소개- Verilog HDL은 전자 회로 및 시스템에 쓰이는 하드웨어 기술언어(HDL)이다. 줄여서 ‘Verilog'이라고 부르기도 한다. ... 실 험 목 적- 부울대수를 Verilog HDL의 형태로 표현하는 방법을 이해한다.- Verilog HDL code로 Quartus Ⅱ를 이용하여 합성하고 Programing하는 방법을 ... 회로 설계, 검증,구현등 여러 용도로 사용할 수 있다.2) Verilog HDL의 역사- 1983년 Gateway Design Automation사에서 하드웨어 기술언어인HiLo와

  리포트 | 3페이지 | 1,000원 | 등록일 2013.10.31

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  [기초전자회로실험1] "Verilog HDL을 이용한 Seven-segment display의 설계 및 FPGA를 통한 검증" 결과보고서

  실험제목Verilog HDL을 이용한 Seven-segment display의 설계 및 FPGA를 통한 검증2. ... 1Result report Electronic Engineering기초전자회로실험1Verilog HDL을 이용한 Seven-segment display의 설계 및 FPGA를 통한 검증자료는 ... 실제 회로에서는 각 IC로직이 있어야 하는 한계가 있는데 HDL의 코딩방식을 통하면 BCD코드가 아니더라도 각 입력을 이진에 따라 나타내고 싶은 입력변수를 이진코드에 하나씩 대응시키고

  리포트 | 3페이지 | 1,000원 | 등록일 2019.03.23 | 수정일 2019.04.01

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  t-cho hdl-cho

  aggregating the HDL, LDL, TG. ... 제출일 : 2011. 11. 23(수)임상영양학 실험 보고서T-CHO / HDL-CHO박주형 Park ju hyeong 2007028825한양대학교 식품영양학과Cholesterol ... In HDL-cholesterol measurements, we use the contrifuge to separate the serum. total cholesterol means

  리포트 | 4페이지 | 4,000원 | 등록일 2011.12.25

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  verilog HDL _ barrel shifter

  *Block Diagram-mode에 의해 8가지 동작을 수행(logical & arithmetic, shift & rotate, left & right)-dist 값에 의해 자리 수 shift or rotate 동작을 수행-dout은 barrel shifter 내의 ..

  리포트 | 7페이지 | 2,000원 | 등록일 2008.10.26

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  HDL Verilog 알람시계

  실습목표-Alarm 기능을 갖는 digital clock을 Verilog HDL로 설계한다.-기능을 시뮬레이션을 통해서 검증한다.2. ... 하지만, 더욱 더 열심히 노력해 HDL에 더욱 가까워 질 수 있도록 노력하겠다. 1학기 동안 정말 많은 가르침을 주고 수고해주신 교수님과 조교님게 감사드립니다.

  리포트 | 8페이지 | 5,000원 | 등록일 2007.06.21 | 수정일 2023.04.10

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  HDL-cholesterol

  이 가운데 HDL에 함유된 콜레스테롤이 HDL-콜레스테롤입니다. ... 콜레스테롤의 분해가 왕성하게 일어날수록 HDL콜레스테롤이 높아 진다. 따라서 HDL콜레스테롤이 높을수록 혈관은 깨끗해진다. ... HDL콜레스테롤을 낮게 만드는 가장 중요한 원인은 고중성지방혈증인데 비만, 당뇨병, 운동부족 등에서 흔히 나타난다고 한다. 흡연 역시 HDL콜레스테롤을 떨어뜨린다.

  리포트 | 5페이지 | 1,500원 | 등록일 2007.05.25

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  Active-HDL 사용법에 대한 소개 (컴퓨터 아키텍쳐 실습)

  실험 목표Active-HDL의 기본적인 사용법을 익힌다.2. ... Computer Architecture LabLab 02: Introduction to the usage of Active-HDL1. ... Active-HDL의 test bench 자동 생성 기능과 Execute script 기능을 적극 활용하여 만들었다.4. 결과성공적으로 실험 목표를 달성하였다.

  리포트 | 5페이지 | 1,000원 | 등록일 2013.03.08

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  Active HDL로 구현한 ALU

  VHDL로 구현한 ALU입니다프로그램 소스하고 설명 다 있고, 레포트형식으로 만든 한글파일도 있습니다.컴퓨터 실험 과목 수강해서 A+ 나온 자료입니다필요하신 분 받아가세요

  리포트 | 11페이지 | 1,500원 | 등록일 2007.01.07

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  [HDL-Verilog] D F/F, 8bit register, 8bit shift register

  [LAB 2, 3, 4] 실습 레포트(D-Flip Flop, 8-bit register, 8-bit shift register)1. 실험 목표D Flip Flop과 D F/F을 이용한 8-bit register, 8-bit shift register를 각각 Verilo..

  리포트 | 7페이지 | 1,000원 | 등록일 2015.06.05

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  [기초전자회로실험1] "Verilog HDL을 이용한 로직게이트 설계 및 FPGA를 통한 검증 (NAND2, NOR2, XOR2)" 결과보고서

  HDL에서 각 연산자 표기와 모듈과 인스턴스, 포트 그리고 테스트벤치의 의미를 숙지하고 FPGA 보드를 지원하는 Vivado 프로그램에서 HDL을 이용해 원하는 회로를 구성하고 이를 ... 실험제목Verilog HDL을 이용한 로직게이트 설계 및 FPGA를 통한 검증 (NAND2, NOR2, XOR2)2. ... 1Result report Electronic Engineering기초전자회로실험1Verilog HDL을 이용한 로직게이트 설계 및 FPGA를 통한 검증 (NAND2, NOR2, XOR2

  리포트 | 3페이지 | 1,500원 | 등록일 2019.03.18 | 수정일 2019.03.29

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  [기초전자회로실험1] "Verilog HDL을 이용한 로직게이트 설계 및 FPGA를 통한 검증 (NAND2, NOR2, XOR2)" 예비보고서

  실험제목Verilog HDL을 이용한 로직게이트 설계 및 FPGA를 통한 검증 (NAND2, NOR2, XOR2)2. ... 설계방식우선 HDL(Hardware Description Languages)은 C++, JAVA, JAVA Script. ... 1Preliminary report Electronic Engineering기초전자회로실험1Verilog HDL을 이용한 로직게이트 설계 및 FPGA를 통한 검증 (NAND2, NOR2

  리포트 | 7페이지 | 1,500원 | 등록일 2019.03.18 | 수정일 2019.03.29

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  HDL과 LDL, ADH와 ALDH, FAS와 FAE

  지단백 중 가장 작고, 30～50%가 단백성분이어서 가장 밀도가 높고, 지방의 50%가 인지질, 30%는 콜레스테롤-에스테르로 구성된다.비중에 따라 HDL2와 HDL3가 있으며, HDL3가 ... 대개는 HDL3에서 HDL2로 대사되나, hepatic lipase에 의해 역전환 되기도 한다.기능요약 :* 혈관 내강에 침착된 LDL-콜레스테롤을 간으로 역수송하여 체외로 배설하게 ... 이러한 기능으로 해서 HDL-c은 “좋은 콜레스테롤”이라고 불리워 진다. 주로 간에서 생성되나, 소장에서도 합성된다.

  리포트 | 5페이지 | 1,000원 | 등록일 2009.03.26

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  아주대학교 논리회로 HDL프로젝트 100점만점보고서 상세설명 + CODE포함

  논리회로 VHDL Proj.2#. Project 개요VHDL 2nd Project는 Seven Segment Decoder를 VDHL로 구현하는 것이다.7 Segment란 Segment 방식의 숫자 표시 소자로서 최대 7개의 Segment로 숫자를 표시하는 방식을 의미..

  리포트 | 15페이지 | 2,500원 | 등록일 2016.07.09 | 수정일 2016.07.11

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  [디지털회로실험] [쿼터스 / 베릴로그 언어(Verilog HDL) / DE2] Half Adder / Full Adder

  《 결과 보고서 》조제출일학과/학년학번이름실험1? 코드? 시뮬레이션 결과? Pin 입력? DE2 보드 사진스위치 00 입력스위치 01 입력스위치 10 입력스위치 11 입력실험2? 코드▷ Full Adder 단일 코드▷ 앞에서 짰던 Half Adder 코드를 이용한 코드..

  리포트 | 3페이지 | 2,000원 | 등록일 2014.10.21 | 수정일 2016.06.13

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  디지털 논리회로 Verilog HDL 을 이용하여 RLC 주사위 게임 (RLC DICE GAME) 설계

  게임기의 설계 사양과 옵션 사항 들을 Verilog HDL을 이용하여 코딩해보고 결과를 Modelsim 프로그램을 통해 검증해본다.2.

  리포트 | 25페이지 | 3,500원 | 등록일 2014.03.15

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  verilog HDL을 이용한 LED주사위 설계 피피티 (자판기 or 신호등)

  또한 간단한 동작원리로 동작하는 주사위 값을 LED 로 표현하는 회로를 Verilog HDL 언어를 이용하여 직접 코딩하고 , Verilog HDL 언어를 조금 더 숙련되게 사용하고자 ... 주사위 설계 프로젝트를 통하여 팀원들 간에 Verilog HDL 언어를 이용한 코딩 기술에 대해서 좋은 정보를 함께 공유해본다 . ... 0 0 0 0 1 1 0 0 0 0 0 0 0 1 1 1 0 0 1 1 0 1 1 0 0 1 1 1 1 1 1 1 1 1 0 1 1설계결과 SCHEMATIC설계결과 Verilog HDL설계결과

  리포트 | 14페이지 | 1,500원 | 등록일 2013.07.16

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  운동 전 후의 혈청의 HDL-C 변화

  그 대신 polyaniom과 2가 금속 ion으로 HDL을 간단하게 분리할 수 있어서 흔히 이 방법으로 HDL 내 콜레스테롤을 측정한다.HDL-C은 항동맥경화 작용이 있어서 관상동맥 ... 고밀도 콜레스테롤 ( High density lipoprotein cholesterol; HDL-C )HDL-C은 간 및 소장에서 합성되어 혈중으로 유출되고 지단백 중 가장 큰 비중을 ... 100mg.이 상당의 농도로 계산한다.HDL-C = 검체의 흡광도 / 표준액의 흡광도 × 50 × 25) 측정값정상 혈중 HDL-C 기준치 남자 : 40mg/dl 이하, 여자 :

  리포트 | 2페이지 | 1,500원 | 등록일 2010.07.08

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  혈청측정(Total cholesterol, HDL cholesterol)

  지단백(HDL)에 의해 운반되는 콜레스테롤 즉, HDL cholesterol은 혈중 콜레스테롤의 20-30%를 차지하는데 HDL이 도 있다.- LDL Cholesterol = LDL-CLDL ... HDL cholesterol ? ... 그러므로 체내에 LDL 을 낮춰주고 HDL을 높여주면 된다.

  리포트 | 9페이지 | 2,000원 | 등록일 2010.04.22

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