"디지털논리회로" 검색결과 121-140 / 4,145건

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  디지털 논리회로 실험 9주차 Shift Register 예비보고서

  디지털 논리회로 설계 및 실험예비보고서주제 : Shift Register소속: 공과대학 전자전기공학부수업: X X,X XXX 교수님 XXX 조교님제출 일자: 20XX년 X월 XX일 ... 실험 이론레지스터는 많은 디지털 시스템에서 매우 중요한 논리 블록이다. 레지스터들은 2진 정보를 저장하고 디지털 연산을 실행하는데 사용된다. ... [그림 2]존슨 카운터는 맨 마지막 플립플롭의 출력 중 NOT 출력을 첫 번째 플립플롭의 입력과 연결한 회로이다.

  리포트 | 11페이지 | 1,500원 | 등록일 2021.04.22

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  서강대학교 디지털논리회로실험 7주차 결과보고서

  배경이론 및 실험방법Counter는 clock에 의해 단일 cycle을 반복적으로 수행하는 순차 논리회로이다.

  리포트 | 12페이지 | 1,000원 | 등록일 2021.10.02

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  서강대학교 디지털논리회로실험 9주차 결과보고서

  1. 실험목적1) 메모리 소자들의 동작 원리와 활용 방법을 이해한다.Read Only Memory(ROM)Random Access Memory(RAM)2) Address decoding의 개념과 구현 방법을 이해한다.3) ROM을 이용해서 임의의 기능을 수행하는 com..

  리포트 | 12페이지 | 1,000원 | 등록일 2021.10.02

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  서강대학교 디지털논리회로실험 4주차 결과보고서

  배경이론 및 실험방법Multiplexer는 n개의 입력신호로부터 1개를 선택해서 출력에 연결해주는 Digital Switch이다.일반적으로 n개의 입력을 갖는 b-bit multiplexer의 ... device을 통해 High-impedance상태를 오실로스코프로 관찰하고 그 기능에 대해 알아본다.Multiplexer, Exclusive-OR, Parity circuit는 FPGA로 회로를

  리포트 | 12페이지 | 1,000원 | 등록일 2021.10.02

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  홍익대_디지털논리회로실험_2주차 예비보고서_A+

  디지털 논리실험 및 설계 2주차 예비보고서실험 준비1.1 NAND 7400 게이트, NOR 7402 게이트, XOR 7486 게이트의 datasheet를 확인하시오.7402 NOR ... 이때의 진리표는 XOR 게이트의 진리표와 같다.2.5 응용실험 (2)실험 준비 1.3에서 구현한 회로를 보자. ... 게이트는 지금까지의 게이트와는 다르게 1번 pin이 output이기 때문에 유의할 필요가 있다.1.2 기본 실험 (4)의 회로를 구현하시오.1.3 응용 실험 (1), (2), (3)

  리포트 | 6페이지 | 1,500원 | 등록일 2024.05.15

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  홍익대_디지털논리회로실험_8주차 예비보고서_A+

  디지털 논리실험 및 설계 8주차 예비보고서실험 준비1.1 Gated D Latch의 동작에 대해 설명하시오.Gated S-R Latch와 매우 유사하다. ... 아닌 J-K Flip-flop으로 응용실험 (2)의 회로 [그림 4]와 동일한 기능의 회로를 구현하시오.을 J에 입력해준다. ... 결국 CLK에 연결된 스위치가 올라갈 때마다 Q의 값이 토글된다.결론적으로 응용실험 (1)과 응용실험 (2)의 회로는 Q의 값을 토글시킨다는 공통점이 있지만 응용실험 (1)의 회로는

  리포트 | 7페이지 | 1,500원 | 등록일 2024.05.15

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  홍익대_디지털논리회로실험_5주차 예비보고서_A+

  디지털 논리실험 및 설계 5주차 예비보고서실험 준비1.1 4.1 기본 실험 (2)의 전가산기 [그림 2]는 반가산기 [그림 1] 두 개와 하나의 OR 게이트로 이루어져 있다. ... 이렇게 하는 이유는 회로가 복잡해짐에 따라 디버깅이 중요해지기 때문이다. ... 이를 ∑ = (A⊕B으로 구현했다.1.2 응용 실험 (1), (2)의 회로를 구현하시오.응용실험(1)전가산기를 두개 이용하여 두 자리 이진수 덧셈기를 구현했다.

  리포트 | 5페이지 | 1,500원 | 등록일 2024.05.15

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  서강대학교 디지털논리회로실험 5주차 결과보고서

  Subtractor(감산회로)는 어떤 수의 2’s complement를 더함으로 구현하거나 subtractor의 구현을 통해 수행할 수 있다.ALUs(연산회로)는 여러 연산 및 논리 ... 배경이론 및 실험방법비교회로(Comparator)는 두 binary 수의 비교를 통해 판단하는 회로이다.Adder(가산회로)는 두 개의 1-bit를 더해 2-bit의 합을 출력한다. ... Full-adder회로는 다음과 같다.

  리포트 | 13페이지 | 1,000원 | 등록일 2021.10.02

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  디지털 논리회로 실험 2주차 기본 논리 게이트 (NAND, NOR, XOR Gate) 결과보고서

  디지털 논리회로 설계 및 실험결과보고서주제 : NAND, NOR, XOR GATE 및 응용소속: 공과대학 전자전기공학부수업: X X,X XXX 교수님 XXX 조교님제출 일자: 20XX년 ... 지금까지 실험한 기본 논리 게이트들의 핀의 위치는 대부분 핀 1,2번이 입력값이고 핀 3번이 출력값이었는데, 4.1.2 실험 때 쓰이는 NOR 게이트는 다른 논리 게이트들과 달리 3번 ... 결론이번 실험에서는 기본 논리게이트 중 NAND, NOR, XOR 게이트 각각의 진리표의 진위를 확인해보고, 이 3가지 게이트들의 각각의 특성들을 파악할 수 있었다.

  리포트 | 11페이지 | 2,000원 | 등록일 2022.04.21

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  서강대학교 디지털논리회로실험 10주차 결과보고서

  R-2R ladder circuit를 이용해 DAC를 나타낼 수 있는데, 회로는 다음과 같다.이 회로는 R과 2R의 크기를 갖는 저항들을 사다리형태로 배열하고 입력되는 4-bit 디지털 ... 배경이론 및 실험방법DAC는 이진수 체계로 표현된 디지털 신호를 상응하는 아날로그 전압으로 전환하는데 사용되는 소자로, 이 소자는 집적회로의 형태로 공급되고 있는데, 그 기능을 파악하기 ... 실험목적1) Digital-to-analog 변환(DAC)- Digital 신호를 analog 신호로 반환하는 회로의 동작 원리를 이해한다.- DAC IC(DAC0808)의 구동 방법을

  리포트 | 12페이지 | 1,000원 | 등록일 2021.10.02

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  서강대학교 디지털논리회로실험 3주차 결과보고서

  Decoder는 하나의 code체계를 다른 code 체계로 변환하는 논리회로이다. ... 그 후 Combinational 회로 설계 단계에서 Karnaugh map을 통해 출력 F를 구한다. ... 배경이론 및 실험방법회로를 수식으로 나타낼 때 직접적으로 최소화하는 것은 비효율적이다. 더 효율적인 방법의 예는 Karnaugh map이 있다.

  리포트 | 8페이지 | 1,000원 | 등록일 2021.10.02

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  디지털 논리회로의 응용 D/A, A/D Converter/반도체 기억장치

  디지털 논리회로의 응용 – D/A, A/D Converter/반도체 기억장치메인 레포트실험 목표디지털-아날로그 변환기와 아날로그-디지털 변환기에 대해 이해할 수 있다.디지털 논리 소자를 ... 이 경우도 각각의 회로를 테브냉 등가를 이용해서 계산하면 출력값이 나오게 된다.아날로그 디지털 변환기 (A/D converter)아날로그 디지털 변환기는 아날로그 신호를 디지털 신호로 ... 만약 구간을 더욱 작게 나눠서 측정한다면 모든 디지털 신호에 해당하는 전압구간을 측정할 수 있을 것이다.RAM/ROMRAM 실험에서는 RS래치 회로를 이용하여 회로를 구성하였다.

  리포트 | 11페이지 | 1,000원 | 등록일 2022.03.03

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  홍익대_디지털논리회로실험_3주차 예비보고서_A+

  디지털 논리실험 및 설계 3주차 예비보고서실험 준비1.1 기본 실험 (1)의 회로가 2-bit 복호기인 이유를 설명하시오.기본 실험 (1)의 회로는 입력 A,B를 받아 Y0, Y1, ... 다음과 같다. n개의 입력으로 들어오는 데이터를 받아 그것을 숫자로 보고 2의 n제곱 개의 출력 회선 중 그 숫자에 해당되는 번호에만 1을 내보내고 나머지는 모두 0을 내보내는 논리 ... 회로.

  리포트 | 6페이지 | 1,500원 | 등록일 2024.05.15

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  홍익대_디지털논리회로실험_9주차 예비보고서_A+

  디지털 논리실험 및 설계 9주차 예비보고서실험 준비1.1 8-bit Serial-in Parallel-out Shift Register 74164의 datasheet를 확인하고 의 ... Q1, Q2는 각각 Q2, Q3에 출력된다.2.2 기본실험 (2)기본실험(1)에서 만든 회로의 원리대로 8개의 D Flip-flop을 이어 붙인 것이 74164 칩이다. ... Q3라고 할 때 초기 값이 0100이라면 CLK가 0에서 1로 올라갈 때 1010으로 출력이 바뀐다.1.3 응용실험 (2)에서 초기화 하는 과정을 자세히 서술하시오.응용실험 (2)의 회로는

  리포트 | 6페이지 | 1,500원 | 등록일 2024.05.15

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  홍익대_디지털논리회로실험_7주차 예비보고서_A+

  디지털 논리실험 및 설계 7주차 예비보고서실험 준비1.1 S-R Latch와 - Latch의 동작에 대해 설명하시오.Latch란 1비트의 정보를 저장할 수 있는 회로이다. ... 한번 눌렀다고 생각할 수 있지만 채터링이 발생하면 입력이 여러 번 된 것으로 간주되어 결과가 나타난다.실험 결과2.1 기본실험 (1)모두 0일 때 둘 다 1이 출력되지만 이것은 위 회로에선

  리포트 | 7페이지 | 1,500원 | 등록일 2024.05.15

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  홍익대_디지털논리회로실험_6주차 예비보고서_A+

  디지털 논리실험 및 설계 6주차 예비보고서실험 준비1.1 ALU 74181의 datasheet을 읽고 네 자리 이진수의 덧셈을 74181을 이용하여 어떻게 구현할 수 있는지 설명하시오.ALU

  리포트 | 7페이지 | 1,500원 | 등록일 2024.05.15

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  디지털 논리회로 8장 연습문제 풀이 (생능출판, 김종현)

  리포트 | 22페이지 | 3,000원 | 등록일 2021.04.28

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  디지털 논리회로 실험 8주차 D-FlipFlop 예비보고서

  디지털 논리회로 설계 및 실험예비보고서주제 : D-FlipFlop소속: 공과대학 전자전기공학부수업: X X,X XXX 교수님 XXX 조교님제출 일자: 20XX년 X월 XX일 X요일X조 ... 실험 이론디지털 시스템에서 클럭 (clock) 신호에 의해 각종 논리신호가 동작되는데, 플립플롭 역시 이 신호에 동기 되어 동작한다. ... -D 플립플롭InputOutputDCLKQ0falling01falling1(a) 논리회로 (b) 진 리 표(C) 타이밍 선도그림 5-6 SR 플립플롭을 이용한 하강 에지 트리거 D

  리포트 | 8페이지 | 1,500원 | 등록일 2021.04.22

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  아날로그 및 디지털회로설계실습 10 조합논리 회로의 예 (7-segmentDecoder 회로 설계) 과제

  조합논리 회로의 예 (7-segment/Decoder 회로 설계) 과제7-segment LED의 특성을 확인하였을 때 Common Cathode type이라면, 7-Segment LED의

  리포트 | 1페이지 | 1,000원 | 등록일 2021.09.02

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  디지털 논리회로 실험 2주차 기본 논리 게이트 (NAND, NOR, XOR Gate) 예비보고서

  디지털 논리회로 설계 및 실험예비보고서주제 : 기본 논리 게이트 (NAND, NOR, XOR Gate)소속: 공과대학 전자전기공학부수업: X X,X XXX 교수님 XXX 조교님제출 ... 실험 목적NAND, NOR, XOR, 등 논리게이트의 특성 및 응용에 대해 학습한다.2. 실험 이론? NAND, NOR, XOR 연산? NAND? ... 모든 논리 게이트가 NOR 게이트로 대치 가능 (범용 게이트)? AND, OR, NOT 게이트도 NOR 게이트로 표현 가능? 그림????? NOR 게이트 등가회로?

  리포트 | 13페이지 | 1,500원 | 등록일 2021.04.22

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