"Logic OR NOR 결과 보고서" 검색결과 1-20 / 86건

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  전자공학 실험 Logic OR NOR 결과 보고서

  B1111010110001.2 or logic과 같다실험1에 10-1번 사고 실험에서 나온 질문을 직접 회로를 꾸며서 만들어 보는 실험이다또한 드 모르간 법칙과 진리표를 이용하면 사고 ... 실험은 NAND로 꾸민 logic과 XOR TTL gate에 실험값이 같은지를 확인하는 것이다NAND만으로도 꾸밀수 있지만 AND OR INVERTER로도 꾸밀수 있다. ... 실험 2 Logic and time table실험1.ABA .

  리포트 | 5페이지 | 1,000원 | 등록일 2018.06.07

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  (A+/이론/예상결과/고찰) 아주대 논리회로실험 결과보고서 1

  그러나 NAND NAND, NOR NOR로 쓴 예비보고서와 달리 AND NAND를, OR NOR를 쓴 실험 결과는 전혀 달랐다. ... 조합은 예비보고서와 실험 결과가 잘 일치했다. ... 즉 3-input NAND, 3-input NOR라는 것은 3-input AND와 3-input OR의 결과에 부정인 결과를 얻기 위한 gate로 AND NAND, OR NOR의 조합을

  리포트 | 8페이지 | 1,000원 | 등록일 2021.10.24

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  아주대학교 논리회로실험 / 1번 실험 예비보고서

  1주차 실험 예비보고서전자공학과 / 학년 / 학번 : / 이름 :날짜 : / 담당조교님 :실험 1. Basic Gates1. 실험 목적1. ... Logic Gate ( AND, OR, NOT, XOR, NOR, NAND )를 이해한다.2. ... 출력 결과에 따른 진리표를 작성한다.3. 소자를 OR로 변경하고 앞선 과정을 반복한다.실험 1-2 : 3-input NAND, NOR gate1.

  리포트 | 8페이지 | 1,000원 | 등록일 2021.07.20

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  서강대학교 21년도 디지털논리회로실험 2주차 보고서 (A+자료) - Logic Gates, FPGA

  디지털논리회로실험 2주차 실험 보고서목적- TTL logic gates의 동작 방법을 익히고, Logic level과 noise margins, fanout에 대해 이해한다.- Gates를 ... 따라서 NOR의 기능을 한다고 볼 수 있는데, 이는 negative-logic으로 OR이고 단자의 연결만으로 logic을 구현했기에 wired-OR connection이라 한다.이 ... Logic signals and gates디지털 논리 값은 0(low)와 1(high)가 있는데, 기본적인 함수 AND, OR, NOT, NAND, NOR를 이용해 디지털 논리 회로를

  리포트 | 20페이지 | 2,000원 | 등록일 2022.09.18

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  건국대학교 전기전자기초실험1 12주차 예비보고서 A+

  전기전자기초실험1 예비보고서 – 12주차학과 : 2 학번 : 이름 : 21. ... 그리고 NOR 게이트의 출력에 (a)의 인버터를 접속하면, [(A+B)’]’=(A+B)가 되어 OR 게이트가 된다. ... 사전 조사 항목(1) 논리 게이트의 종류에 대해 조사하시오.→ 종류 : RTL(Resistor-Transistor Logic), DTL(Diode-Transistor Logic),

  리포트 | 24페이지 | 5,000원 | 등록일 2024.04.14 | 수정일 2024.04.22

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  [건국대학교 전기전자기초실험1 A+][2024 Ver] 12주차 - 예비레포트

  전기전자기초실험1 예비보고서 – 12주차분반학과이름학번1. ... 즉, 입력신호 A가 0일 때는 F로 1이 출력되며, A=1일 때는 F=0이 된다.(3) NOR 게이트로 AND, OR, NOT 게이트 논리회로를 구현하는 방법을 각각 구하시오. ... NOR게이트는 OR게이트와 NOT게이트를 이용하여 구현하시오.다음과 같은 회로를 구성하고 A,B 단자의 입력전압 , 를 아래와 같이 인가하고 입력전압과 출력전압을 측정하여 한화면에

  리포트 | 18페이지 | 5,000원 | 등록일 2024.08.10

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  논리회로설계 실험 기본게이트 설계

  논리회로설계 실험 예비보고서 #1실험 1. 기본게이트 설계1. 실험 목표CPLD와 FPGA에 대해 알아보고 그의 활용을 알아본다. ... 게이트로, 두 개의 입력(A와 B라 가정)을 받아 A와 B 둘 중 하나라도 1이면 결과가 1이 되고, 둘 다 0이면 0이 된다.4) NOR 게이트OR 게이트에 NOT 게이트를 연결OR ... 이와 같이 A와 B 각각에 0과 1을 대입해보면 어떤 결과 값이 나오는지 알 수 있을 것이다.3) OR 게이트OR 게이트의 논리식과 논리도OR 게이트는 부울대수의 OR 연산을 하는

  리포트 | 6페이지 | 1,500원 | 등록일 2021.10.01

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  서강대학교 디지털논리회로실험_2 Digital logic gate

  디지털 논리회로 실험 결과 보고서2주차 Digital logic gate5조 20161510 윤수찬1. 실험제목 : Digital Logic gate2. ... AND와 OR logic의 출력에 inverter symbol을 추가하여 NAND와NOR gates를 정의하며 그림 2.2에 진리표와 symbol을 표시하였다.그림 SEQ 그림 \* ... 임의의 논리 함수가 최소화 될 수 있음을 확인한다.- Wired OR logic의 특성과 활용 방법을 익힌다.- FPGA를 이용하여 간단한 논리 회로를 구현하고 동작을 확인한다.

  리포트 | 21페이지 | 1,000원 | 등록일 2020.08.12

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  전기및디지털회로실험 실험6 예비보고서

  예비보고서 문제 풀이6. ... (5) 예비보고서 5항의 회로를 결선하고 그 결과가 설계요구조건에 부합하는지 확인하라.입력예상신호실제신호오차율ABCDFFF00000001001010011101001010110S0000010110011110 ... (4) 예비보고서 4항의 회로를 결선하고 그 결과가 설계요구조건에 부합하는지 확인하라.입력예상신호실제신호오차율ABCDFFF00000000100010000111010000101101101011111000010011101011011111001110111110111111

  리포트 | 16페이지 | 1,000원 | 등록일 2023.06.30

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  디지털 실험 5장(논리회로 간소화) 결과보고서

  실험순서1) 그림 5-5에 제시된 회로를 NAND게이트만으로 구성된 회로로 바꾸어 구성하고 모든 입력 조합을 검사하고 보고서의 진리표를 완성한다. ... ’+d)TTL 논리- Transistor-transistor logic의 약자이다. ... 고찰카노맵을 이용해서 구한 식을duct of Sum의 약자이다. 1단계는 OR항(합의 항)으로 구성되고, 2단계는 AND항(곱의 항)으로 만들어진 논리식이다.Ex) f=(a+b)(c

  리포트 | 7페이지 | 3,000원 | 등록일 2019.12.17

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  제10장 래치와 플립플롭 예비보고서

  제10장 래치와 플립플롭-예비보고서-1) 실험의 목표- 순차논리회로에 대한 개념을 이해한다.- 래치의 동작원리를 이해한다.- 래치의 동작을 실험을 통해 이해한다.- 플립플롭의 동작원리를 ... 마지막 단계로 스위치가 a지점에 안정하게 고정되면 출력이 Q=1인 상태가 유지되어, 결과적으로 바운싱현상이 나타나지 않음을 알 수 있다.그림 10-14. ... NOR게이트로 구성된 SR래치그림 10-6. NOR게이트의 역할그림 10-7. NAND게이트로 구성된{bar{S}} {bar{R}}래치회로그림 10-8.

  리포트 | 15페이지 | 1,500원 | 등록일 2020.02.11

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  11. 카운터 설계 예비보고서 - [아날로그및디지털회로설계실습 A+ 인증]

  아날로그 및 디지털 회로 설계 실습-실습 11 예비보고서-카운터 설계소속중앙대학교 전자전기공학부담당 교수님*** 교수님제출일2021.11.25(목)분반, 조**분반, *조학번2*** ... 실습 준비실습 준비물부품JK Flip Flop 74HC73NAND gate 74HC00NOR gate 74HC02AND gate 74HC08OR gate 74HC32LED BL-R2131H ... 다음은 RS-Latch 를 이용한 방법으로 forbidden 영역 없이 완전한 Logic High, Logic Low 로 구분 가능하다는 장점이 있다.참고 자료 : 실습 교재 이론부

  리포트 | 12페이지 | 1,000원 | 등록일 2022.11.16 | 수정일 2023.01.03

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  [기초전자회로실험2] Verilog 언어를 이용한 Sequential Logic 설계 결과레포트

  ,보고서 평가 A+기초전자회로실험 과목 A+받은 자료입니다.본 문서는 나눔글꼴 기준으로 되어있습니다. ... 실험제목Verilog 언어를 이용한 Sequential Logic 설계2. ... 실험결과 및 사진SR Flip-FlopT Flip-FlopD Flip-FlopSR Latch module Test Bench sourceSR Latch module source1.

  리포트 | 4페이지 | 1,000원 | 등록일 2019.03.27 | 수정일 2019.04.01

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  아주대학교 논리회로실험 실험1 Basic Gates 결과보고서

  실험1 Basic Gates 결과보고서IEEE Code of Ethics(출처: http://www.ieee.org)We, the members of the IEEE, in recognition ... NOR gate도 마찬가지로 OR gate에 NOT gate가 합쳐진 것으로 Boolean식으로는{bar{A+B}} ={bar{A}} BULLET {bar{B}}으로 표현되고 OR ... 결선도를 제대로 확인하고 실험하는 자세가 필요하다.2) 3-input OR gate 구성3-input OR gate의 logic diagram결선도A=1, B=0, C=0A=1, B

  리포트 | 7페이지 | 1,500원 | 등록일 2019.02.20

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  [기초전자회로실험1] "Verilog HDL을 이용한 Full Adder와 Half Adder의 설계 및 FPGA를 통한 검증" 예비보고서

  Engineering기초전자회로실험1Verilog HDL을 이용한 Full Adder와 Half Adder의 설계 및 FPGA를 통한 검증자료는 실제 실험을 바탕으로 작성되었으며,보고서 ... 여기서 + 와 - 는 덧셈과 뺄셈을 나타낸다.① 논리 연산자에는 Logical AND (&&), Logical OR (||), Logical NOT (!) 이 있다. ... AND (&), NAND (~&), OR (|), NOR (~|), XOR (^)을 단항 연산자처럼 사용할 수 있는데, 이 때는 축소 연산을 수행한다.

  리포트 | 6페이지 | 1,000원 | 등록일 2019.03.19 | 수정일 2019.04.01

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  아주대학교 논리회로실험 실험1 Basic Gates 예비보고서

  실험1 Basic Gates 예비보고서IEEE Code of Ethics(출처: http://www.ieee.org)We, the members of the IEEE, in recognition ... 실험 과정실험1Breadboard에 실험1과 같은 구성으로 AND, OR, NAND, NOR Gate가 있는 칩으로 바꾸면서 실험한다.실험2여러 Logic Gate를 사용하기 때문에 ... 예상 결과1) 실험 1 결과 예상Logic GateInputOutputABCL1L2ANDLLLLLHLLLLLHLLLLLHLLLHHLLHLHLLHHLHLHHHHHLogic GateInputOutputABCL1L2ORLLLLLHLLLHLHLHHLLHLHLHHHHHLHHHHHLHHHHHHHLogic

  리포트 | 5페이지 | 1,500원 | 등록일 2019.02.20

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  디지털회로 예비 보고서[부울대수(Boolean Algebra)와 조합 논리 회로]

  디지털 회로 실험 예비 보고서 #2실험 2. 부울대수(Boolean Algebra)와 조합 논리 회로과 목담당교수제 출 일분반/조학 번이 름1. ... 실험 준비물- AND, OR, NOT, NAND, NOR Gate, 멀티미터, 전원공급기, 빵 판3. ... 예비 이론①소개부울 논리(Boolean Logic)는 부울 논리의 기본이 되는 두 부울 상수 0과 1을 조합하여 이 루는 논리를 말한다.

  리포트 | 7페이지 | 1,000원 | 등록일 2018.06.12 | 수정일 2018.06.18

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  [mahobife]디지털회로실험 오픈컬렉터와 3-상태버퍼/인버터, 논리회로실험 예비보고서입니다.

  간단한 논리회로실험예비보고서조교님제출일학 과학 년학 번성 명Ⅰ. 목적1. 오픈 컬렉터의 의미 확인2. 3-상태(3-state) 버퍼/인버터 특성 확인3. ... 페리티 체커● X-OR 게이트나 X-NOR 게이트는 패리티 검사에 응용할 수 있다.짝수 패리티비트를 갖고 전송되는 세 비트 메시지를 고려해보자. ... 따라서, 이러한 바람직하지 않은 결과를 방지하려면 개방 콜렉터형의 wired-OR회로에서는 반드시 이 묶여진 출력단을 수 KΩ 정도의 저항으로 +5V 전원에 풀업(pull-up)시켜

  리포트 | 12페이지 | 1,000원 | 등록일 2017.10.09 | 수정일 2017.12.09

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  디지털실험 - 실험 1. 디지털 논리소자 예비

  Logic)과 각 게이트(AND, OR, NAND, NOR, Exclusive OR)의 상관관계를 알아보아라.- DTL은 다이오드와 트랜지스터를 사용한 노리를 구성하고 있다. ... *예비보고서*실험주제실험 1. 디지털 논리소자조13조1. ... 실험 이론- 목 적1) 반도체 소자를 사용하여 구성한 Inverter, AND, OR 의 기본회로를 이해한다.2) 기본회로를 이용하여 NAND, NOR 회로를 구성하고, 논리회로의

  리포트 | 8페이지 | 1,500원 | 등록일 2017.04.02

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  논리게이트 실험 결과보고서

  이 회로와 등가인 게이트가무엇인지 알아본다.그림 3-85.실험보고서1)실험목적- NAND, NOR, NOT 게이트의 진리표를 결정한다.- 다른 기본 논리 게이트를 구성하는데 NAND ... ) 결과분석이번실험은 NAND와 NOR 게이트를 사용하여 다른 논리 게이트를 만드는 것이었다. ... 이들 게이트들은 TTL, CMOS등 논리군에서 기본 소자로 만들어지고 있다.종종 기본 게이트로 분류되어지는 게이트로 exclusive-OR(간략형 XOR)와 exclusive- NOR

  리포트 | 7페이지 | 1,000원 | 등록일 2016.06.30

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