"dct verilog" 검색결과 1-6 / 6건

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  Verilog를 이용한 IDCT 설계

  PurposeHardware description languages (HDLs) such as Verilog HDL are basic tools for describing digital ... using Verilog.3) Verify the operation of the designed hardware with a logic simulator (e.g., Modelsim ... IDCT는 DCT의 원리를 반대로 적용시킨 것이기 때문에 DCT에 중점을 맞추어 설명하도록 하겠다.

  리포트 | 6페이지 | 6,000원 | 등록일 2009.12.24

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  예비보고서-Exp9.Inverse DCT Hardware Module Design

  output이 state에 dependent 함을 나타내고 있으므로 무어머신 임을 알 수 있다.(3) Describe the operation of a counter using Verilog.Verilog를 ... PurposeHardware description languages (HDLs) such as Verilog HDL are basic tools for describing digital ... using Verilog.3) Verify the operation of the designed hardware with a logic simulator (e.g., Modelsim

  리포트 | 11페이지 | 2,000원 | 등록일 2010.10.09

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  카이스트 전자공학실험2 실험9 Inverse DCT Hardware Module Design 결과보고서

  Exp 9.Inverse DCT Hardware Module Design1. ... 레지스터에 저장하면 되기 때문에 레지스터 4개를 줄일 수 있게 되어, 출력 레지스터 포함 총 16개의 레지스터로 Transpose_Matrix를 만들 수 있다.② Reg와 Wire의 차이Verilog에서 ... FS - FT - DFT - DCT연속시간에서 fourier series부터 시작하자.

  리포트 | 14페이지 | 2,500원 | 등록일 2011.11.06

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  결과보고서-Exp9.Inverse DCT Hardware Module Design.hwp

  Exp9.Inverse DCT Hardware Module Design1. ... Source Codetest bench 포함해서 다음과 같이 총 5개의 verilog code file 이 있다.1. IDCT_1D.v2. IDCT_2D.v3. ... 단지 선을 연결하거나 and나 or등의 모듈로 나온 선을 잇는것만 가능할 뿐이다.verilog에서 사용되는 data type은 nets, register, 그리고 parameter가

  리포트 | 12페이지 | 2,000원 | 등록일 2010.10.09

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  FFT를 이용한 Fast DCT의 구현

  .- Input : cy[0...N-1], lx=N- Output : cy[0...N-1]○ Procedure Part(DCT)void DCT(int N, COMPLEX * cy){ ... }QueryPerformanceFrequency((LARGE_INTEGER*)(&freq));QueryPerformanceCounter((LARGE_INTEGER*)&start);DCT ... float)1000.0;fprintf(fp3, "%f\n", fgap);PrintFDCT(k, cx);FilePrint3(k, cx);fclose(fp3);return 0;}void DCT

  리포트 | 12페이지 | 3,000원 | 등록일 2008.12.03

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  FPGA를 이용한 IDCT의 co-emulation

  module IDCT_2D(clk,rst,start,in0,in1,in2,in3,idct_out0,idct_out1,idct_out2,idct_out3 ... it.i) IDCT_2D velilog HDL다음은 Synthesize 할 IDCT_2D (Inverse Discrete Cosine Transform, 2 dimension) verilog

  리포트 | 11페이지 | 7,000원 | 등록일 2009.12.24

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