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  • FF, SP CONVERSION
    실험목적 RS Flip-Flop과 Master-Slave RS Fliip-Flop을 설계해보고 시뮬레이션 해본다. 또한 F/F를 이용하여 8-bit serial-to-parallel register를 설계하고 ..
    공학/기술| 2010.03.26| 14페이지| 1,000원| 조회(195)
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  • DECODER
    Xilinx ISE Webpack의 기능 ▶ VHDL 코드 합성 Xilinx ISE는 유저가 코딩한 VHDL이나 Verilog 또는 SCH를 Netlist로 만드는 과정을 수행하도록 지원한다. ISE는..
    공학/기술| 2010.03.26| 9페이지| 1,000원| 조회(134)
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  • DECODER, ENCODER
    실험목적 BCD코드로 입력된 값을 7-segment로 표시할 수 있도록 디코딩 한다. 한 개의 7-segment표시창은 0부터 9까지 표시하며 네 개의 표시창을 합하면 0000에서부터 9999까지 표시할 수 있..
    공학/기술| 2010.03.26| 13페이지| 1,000원| 조회(159)
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  • COUNTER
    실험목적 비동기 reset이 가능한8 bit-up counter와 74LS193A counter를 설계해본다 Xilinx ISE Webpack의 기능 ▶ VHDL 코드 합성 Xilinx IS..
    공학/기술| 2010.03.26| 11페이지| 1,000원| 조회(261)
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  • BCD to EXCESS-3 CODE CONVERTER
    실험목적 BCD코드를 EXCESS-3코드로 변환시켜본다. 첫번째 과제에서는 BCD코드를 입력하면 설정된 EXCESS-3 코드가 출력되도록 하며 두번째 과제에서는 클럭값을 넣고 밀리형식을 따라 EXCESS..
    공학/기술| 2010.03.26| 10페이지| 1,000원| 조회(685)
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2024년 07월 19일 금요일
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