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FF, SP CONVERSION
실험목적 RS Flip-Flop과 Master-Slave RS Fliip-Flop을 설계해보고 시뮬레이션 해본다. 또한 F/F를 이용하여 8-bit serial-to-parallel register를 설계하고 ..
공학/기술
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2010.03.26
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14페이지
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1,000원
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조회(199)
VHDL
,
Flip Flop
,
ff
,
SPARTAN3E
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DECODER
Xilinx ISE Webpack의 기능 ▶ VHDL 코드 합성 Xilinx ISE는 유저가 코딩한 VHDL이나 Verilog 또는 SCH를 Netlist로 만드는 과정을 수행하도록 지원한다. ISE는..
공학/기술
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2010.03.26
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9페이지
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1,000원
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조회(135)
VHDL
,
결과
,
Decoder
,
SPARTAN3E
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DECODER, ENCODER
실험목적 BCD코드로 입력된 값을 7-segment로 표시할 수 있도록 디코딩 한다. 한 개의 7-segment표시창은 0부터 9까지 표시하며 네 개의 표시창을 합하면 0000에서부터 9999까지 표시할 수 있..
공학/기술
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2010.03.26
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13페이지
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1,000원
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조회(162)
VHDL
,
Encoder
,
Decoder
,
SPARTAN3
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COUNTER
실험목적 비동기 reset이 가능한8 bit-up counter와 74LS193A counter를 설계해본다 Xilinx ISE Webpack의 기능 ▶ VHDL 코드 합성 Xilinx IS..
공학/기술
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2010.03.26
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11페이지
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1,000원
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조회(263)
VHDL
,
counter
,
특징
,
SPARTAN3
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BCD to EXCESS-3 CODE CONVERTER
실험목적 BCD코드를 EXCESS-3코드로 변환시켜본다. 첫번째 과제에서는 BCD코드를 입력하면 설정된 EXCESS-3 코드가 출력되도록 하며 두번째 과제에서는 클럭값을 넣고 밀리형식을 따라 EXCESS..
공학/기술
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2010.03.26
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10페이지
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1,000원
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조회(686)
VHDL
,
converter
,
BCD
,
EXCESS3 CODE
,
SPARTAN ..
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ADDER COMPARATOR
평가
A+
최고예요
실험목적 8비트 가산기와 비교기를 4비트 adder, comparator를 사용하여 디자인 해본다. 가산기 즉 adder는 carry를 처리할 수 있도록 full adder로 디자인 한다. 또한 4비트 가산기와..
공학/기술
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2010.03.26
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21페이지
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1,000원
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조회(266)
가산기
,
VHDL
,
adder
,
비교기
,
Comparator
,
SPARTAN 3E
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전류계, 전압계, 파형발생기 사용법
1. Experiment& Result [Experiment 1] [1-1] 서로 다른 저항값과 허용오차를 갖는 10개의 저항에 대해 각각의 색 코드에 따른 저항값과 허용오차를 계산해보고, 멀티미터의 작동법을..
공학/기술
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2010.03.26
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7페이지
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1,000원
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조회(900)
전압계
,
사용법
,
전기회로
,
전류계
,
파형발생기
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전기회로 매틀랩 사용
아래의 회로에서 V =12 [V], R =1MΩ, C =1 μ F S 일 때, 0 ≤ t ≤ 2 sec 의 구간에서 v(t) 의 값을 구하시오. v(t = 0) = 2 [V]로 하시오 가) 미분 방정식 풀기 식을..
공학/기술
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2010.03.26
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3페이지
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1,000원
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조회(347)
회로
,
전기회로
,
매틀랩
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메쉬, 노드, 슈퍼포지션
1. Experiment Result [Experiment 1] Nodal analysis [1-1] 실험을 통해 측정한 전류와 이론치와 simulation 결과를 비교해 본다. 이론치(㎃) Pspice 결..
공학/기술
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2010.03.26
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7페이지
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1,000원
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조회(355)
전기회로
,
노드
,
매쉬
,
슈퍼포지션
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op amp
2. Discussion & Conclusion 2.1 실험간 애로사항 우선 실제 회로에서 접지가 어떻게 해야 이루어지는 것인지에 대해 잘 몰랐다. 이 점은 정말 후회가 되는 부분이다. 이번 실험에서는 각 실..
공학/기술
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2010.03.26
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5페이지
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1,000원
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조회(93)
OP
,
특성
,
op amp
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AI 챗봇
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AI 챗봇
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