"논리회로설계및실험" 검색결과 41-60 / 1,675건

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  [서울시립대] 전자전기컴퓨터설계실험2 / Lab05(예비) / 2021년도(대면) / A+

  실험의 목적Verilog HDL 언어를 사용하여 Combinational Logic을 설계 및 실험(Encoder/Decoder, Mux/Demux 등)하고, 설계한 로직을 시뮬레이션하기 ... 실험 이론(1) 조합 논리 회로- 논리 곱(AND), 논리 합(OR), 논리 부정(NOT)의 세가지 기본 회로를 조합하여 구성한 논리 회로- 출력이 입력에 의해 결정됨.- 논리 게이트로만 ... 진리표로부터 논리회로를 Karnaugh Map을 이용한 최적화 방법으로 설계하시오.- ,(3) 교안의 2:1 Mux의 진리표로부터 논리회로를 Karnaugh Map을 이용한 최적화

  리포트 | 13페이지 | 2,000원 | 등록일 2022.07.16

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  [A+] 중앙대학교 아날로그및디지털회로설계실습 7차 예비보고서

  아날로그 및 디지털 회로 설계 실습예비보고서설계실습 7. 논리함수와 게이트소속전자전기공학부학수번호실험 조x조조원 이름작성자실험날짜2023.11.02제출날짜2023.11.021. ... NAND 게이트 설계 및 특성 분석(A) VCC를 5V (논리값 1)에서 0V (논리값 0)로 단계적으로 변화시켜서 NAND 게이트가 동작하는 최소 정격 전압을 구하는 설계 방법을 ... XNOR 게이트 설계 및 특성 분석(A) AND, OR, NOT 게이트를 사용하여 NAND, NOR, XOR 게이트의 기능을 갖는 회로도를 그리고, XNOR (Exclusive NOR

  리포트 | 7페이지 | 1,000원 | 등록일 2024.02.17

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  충북대 기초회로실험 4-비트 산술논리회로 결과

  논리 연산회로를 그리고 시뮬레이션을 한 다음 심볼화 하라.(8) 실험 4와 실험 5 및 실험 7에서 설계된 심볼을 이용하여 의 4비트 산술논리회로를 그리고 시뮬레이션을 한 다음 심볼화 ... BXOR111xF =bar{B} 보수비고 및 고찰이번 실험에서는 Pspice를 이용하여 몇 가지 회로를 설계해 보고, 최종적으로 4-bit 산술논리회로를 설계하여 시뮬레이션을 해 보는 ... 실험 12. 4-비트 산술논리회로(결과보고서)실험 결과(1) Pspice를 이용하여 의 (a)와 같이 1비트 전가산기를 그리고 시뮬레이션을 한 다음 (b)와 같이 심볼화 하라.(2)

  리포트 | 5페이지 | 1,000원 | 등록일 2021.09.10

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  아날로그 및 디지털 회로 설계 실습 결과보고서7 논리함수와 게이트

  아날로그 및 디지털 회로 설계 실습-실습 7 논리함수와 게이트-설계실습 내용 및 분석설계한 논리게이트 구현 및 동작Low(0) 값, High(1) 값, Vcc를 각각 0V, 5V, ... 및 출력파형ABY001010100110XORXOR회로도 및 출력파형ABY000011101110NAND 게이트만 사용하여 AND, OR, NOT 게이트의 등가회로를 구성한다. ... -본 설계실습에서 무엇을 하였으며 그 결과는 어떤가? 수치를 포함하여 요약한다. 설계실습계획에서 설계한 회로와 실제 구현한 회로의 차이점을 비교하고 이에 대한 이유를 서술한다.

  리포트 | 24페이지 | 2,000원 | 등록일 2023.09.05 | 수정일 2023.10.24

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  디지털 회로 실험 및 설계 - Multiplexer, DeMultiplexer 실험, JK Flip Flop 순차회로 실험 1

  디지털회로실험및설계 예비 보고서 #4( Multiplexer, DeMultiplexer 실험 / JK Flip-Flop을 이용한 순차회로 실험 )과 목담당교수제 출 일학 번이 름1. ... PSpice 시뮬레이션 회로도 및 결과실험1) 4-to-1 MUX를 구성하고, S1과 S0의 입력신호에 따른 출력 Y를 작성하시오.?회로도? 시뮬레이션 결과? ... 실험목표① 멀티플렉서의 회로 구성과 동작을 실험한다.② 디멀티플렉서의 회로 구성과 동작을 실험한다.③ JK F.F를 이용하여 동기/비동기 카운터를 실험하고 이해한다.2.

  리포트 | 19페이지 | 3,000원 | 등록일 2023.09.22

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  [A+] 중앙대학교 아날로그및디지털회로설계실습 결과보고서 9. 4-bit Adder 회로 설계

  설계실습 내용 및 분석9-2-1 설계한 전가산기 회로의 구현 (2-level 로직 회로)설계실습계획서에서 그린 2-단계 전가산기 회로를 토글 스위치와 LED를 추가하여 설계 및 구현하여라 ... 요약 : 본 실습 9에서는 3가지 실험을 진행했다. ... 본 실습 9에서는 이러한 조합 논리 회로의 예로 두 개 이상의 수를 입력하여 이들의 합을 출력으로 나타내는 회로인 가산기 회로를 설계해보았다.

  리포트 | 7페이지 | 1,000원 | 등록일 2023.02.06 | 수정일 2023.02.10

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  아날로그 및 디지털회로설계실습 4-bit Adder

  아날로그 및 디지털회로 설계실습예비 REPORT9. 4-bit Adder 회로 설계분 반교 수 명실험 날짜제출 날짜조학 번이 름요약 : 조합논리회로의 설계 방법을 이해하고 조합논리회로의 ... 서론조합논리회로의 설계 방법을 이해하고 조합논리회로의 한 예로 가산기 회로를 설계한다.2. 실험결과9-3. ... 참고문헌- 아날로그 및 디지털회로 설계실습 교재

  리포트 | 4페이지 | 1,000원 | 등록일 2021.12.15

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  [A+] 중앙대학교 아날로그및디지털회로설계실습 9차 예비보고서

  아날로그 및 디지털 회로 설계 실습예비보고서설계실습 9. 4-bit Adder 회로 설계소속전자전기공학부학수번호실험 조x조조원 이름작성자실험날짜2023.11.16제출날짜2023.11.161 ... 실습 목적조합논리회로의 설계 방법을 이해하고 조합논리회로의 한 예로 가산기 회로를 설계한다.2. ... S의 2-level 회로 의 2-level 회로(D) XOR gate 를 이용하여 보다 간소화된 다단계 조합 논리 회로를 설계한다.

  리포트 | 8페이지 | 1,000원 | 등록일 2024.02.17

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  FPGA Board를 이용한 FSM회로의 구현 (up-counter) 예비레포트

  실험 장비 및 부품- Digilent Nexys4 FPGA Board- Vivado Design Suite 2014.44. ... 용도 및 기능을 파악하고 설계한 Digital IC를 검증하는 방법을 익힌다.3. ... 관련이론1) FPGAFPGA(Field-Programmable Gate Array)는 설계 가능 논리 소자와 프로그래밍이 가능한 내부 회로가 포함된 반도체 소자이다.

  리포트 | 5페이지 | 1,000원 | 등록일 2022.11.06

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  광운대학교 전기공학실험 실험7. 디코더와 인코더 결과레포트 [참고용]

  더해서 디코더와 인코더의 원리와 구성방법을 실험을 통해 이해하고 이를 응용 및 설계 하여 실용적 목적 회로 구성에 대한 연습을 진행한다.3. ... 고찰본 실험을 통해 디지털논리회로 설계의 과정 중 NAND, NOR게이트로의 변환을 통해 공학적으로 더 나은 회로를 구성하도록하는 방법을 알 수 있다. ... 수 있음을 실험적으로 확인할 수 있으며, E1, E2, E3등에는 순서 맞는 일종의 convention이 있어 이에 주의하여 회로를 연결 및 구성해야한다.

  리포트 | 6페이지 | 1,500원 | 등록일 2024.01.02

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  디지털 회로 실험 및 설계 - Multiplexer, DeMultiplexer 실험, JK Flip Flop 순차회로 실험 2

  디지털회로실험및설계 결과 보고서 #4( Multiplexer, DeMultiplexer 실험 / JK F.F을 이용한 순차회로 실험 )과 목담당교수제 출 일학 번이 름? ... 결과분석- 이 회로는 시간이 없어서 실패했는데, 이론을 바탕으로 결과 예측 및 분석을 해보자면, 위 회로는 JK F.F을 활용한 비동기 카운터로서, 클럭에 NOT게이트가 있어 상향 ... 결과분석- 여러 출력 단자 중에서 하나로 데이터를 내보내는 조합 논리회로인 DeMUX를 잘 활용한 실험 결과였다.- 이론값대로 결과 잘 나왔고, 전압 레벨 또한 High는 4.45V

  리포트 | 15페이지 | 3,000원 | 등록일 2023.09.22 | 수정일 2023.09.24

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  디지털 시스템 설계 및 실습 업다운 카운터 설계 verilog

  실습목적동기식 카운터는 순차논리회로에서 예제로 가장 많이 사용된다. ... 그리고 각 상태에서 0에서 9까지의 수를 각각 출력하도록 설계한다. 이 실습을 통해서는 상태 천이를 위한 여러 가지 조건을 순차회로에 적용하는 방법에 대해 알아본다.2. ... 일상생활에서는 10진수를 주로 사용하므로, 이 실습에서는 10진수를 2진수로 표현하는 BCD 카운터를 설계한다.

  리포트 | 4페이지 | 1,000원 | 등록일 2021.03.24

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  인코더와 디코더 회로 예비 보고서(고찰포함)A+

  실험 목적인 부호변환 회로의 설계방법과 7 -segment 의 사용법을 익히는 것도 인지하고 실험에 임해야겠다. PAGE \* MERGEFORMAT 2 ... 예비 보고서인코더와 디코더 회로실험 목적Encoder와 Decorder의 기능을 익힌다.부호변환 회로의 설계방법을 익힌다.Seven-segment(숫자표시기)의 사용방법을 익힌다.이론상태 ... 실험을 하면 확실이 디코더와 인코더의 개념과 기능이 숙지 및 숙달이 될꺼 라고 생각하였다. 7 -세그먼트 표시기는 개념이 부족하여 예비보고서를 작성하면서 이론을 보면 숙지하였고.

  리포트 | 5페이지 | 2,000원 | 등록일 2024.04.19 | 수정일 2024.04.21

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  실험6. 산술논리연산회로 예비보고서

  실험방법 및 순서5.1 해당 실험의 기초 이론을 참고하여 [그림 6-2]의 산술연산회로를 결선하라. ... ▣ 실험6. 산술논리연산회로1. ... 실험 목적본 실험을 통해■ 산술논리연산회로에 대해 알아본다.■ 산술논리연산회로를 구현하여 산술연산회로 동작을 확인해본다.■ 산술논리연산회로를 구현하여 논리연산회로 동작을 확인해본다.2

  리포트 | 5페이지 | 1,500원 | 등록일 2022.05.26

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  [A+] 디지털공학실험 JK 플립 플롭

  타이머를 이용한 비안정 멀티바이브레이터 설계 및 실험Ⅱ. ... 생성, 듀티 사이클 및 주파수 측정, 그리고 비안정 멀티바이브레이터 설계 및 실험을 할 수 있었다 ... (회로 시험 관찰)17-3 회로 설계한다.17-1의 JK 플립플롭 진리표를 이용하여 회로의 동작을 예견한다.17-3회로를 관찰한 내용을 보고서에 작성한다.실험순서4 (리플 카운터)

  리포트 | 7페이지 | 2,000원 | 등록일 2023.11.08

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  논리 게이트, 부울의 법칙 및 드모르간의 정리 예비레포트

  논리 게이트, 부울의 법칙 및 드모르간의 정리예비레포트1. 실험 제목1) 논리 게이트 – 12) 논리 게이트 – 23) 부울의 법칙 및 드모르간의 정리2. ... /IEEE 표준 91-1984 논리 기호의 사용2) 논리 게이트 – 2(1) 실험을 통한 OR 및 XOR의 진리표 작성(2) 펄스 파형을 이용한 OR 및 XOR 논리 게이트의 테스트 ... (1) 실험을 통한 부울 대수의 규칙 증명(2) 부울 규칙 10과 11을 증명하는 회로 설계(3) 실험을 통해 3-입력 변수의 회로들에 대한 진리표를 작성하고 드모르간의 정리를 이용하여

  리포트 | 11페이지 | 1,500원 | 등록일 2022.08.26 | 수정일 2022.08.29

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  A+ 중앙대 아날로그및디지털회로설계실습(결과)7. 논리함수와 게이트

  설계실습 내용 및 분석7-4-1 설계한 논리게이트 구현 및 동작(A) Low(0) 값, High(1) 값, Vcc를 각각 0V, 5V, 5V로 설정한다. ... 중앙대학교 전자전기공학부, “아날로그 및 디지털 회로 설계 실습”, pp 55-60 ... 논리함수와 게이트(학생이름, 학번, 학수번호, 실험조의 번호, 실험조원의 이름, 실험날짜, 제출날짜)요약 : 전자전기장비에 많이 사용되는 bandpass filter를 R,L,C를

  리포트 | 5페이지 | 1,000원 | 등록일 2022.09.10

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  전기및디지털회로실험 실험8 예비보고서

  전기및디지털회로실험예비레포트담당교수 :학과 :학번 :이름 :목차실험 명실험 개요이론 조사실험 기기예비보고서 문제풀이실험 순서실험명실험 8. 숫자표시기와 응용2. ... 나머지 세 보조입력단자의 상태를 바꾸어가면서 회로의 동작이 어떻게 영향을 받는지 확인하고 이것이 보조입력단자의 기능설명과 부합하는지 관찰하라.(5) 예비보고서 1항에서 설계한 회로를 ... 구성하고 그 동작을 확인하라.(6) 예비보고서 2항에서 설계한 회로를 구성하고 그 동작을 확인하라.PAGE \* MERGEFORMAT2

  리포트 | 6페이지 | 1,000원 | 등록일 2023.06.30

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  [서울시립대] 전자전기컴퓨터설계실험2 / Lab05(결과) / 2021년도(대면) / A+

  실험의 목적Verilog HDL 언어를 사용하여 Combinational Logic을 설계 및 실험(Encoder/Decoder, Mux/Demux 등)하고, 설계한 로직을 시뮬레이션하기 ... 실험 이론(1) 조합 논리 회로- 논리 곱(AND), 논리 합(OR), 논리 부정(NOT)의 세가지 기본 회로를 조합하여 구성한 논리 회로- 출력이 입력에 의해 결정됨.- 논리 게이트로만 ... 설계하시오.a. if문 사용Source codePinPin testbench 시뮬레이션 결과 설계한 논리회로의 동작을 확인하는 모습- 실험 결과: 입력은 A(Button SW1),

  리포트 | 19페이지 | 2,000원 | 등록일 2022.07.16

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  디지털 시스템 설계 및 실습 패리티검사기 설계 verilog

  1. 실습목적패리티 비트는 데이터 전송 도중 오류가 발생했는지 검사하는 데 사용된다. 수신측에서는 송신 측에서 전송한 데이터에 대해 데이터에 포함된 ‘1’의 개수를 카운트하여 오류가 발생했는지 판단한다. 이 실습에서는 데이터 오류를 검사하는 데 사용되는 패리티 비트에 ..

  리포트 | 3페이지 | 1,500원 | 등록일 2020.11.02

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