"7476" 검색결과 161-180 / 351건

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  [논리회로실험]실험5결과보고서 래치와 플립플롭

  또 이 결과를 7476 칩에 대한 측정 결과와 비교하라.JKQ(t)Q(t)’00Q(t-1)Q(t-1)’0101101011Q(t-1)’Q(t-1)[ J-K F/F 구성 회로 실험 ]( ... Q 출력 값 )( J = 1, K = 0 ) ( J = 0, K = 1 )[ 7476 칩을 이용한 실험 ]( J = 1, K = 0 ) ( J = 0, K = 1 )이번 실험은 J-K ... 1,0) 일때에는 R-S F/F과 같은 값을 가지고 기능도 같았으며 (J,K) = (1,1)값을 가질 때 결과 데이터와 마찬가지로 앞의 ‘1’값과 보수값인 ‘0’값이 출력 되었다. 7476

  리포트 | 7페이지 | 1,000원 | 등록일 2010.04.12

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  비동기식 카운터 (Asynchronous Counters)

  혹시나 7476 J-K 플립플롭에 문제가 있는 것은 아닐까하여 논리 소자도 바꿔보고 이와 같이 파형이 잘 나오지 않는 것이 각 소자가 갖고 있는 내부 저항에 의해서도 영향을 받는다고

  리포트 | 3페이지 | 2,000원 | 등록일 2010.11.12

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  [토끼] Flip-Flop (플립플롭), JK 플립플롭, D플립플롭, T플립플롭의 설계 및 검증

  JK 플립플롭도 7476과 게이트를 이용한 시뮬레이션 두 개를 시험해 보았는데 7476은 CLR 신호를 입력하여 칩을 Reset 하여야하므로 D플립플롭과 마찬가지로 시간차이가 났다. ... 그리고 게이트를 이용하여 한번더 파형을 뽑아 보았으며 이는 7476을 사용할 때와 같이 거의 일치 하였습니다.

  리포트 | 48페이지 | 5,000원 | 등록일 2011.04.11 | 수정일 2014.06.08

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  디지털실험 15예비 up/down counter

  지연시간 차이에 따른 오차로 보인다.실험 준비물7400, 7404, 7472, 7476, 74169, 전원공급기, 오실로스코프, 함수발생기.실험 방법1.회로를 구성하고 dcba=1111로

  리포트 | 8페이지 | 1,000원 | 등록일 2014.09.30

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  아주대 논리회로실험 결과5-래치와 플립플롭

  또 이결과를 7476 칩에 대한 측정 결과와 비교하라.< J-K F/F 회로도> < 74HC76 칩 구조 >? ... 실험 결과 Truth table (7476)※ 동작 원리J-K F/F은 R-S F/F를 보완한 회로로 R-S F/F은 입력이 SR = 11일 때 출력이 될 수 없지만 J-K F/F일 ... 또한 7476은 J-K F/F를 두 개 종속시킨 IC 칩으로 이용하여 구성한 회로는 위 실험과 동일한 결과를 나타낸다.(4) 예비과제 (3)에서 구한 T F/F을 구성한 후 출력을

  리포트 | 4페이지 | 1,000원 | 등록일 2010.04.04

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  CPU 설계 과제 (컴퓨터 구조 A+받은 자료)

  제어 논리 게이트들⑦ AC의 입력에 연결된 가산 논리 회로메모리장치는 KM62256A를 사용하였고, 레지스터는 74LS163을 사용한다.플립플롭은 D-FF는 7474 JK-FF는 7476을

  리포트 | 17페이지 | 4,000원 | 등록일 2015.01.27

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  디지털 시계

  2개(JK F/F4개)를 구성하여 일의 자리수 구성● 7476 2개(JK F/F3개)를 구성하여 십의 자리수를 표현● 7408(2-input AND gate)를 이용하여 60진법에 ... 구성한다● 전체 JK F/F에 동일한 클럭을 주어 동기식카운터로 구현하되 다른 F/F의 출력값을 이용하여 시간표현에 알맞은 변화조건이 되도록 시계회로를 구성한다① 초의 자리 구성● 7476

  리포트 | 6페이지 | 1,000원 | 등록일 2009.09.16

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  실험예비45_디지털 IC 플립 - 플롭

  실험 장비 및 재료전원공급+ 5V장비구형파발생기, 오실로스코프, 디지털 멀티미터IC7402, 7474, 7476 각 1개저항1000Ω 2개, 10,000Ω 4개 1/2W기타SPST ... 그림 45-16과 같이 연결한다. 7476의 5번 핀은 +5V, 13번 핀은 접지로 연결한다.J와 K를 낮은 값으로 하고, CLK 입력에 구형파발생기를 연결하여 3번 과정과 같이설정한다

  리포트 | 5페이지 | 1,000원 | 등록일 2010.06.14

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  [실험결과보고서]D 래치 및 D 플립플롭 JK 플립플롭

  플립-플롭실험 목표- 동기 및 비동기 입려방식을 포함한 J-K플립-플롭의 다양한 구성에 대한 시험- 토글모드에서 주파수 분할 특성 관찰- J-K플립플롭의 전달 지연 특성 측정사용부품7476

  리포트 | 5페이지 | 1,000원 | 등록일 2012.02.04

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  비동기 및 동기 입력을 포함한 J-K 플립플롭의 여러 구성에 대한 레포트

  J-K 플립플롭은 에지-트리거 또는 펄스-트리거 소자로 사용이 가능하다. 7476은 2조 펄스0트리거 소자이며, 74LS76A는 클럭이 HIGH에서 LOW로 변환 시의 에지-트리거

  리포트 | 10페이지 | 3,000원 | 등록일 2015.06.03

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  결과보고서 실험 6. 시프트레지스터와 카운터 (Shift Register & Counter)

  J-K F/F을 이용하여 예비과제에서 구한 4단 2진 count-up 리플 카운터를 구성하고 각 단의 출력 Q에서의 파형을 측정하라.7476 J-K F/F을 이용한 4단 2진 Count-Up ... 완성하라.ShiftPulseL0L1L2L3L40LDDDD1DLDDD2DDLDD3DDDLD4DDDDL5LDDDD6DLDDD7DDLDD5-bit shift-right circulating shift register4) 카운터(1) 7476

  리포트 | 5페이지 | 3,000원 | 등록일 2012.03.11

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  Shift Register와 Ring Cuounter

  - 각 1개(7476 3개)3. ... 1대▶ SWG (+5 V, 1 ～ 10 ㎑ 또는 50 ㎲의 단일펄스)- 1대▶ 스위치 판- 1대▶ 저항 680Ω- 5개▶ LED : 적색- 5개▶ IC : 7400, 7496, 7476

  리포트 | 4페이지 | 1,000원 | 등록일 2010.05.23

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  계산기 설계도 및 이론

  HALT / Halt◎타이밍 흐름◎◎전체 Data Flow◎◎사용소자◎레지스터 : 74194MUX : 74157가산기 : 74283JK/FF : 7476D/FF : 7474FND 디코더 ... SEL 단자에 연결해 주었다.결국 T2의 타이밍에서는 SA의 값을 출력으로 내보내고 나머지 타이밍에서는 ALU의 값을 출력으로 내보낸다.5) Carry OutJK플립플롭 소자인 7476을 ... 7449의 입력단에 물려주고 각각의 값에 맞는 숫자가 FND를 통해 디스플레이되도록 만들어주었다.7) 타이밍 생성부분계산기에 쓰이는 타이밍 신호를 생성하는 회로이다JK 플립플롭인 7476소자와

  리포트 | 7페이지 | 2,500원 | 등록일 2009.10.31

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  [기초 회로] 기본 게이트와 카운터

  준비물 : 7400, 7402, 7404, 7408, 7432, 7474, 7475, 7476, 7486, 파형 발생기, 오실로스코프, dc전원장치.*.

  리포트 | 4페이지 | 1,000원 | 등록일 2004.08.18

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  [일반화학실험]결정의 구조

  양이온과 음이온의 반지름비가 0.414～0.732의 값을 가질 때 안정한 구조로 결정의 안정화 정도를 나타내는 마델룽(Madelung constant) 상수의 값은 1.7476이다.

  리포트 | 6페이지 | 2,500원 | 등록일 2014.10.19 | 수정일 2020.07.27

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  기초전자회로실험 예비레포트 플립플롭 flip-flop

  D Flip-Flop를 사용한 병렬 데이터 저장 회로InputOutputClk,,,이론값측정값이론값측정값이론값측정값이론값측정값↑00000↑11111(4)J-K Flip-Flop(7476 ... 설계하고 출력값을 oscilloscope를 사용하여 측정하여라.INPUTOUTPUTCLKQ1Q2예측값실측값예측값실측값1회002회103회014회11(6) J-K Flip-Flop(7476

  리포트 | 8페이지 | 1,000원 | 등록일 2009.09.18

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  간세포암

  손상에도 출혈의 위험이 큼- 혈액에 관련된 것, 혈액응고인자 출혈 등을 보기 위하여PCT0.15~0.42%0.1840.2000.195PDW17.217.418.8DiffSeg43~75%7476

  리포트 | 18페이지 | 2,000원 | 등록일 2015.05.19 | 수정일 2015.05.20

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  디지털실험 13예비 비동기 계수기

  같다.clkdcba10000200013001040011501006010170110801119100010100111101012101113110014110115`11101500001110이 출력되면 anad가 동작 ,클리어 시킨다.실험 준비물7400, 7476

  리포트 | 10페이지 | 1,000원 | 등록일 2014.09.30 | 수정일 2014.11.11

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  [디지털 결과]플립 플롭 (Flip Flop)

  실험결과(1) JK-F/F 회로순번CJKQ10000.00121000.17730010.00141010.17650100.00161100.30170110.02681110.276(2) TTL 7476

  리포트 | 3페이지 | 2,000원 | 등록일 2010.11.12

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  2진수와 2진카운터

  ◎2진수와 2진 카운터5V272SWG10KHzPRJ Q7476▷CLFF1K QCLRPRJ Q7476▷CLFF2K QCLRPRJ Q7476▷CLFF3K QCLR************* ... 또한 JK F/Fs 는 J와 K가 모두 1일 때는 입력 값을 보수가 출력 되는 특성을 가지고 있다.또한 7476 내부의 특성을 이용하여 CLR 값을 넣어 주었을 때와 넣지 않을 때 ... 그에 대한 출력을 비교 하여 결과를 도출하였다.먼저 CLR pin에 연결된 Switch 를 OFF 시켰을 때는7476 내부 값이 클리어 되지 않아 Q=1 이 출력 되었고 Switch를

  리포트 | 3페이지 | 1,000원 | 등록일 2008.01.24

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