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"시계설계" 검색결과 1-20 / 6,942건

  • 시계설계
    시계설계시계설계의 특성은 시간의 흐름에 따른 복수의 관찰이라는 것이다. ... 두 번째 시계설계는 바로 그것이며, 비동등 종속변인을 가진 틈입 시계설계라고 불린다. ... 이 외 이 설계는 단순 틈입 시계설계와 동일하다.
    리포트 | 5페이지 | 3,700원 | 등록일 2021.04.07
  • 시계설계
    시계설계시계설계는 개입 전 여러 번 측정하고, 개입 후 여러 번 측정함으로써 이전에 언급된 설계들의 (몇몇) 문제점들을 극복할 수 있는 방법이다.예를 들어, 피임에 대한 청소년들의 ... [그림] 시계설계(1) 내적 타당성에 대한 위협 요소사건은 시계설계에서 내적 타당성을 위협하는 주요 요인이 된다. ... , 어느 한 시점이나 비교적 짧은 기간 동안 현상의 단면을 분석하는 연구를 횡단적 설계라고 한다.시계설계의 장점은 개입 전과 개입 후 자료의 경향을 탐지할 수 있다는 점이다.
    리포트 | 2페이지 | 1,000원 | 등록일 2020.07.15
  • 유사실험 조사설계(시계설계, 비동일 통제집단설계)
    시계설계의 구성을 보여주는 것이다.[그림] 시계설계설계에 있어서의 인과관계의 추정논리는 다음과 같다. ... 시계설계시계설계(time-series design)는 비교집단을 설정하기 곤란한 경우에 한 집단을 선택해서 독립변수의 조작이나 독립변수에의 노출 전에 몇 번 이상씩(보통3번 이상 ... 유사실험 조사설계(시계설계, 비동일 통제집단설계)유사실험설계(quasi-experimental designs)는 실험결과의 측정시기 및 측정대상의 통제만 가능하고 실험변수의 노출시기
    리포트 | 3페이지 | 2,000원 | 등록일 2020.07.23
  • 디지털 알람 시계 회로도 설계 및 제작
    디지털 알람 시계 회로도 설계 및 제작Contents Conclusion 작동 원리 주요 소요 부품회로도 및 회로 설명 TIME TABLE 1. ... 최종 설계 목표 ( SPEC ) 시 , 분 , 초의 카운터 기능 알람 기능 AM( 오전 )/PM( 오후 ) 표시 기능 Reset ( 작동하고 있는 시계를 Reset 시키는 것 ) Time ... TABLE 최종 설계 목표 ( SPEC ) 업무분담 작품시현 보드구현 보드구현회로도 및 회로 설명 TIME TABLE 최종 설계 목표 ( SPEC ) 업무분담 작품시현 패턴도 패턴도작품
    리포트 | 16페이지 | 2,000원 | 등록일 2020.02.14
  • 디지털 시계 설계 설계보고서(충북대 및 타 대학교)
    목적1) 디지털 시계 설계2) 학습한 내용을 토대로 디지털 응용회로를 설계, 구현하고 실험을 통해 동작 확인3) 팀 단위의 프로젝트 진행으로 팀원간 역할분담, 팀워크 훈련4) 기판상에 ... 그러나 시계를 구성하는 각 카운터가 1이 증가하는 시점이 다르기 때문에 각 카운터마다 enable 기능을 갖는 카운터를 설계해야 한다.⑤ enable 기능이 있는 카운터 설계대부분 ... 기초회로실험 Ⅱ디지털 시계1.
    리포트 | 18페이지 | 2,500원 | 등록일 2020.11.19 | 수정일 2020.12.04
  • term project - ALUs (Arithmetic logic units)를 이용한 다기능 디지털 시계 설계
    름학 과전자공학과ALUs (Arithmetic logic units)를 이용한 다기능 디지털 시계 설계0. ... 설계 목표는 단순한 시계 구현만이 아니라, 타이머와 스탑워치의 기능까지 구현하는 것이 중요했다. ... 요약 (Abstract)이번 학기 프로젝트의 주제는 ALUs (Arithmetic logic units)를 이용한 다기능 디지털 시계 설계이다.
    리포트 | 14페이지 | 1,000원 | 등록일 2023.06.22 | 수정일 2023.06.25
  • [마이크로프로세서설계실험] 팀프로젝트 시계 회로를 구현 결과보고서
    마이크로 프로세서 설계 실험Term project 결과 보고서1. ... 목적Pic16f876a와 다른 output 소자들을 이용하여 시계 회로를 구현하고 어셈블리어를 사용하여 시계 및 다른 기능들의 프로그램을 코딩합니다.2. ... 시스템 동작 내용h/wHw/기능시계시간 설정S1시간,분 표시/초시계 모드 변경숫자 1증가S2시간 설정 모드 on자리 바꿈S3X시간 설정 mode탈출Buzzer정시마다 반복 울림XFnd시간
    리포트 | 20페이지 | 1,500원 | 등록일 2019.11.17
  • [디지털공학개론] 디지털 시계의 회로도 설계와기본형 레지스터 및 IC의 종류
    발진 회로디지털 시계의 회로도 설계에 있어서 발진회로는 일정한 클록을 제공하기 위해서 요구된다. 이를 세팅하기 위해서는 다음의 세 방법이 있다. ... 분주 회로디지털 시계의 기본 단위로 약속된 시간 규격인 초 를 나타내기 위해서는 ‘ ’ 1Hz 주파수가 필요하다 분주회로는 정현파에서 구형파를 얻을 수 있도록 . 60Hz 1Hz 도와주는
    리포트 | 6페이지 | 2,000원 | 등록일 2020.04.05
  • 전전설2 파이널 프로젝트 디지털시계 (전자전기컴퓨터설계2 실험 파이널 프로젝트)
    디지털 시계 코드`timescale 1ns / 1ps////////////////////////////////////////////////////////////////////////
    리포트 | 73페이지 | 5,000원 | 등록일 2019.11.09
  • 실험4 예비 5_마이크로프로세서 실험 및 설계 실습8. 타이머를 이용한 디지털 시계
    마이크로프로세서 실험 및 설계예비보고서실습8. 타이머를 이용한 디지털 시계#include //확장자가 .h로 끝나는 avr/io라는 헤더파일을 포함하라는 의미의 선언.
    리포트 | 5페이지 | 2,000원 | 등록일 2020.01.02 | 수정일 2020.11.12
  • [전자전기컴퓨터설계실험2] Verilog를 이용한 디지털 시계 (알람, 스탑워치, LED 기능 포함)
    //Digital_Clock.vmodule Digital_Clock(RESETN, CLK, LCD_E, LCD_RS, LCD_RW, LCD_DATA, PIEZO, BUS, BUT, LED);input RESETN, CLK;input [7:0] BUS; // BUS_SW..
    리포트 | 81페이지 | 5,000원 | 등록일 2020.09.07
  • 일반국도 30번째 설계시간계수의 시계열적인 특성 분석에 관한 연구
    한국도로학회 오주삼, 임성만
    논문 | 9페이지 | 4,000원 | 등록일 2016.04.02 | 수정일 2023.04.05
  • 팀 프로젝트 디지털시계 설계 및 구현
    카운터를 이용해 설계할 수 있는대표적인 순차회로의 하나이다.가장 먼저 시간을 계산하기 위해서 시계의 가장 기본적인 단위인 1초를 회로에서 얻을 수 있어야 하는데, 우리는 10진 카운터를 ... 카운터 구현현재상태다음상태S2S1S0S2S1S*************010011011100100101101000110xxx111xxx< 상태도 > < 진리표 >< 카르노 맵 >실제 설계한 ... 디지털시계에는 7세그먼트를 여러개 사용하는데 각 세그먼트마다 저항을 일곱개씩 달아줘야해서 조금 번거로웠다.
    리포트 | 11페이지 | 2,500원 | 등록일 2017.10.21 | 수정일 2017.12.27
  • 전지전자기초실험 디지털 시계 설계 실습 설계프로젝트 레포트
    전기전자 기초실험 결과보고서제12장 설계 프로젝트 I- 디지털 시계 설계 실습 -학과학년학번분반실험조성명전기전자공학2# 기본 개념아무 입력도 들어오지 않으면 일반 시계 모드에 있으며 ... , 시간의 흐름(clk의 증가)에 따라 시계가 표시된다. reset 버튼을 누르면 A12:00:00으로 초기화 되고, 시간, 분 조절 버튼을 누를 때마다 각각 1씩 증가한다. ... 초 조절 버튼은 초를 00으로 초기화한다.# verilog code실제로 디지털 시계를 구현할 때에는 조금 더 많은 측면을 고려해야 한다.clk가 1,000,000번 진동할 때마다
    리포트 | 6페이지 | 1,500원 | 등록일 2017.12.01
  • VHDL을 이용한 디지털 시계 설계
    introduction 이번 실습은 VHDL을 이용한 디지털 시계 설계로 분주회로를 설계하는 방법을 학습한 후, Training Kit를 통해 7-segment와 LCD로 검증하였다 ... 시계를 1초에 숫자 1씩 바꾸기 위해 필요한 변수이다. ◎ Output DIGIT : 시계를 표시할 때 사용될 segment를 지정해주는 변수이다. ... does 디지털 시계 ● 시, 분 및 초를 표시하는 디지털 시계 ■ 초 ● 입력 클럭을 분주하여 1초 단위로 상승 ● 59초에서 60초로 넘어 갈 때 1분 카운트를 발생, 초는 00으로
    리포트 | 20페이지 | 3,000원 | 등록일 2014.11.04 | 수정일 2022.11.04
  • 전자회로실험설계 최종설계보고서 다기능 시계 설계
    적절한 분주비와 TCNT 를 통한 타이머 인터럽트를 설정했음에도 불구하고 타이머에 의한 시간진행이 실제시간 1 초보다 느리게 구동되는 현상이 관찰되었다. 이는 가상머신과 시뮬레이션 프로그렘 자체의 성능저하로 인한 현상으로 보인다. 실제로 7 세그먼트의 구동에 있어서, ..
    리포트 | 10페이지 | 2,000원 | 등록일 2017.01.11 | 수정일 2022.02.04
  • 시계설계
    디지털 공학(디지털시계 설계)전자시스템공학과목차1.연구의 목적 및 필요성2.연구의 목표3.연구의 내용 및 범위1. 전체 회로도.2. 회로도 분석.3. 분주 회로도.4. ... 전자시계를 직접 제작하면서 지금까지 배운 강의 내용을 확인하고 회로도의 이해와 칩에 관한 분석 능력을 키운다.2. ... 따라서 오직 세그먼트 b만이 빛을 발한다.4.연구진 편성표(항목별)권동호-전체회로도, 초회로도, 분회로도, 시회로도, 오전오후회로도설계최윤석-각각의 부품의 역할을 조사 및 설계.TTL
    리포트 | 16페이지 | 2,000원 | 등록일 2009.06.24
  • VHDL 시계 설계
    ♣ 2버튼 디지털 시계 설계▶작동 방법 : 앞에서 했던 디지털 시계설계는 3개의 버튼으로 초, 분, 시를 설정할수 있었지만 이번에 설계하는 디지털 시계는 2버튼으로 설계를 해보았습니다 ... ⇒ 앞에서 제출했던 추가 레포트와 마찬가지로 2버튼 시계와 3버튼 시계는 12진 카운터를 똑같이 설계를 했습니다. ... 또한 2버튼 디지털 시계시 3버튼 디지털 시계와 차이점은 2버튼 제어기만 있으면 추가하면 되는 설계를 보였습니다.★ 2버튼 키 제어기(Key_1, Key_2)※ 2버튼 키 제어기(Key
    리포트 | 17페이지 | 25,000원 | 등록일 2011.04.07
  • 디지털 알람시계 설계 보고서 - 디지털회로설계및언어
    디지털 알람시계 설계 보고서1. 주제 : Digital Alarm Clock2. 기능1. 설계주제- 알람기능을 하는 시계 구현.2. ... 설계과정1) Controller & Data path2) AlgorithmMode1Mode2Mode3Normal OperationMin, Hour, Date, Month Display12월 ... = 0) begin Alarm_CNT = Alarm_CNT - 3'b001; set_PTR = 1; endelse beginclear_PTR = 1; end(5) 일반 시계 작동if
    리포트 | 15페이지 | 3,500원 | 등록일 2017.11.16
  • 리눅스를 이용한 시계설계. 프로세스설계
    설계 결과 보고서-디지털 시계구현-Contents-설계목표&기준설정-배경이론-소스-결과-목표 : 리눅스의 디바이스들을 이용해 디지털 시계를 구현한다.
    리포트 | 12페이지 | 5,000원 | 등록일 2013.03.12
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2024년 09월 03일 화요일
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- 작별인사 독후감
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- 국내의 사물인터넷 상용화 사례를 찾아보고, 앞으로 기업에 사물인터넷이 어떤 영향을 미칠지 기술하시오
5글자 이하 주제 부적절한 예)
- 정형외과, 아동학대