"논리설계실험" 검색결과 61-80 / 7,337건

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  홍익대학교 디지털논리실험및설계 10주차 예비보고서 A+

  1.1 비동기식 카운터와 동기식 카운터의 작동원리와 차이점에 대하여 서술하 시오.기본적으로 특정한 state이 반복적으로 어떤 주기를 가지고 발생하면 카운터의 기능을 수행 할 수 있습니다. 비동기식 카운터와 동기식 카운터의 경우 특정한 state이 반복적으로 발생 하는..

  리포트 | 6페이지 | 1,500원 | 등록일 2023.03.21 | 수정일 2023.04.03

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  홍익대학교 디지털논리실험및설계 2주차 예비보고서 A+

  1.1 NAND 게이트 7400, NOR 게이트 7402, XOR 게이트 7486의 datasheet를 확인하시오.우선 IC 칩들을 동작하게 하기 위해서 각각의 칩들에 Vcc와 GND를 몇 번 pin에 연결해야 하는지 확인해야 하고, 사용할 게이트 각각에 대해서..

  리포트 | 5페이지 | 1,500원 | 등록일 2023.03.21 | 수정일 2023.04.03

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  (A+/이론/예상결과/고찰) 아주대 논리회로실험 설계계획서

  전문분야에서 발전하도록 도우며, 이 윤리 헌장을 준수하도록 지원한다.위 IEEE 윤리헌장 정신에 입각하여 report를 작성하였음을 서약합니다.학 부: 전자공학부제출일:과목명: 논리회로실험교수명 ... :조교명:분 반:학 번:성 명:전자공학부FPGA를 이용한 Up-Down Counter, Timer 설계1) 설계목표1-1. ... 카운터에 반전 기능(남은 수만큼 거꾸로 새는)을 추가하여 설계한다.2-2. 5분 타이머에 반전 기능(남은 시간만큼 거꾸로 새는)을 추가하여 설계한다.3.

  리포트 | 3페이지 | 1,500원 | 등록일 2021.10.24

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  홍익대학교 디지털논리실험및설계 3주차 예비보고서 A+

  기본 실험 (1) 회로의 경우 (00, 01, 10, 11)에 대한 디코딩 게이트는 각각 (Y0, Y1, Y2, Y3)이고, 어떤 input 이냐에 따라서 특정 디코딩 게이트의 출력만 ... 1이 되고 나머지는 0인 Active HIGH로 회로가 설계되었기 때문에 디코딩 게이트의 출력을 LED를 통해 확인함으로써 어떤 input이 2-bit 복호기로 들어왔는지 확인할

  리포트 | 5페이지 | 1,500원 | 등록일 2023.03.21 | 수정일 2023.04.03

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  홍익대학교 디지털논리실험및설계 1주차 예비보고서 A+

  실험 준비1.1 AND 게이트 7408의 datasheet를 읽는 법을 간단하게 서술하고 기본 실험 (1)의 회로를 어떻게 결선하여야 하는지 pin 번호를 이용하여 설명하시오.우선

  리포트 | 5페이지 | 1,500원 | 등록일 2023.03.21 | 수정일 2023.03.24

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  홍익대학교 디지털논리실험및설계 5주차 예비보고서 A+

  따라서 [그림 2]의 회로는 전가산기로 동작하게 됩니다.1.2 응용 실험 (1), (2)의 회로를 구현하시오.응용 실험 (1)응용 실험 (2) Σ3, Σ2, Σ1의 결과는 LED를 ... 1.1 4.1 기본 실험 (2)의 전가산기 [그림 2]는 반가산기 [그림 1] 두 개와 하 나의 OR 게이트로 이루어져 있다.

  리포트 | 5페이지 | 1,500원 | 등록일 2023.03.21 | 수정일 2023.04.03

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  홍익대학교 디지털논리실험및설계 9주차 예비보고서 A+

  1.1 8-bit Serial-in Parallel-out Shift Register 74164의 datasheet를 확인하고 (MR)’의 역할에 대하여 설명하시오. 왜 입력이 A와 B로 나누어져 있는지 설명하시오.우선 8-bit Serial-in Parallel-ou..

  리포트 | 6페이지 | 1,500원 | 등록일 2023.03.21 | 수정일 2023.04.03

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  홍익대학교 디지털논리실험및설계 8주차 예비보고서 A+

  1.1 Gated D Latch의 동작에 대해 설명하시오.Gated D Latch의 경우 오직 하나의 입력 (D)과 EN 입력만을 가지고 있습니다. EN이 HIGH 일 때, D가 HIGH 면 Latch는 Set 상태이고 D가 LOW 이면 Latch는 Reset 상태입니..

  리포트 | 6페이지 | 1,500원 | 등록일 2023.03.21 | 수정일 2023.04.03

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  [A+보장]한양대에리카A+맞은 레포트,논리회로설계및실험, Decoder & Encoder 실험

  실험 목적게이트를 활용하여 Decoder, Encoder를 설계해서 둘의 관계를 알게되고 LED BAR를 사용해서 Decoder를 동작시켜보자Chapter 2. 관련 이론1.

  리포트 | 8페이지 | 2,500원 | 등록일 2024.05.21

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  홍익대학교 디지털논리실험및설계 6주차 예비보고서 A+

  1.1 ALU 74181의 datasheet을 읽고 네 자리 이진수의 덧셈을 74181을 이용 하여 어떻게 구현할 수 있는지 설명하시오.ALU 74181은 많은 기능들이 내장되어 있는데, 네 자리 이진수 (A3 ~ A0), (B3 ~ B0) 두 개의 입력에 대해서 어떤..

  리포트 | 4페이지 | 1,500원 | 등록일 2023.03.21 | 수정일 2023.04.03

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  [A+, 에리카] 2021-1학기 논리설계및실험 Half Adder, Full Adder 실험결과보고서

  실험 목적Half Adder와 Full Adder를 이해하고, 각각을 논리회로로 설계할 수 있다.Chapter 2. ... 특히 논리적이고, 계산이 가능한 쉬운 모델로 설계가 용이하기에 아날로그보다 디지털을 이용하여 대부분의 설계가 이루어짐을 알 수 있다. 회로의 종류- 논리회로 : 논리 게이트를 이용하여 ... 설계하면 S는 xor게이트로 묶어 간단하게 표현이 가능하다.

  리포트 | 9페이지 | 2,500원 | 등록일 2023.02.28

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  [A+보장]한양대에리카A+맞은 레포트,논리설계실험,디지털 IC 개요, 조합논리회로,Combinational Logic Circuit

  실험 목적디지털 IC 개요 알 수 있고, 조합논리회로를 활용하여 카르노 맵을 이해할 수 있다.Chapter 2. 관련 이론1. ... 조지 부울은 부울 논리라고 하는 2진변수에 대한 논리 연산 체계를 개발하였다. 부울 변수는 true 이거나 flase 일 수 있다. ... 디지털 논리회로는 조합회로와 순차회로 분류된다. 조합회로는 현재의 입력 값에 의해서만 출력 값이 결정되는 회로이고, 예를 들어 논리 게이트가 있다.

  리포트 | 9페이지 | 2,500원 | 등록일 2024.05.21

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  [A+, 에리카] [A+] 2021-1학기 논리설계및실험 Decoder, Encoder 실험결과보고서

  실험 목적Decoder와 Encoder를 이해하고, 2x4 decoder, 4x2 encoder, 3x8 decoder를 논리회로로 설계할 수 있다.Chapter 2. ... 관련 이론ü CodeCode는 부호로, 정보를 특정한 형태로 표현하는 규칙을 의미한다.대부분의 논리회로는 2개 값의 신호를 받아들이기 때문에, 10진수는 2진수의 항들로 표현되어야 ... 아래 행들도 마찬가지로 비교해보면 a와 b의 십진수의 값이 d 옆의 숫자와 같은 10진수로 표현될 때, 1이 됨을 알 수 있다.- and게이트와 not 게이트를 이용하여 논리회로를

  리포트 | 8페이지 | 2,500원 | 등록일 2023.02.28

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  (A+/이론/예상결과/고찰) 아주대 논리회로실험 설계결과보고서

  1) 설계목표 1. FPGA를 이용하여 5분 타이머를 설계한다. ... FPGA를 통해 설계한 타이머를 구현한다. 4. FPGA를 능숙하게 다룰 줄 안다.2) 설계 유의점 1. ... 반전 시킨 뒤, 남은 시간을 다운 카운팅 한다.3) 설계 내용1.

  리포트 | 10페이지 | 1,500원 | 등록일 2021.10.24 | 수정일 2021.10.26

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  [A+, 에리카] [A+] 2021-1학기 논리설계및실험 Flip-Flops, Latch 실험결과보고서

  실험 목적Flip-Flop과 latch에 대해 이해하고, 이 동작원리를 회로 설계를 통해 확인할 수 있다.Chapter 2. ... 관련 이론ü Combinational logic circuit vs Sequential logic circuit- 조합논리회로: 메모리가 없어도 현재 입력만으로도 출력이 결정된다.- ... 순차논리회로: 메모리가 상태를 저장하며, 입력값(과거값), 현재값 모두에 따라 출력이 결정된다.ü 기억소자(Memory element)- 말 그대로 기억할 수 있는 소자로, 전원이

  리포트 | 7페이지 | 2,500원 | 등록일 2023.02.28

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  [A+, 에리카] [A+] 2021-1학기 논리설계및실험 Decoder, 7segment 실험결과보고서

  실험 목적Decoder를 이해하고 7segment decoder 회로를 설계할 수 있다.Chapter 2. ... 대부분의 논리회로는 2개 값의 신호를 받아들이기 때문에, 10진수는 2진수의 항들로 표현되어야 한다.ü Decoder - 2진수 입력값을 10진수 값으로 변환하여 출력한다.- 입력값 ... 아래 행들도 마찬가지로 비교해보면 a와 b의 십진수의 값이 d 옆의 숫자와 같은 10진수로 표현될 때, 1이 됨을 알 수 있다.- and게이트와 not 게이트를 이용하여 논리회로를

  리포트 | 10페이지 | 2,500원 | 등록일 2023.02.28

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  [A+보장]한양대에리카A+맞은 레포트,논리설계실험,Breadboard & Basic logic gates

  실험 목적반도체 소자를 활용하여 게이트의 정의를 알 수 있다. Chapter 2. 관련 이론1. ... 여기에 사용되는 2진 신호를 실험에서는 스위치가 on이나 off되는 현상으로 나타내기도 하며, 때로는 전압이 높고 낮음을 표시하는 High(1), Low(0)등의 대응 기호로 표현하기도 ... 기본 논리 게이트 게이트를 구성하는 디지털 논리 회로는 어떤 일정한 입력에 대해서 논리적인 판단을 내릴 수 있는 전자적 회로로 구성되어 있다.

  리포트 | 16페이지 | 2,500원 | 등록일 2024.05.21

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  [논리회로설계실험] 1bit full adder & 4bit full adder (logic gate 구현)(성균관대)

  adder를 병렬로 연결할 시, 4-bit 뿐만 아니라 여러 개의 Full adder를 연결함으로써, half adder와 달리 모든 비트수에 대해 사용 가능하다는 것을 알 수 있다.이번 실험에서는

  리포트 | 7페이지 | 1,500원 | 등록일 2024.06.07

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  실험6. 논리조합회로의 설계

  실험명실험6. 논리조합회로의 설계2. 개요논리게이트의 조합으로 복잡한 논리적 함수관계를 구현하는 연습을 행한다. ... 설계절차-이상에서 설명한 내용을 감안하여 조합논리회로의 설계절차를 다시 요약하면 다음과 같다.1. ... 관련이론○논리게이트의 조합-앞의 실험2에서 다루었던 기본적인 논리게이트 요소들을 결합하면 이론적으로 어떠한 논리적 함수관계도 표현이 가능하다.

  리포트 | 25페이지 | 3,500원 | 등록일 2018.03.04

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  논리회로설계실험 기본게이트설계 결과보고서

  논리회로설계 실험 결과보고서 #1실험 1. 기본게이트 설계1. ... 실험 목표주어진 진리표를 해석하여 해당하는 입출력 관계를 가진 논리회로를 Xilinx 프로그램을 사용하여 설계 해본다. ... 이러한 문제점들을 해결하기 위해서 주어진 진리표를 먼저 3변수-카르노맵에 나타내어 출력값 F를 입력 A,B,C에 대한 최소 논리곱의 합(Sum of Products) 식으로 나타내었다.ABC01은

  리포트 | 5페이지 | 1,500원 | 등록일 2018.01.10

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