"verilog 프로젝트" 검색결과 181-200 / 289건

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  전자전기컴퓨터설계실험2(전전설2)8주차예비

  HDL project를 생성새 프로젝트를 생성할 때 프로젝트의 종류를 설정해주어야 한다. ... 실험의 목적(Purpose of this Lab)Xilinx 프로그램으로 HDL 중 하나인 verilog를 사용하여 카운터 회로를 만들고 이를 응용하여 segment, piezo에

  리포트 | 26페이지 | 1,500원 | 등록일 2016.01.14 | 수정일 2017.02.10

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  전자전기컴퓨터설계실험2(전전설2)9주차결과

  HDL project를 생성새 프로젝트를 생성할 때 프로젝트의 종류를 설정해주어야 한다. ... 실험의 목적(Purpose of this Lab)Xilinx 프로그램으로 HDL 중 하나인 verilog를 사용하여 combo의 LCD를 사용한다.2.

  리포트 | 23페이지 | 1,500원 | 등록일 2016.01.14 | 수정일 2017.02.10

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  전자전기컴퓨터설계실험2(전전설2)5주차예비

  HDL project를 생성새 프로젝트를 생성할 때 프로젝트의 종류를 설정해주어야 한다. ... 실험의 목적(Purpose of this Lab)Xilinx 프로그램으로 HDL 중 하나인 verilog를 사용하여 조합회로 중 디코더, 인코더, 멀티플랙서를 구현하고 그 원리를 이해한다

  리포트 | 13페이지 | 1,500원 | 등록일 2016.01.14 | 수정일 2017.02.10

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  LG 이노텍 2015 상반기 합격 자소서

  Verilog언어를 익히기 위해 도서관에서 관련 서적들을 찾아보았고, 블로그에 있는 자료들을 찾아보며 독학하였습니다. ... 하지만 프로젝트 수업만큼 많은 것을 배울 수 있는 수업은 없다고 생각했고, 많은 프로젝트 수업들을 수강하였습니다. ... 한 전공 프로젝트로 통신 시스템을 설계하였고, Matlab으로 시스템을 검증하였습니다.

  자기소개서 | 2페이지 | 3,000원 | 등록일 2015.12.13

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  Verilog-HDL 을 이용한 ALU 설계

  논리회로설계 텀프로젝트입니다.Verilog-HDL 을 이용한 ALU 설계 입니다.기본적인 ALU 를 설계하여.① exponential - 지수② factorial - 팩토리얼③ ... multiply - 곱셈을 구현하는 프로젝트 소스입니다.

  리포트 | 2,000원 | 등록일 2011.06.09 | 수정일 2016.02.05

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  전자전기컴퓨터설계실험2(전전설2)4주차예비

  HDL project를 생성새 프로젝트를 생성할 때 프로젝트의 종류를 설정해주어야 한다. ... 실험의 목적(Purpose of this Lab)Xilinx 프로그램으로 HDL 중 하나인 verilog를 사용하여 가산기 구현의 응용인 감산기를 구현하고 또한 비교기를 구현한다.2

  리포트 | 16페이지 | 1,500원 | 등록일 2016.01.14 | 수정일 2017.02.10

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  전자전기컴퓨터설계실험2(전전설2)8주차결과

  HDL project를 생성새 프로젝트를 생성할 때 프로젝트의 종류를 설정해주어야 한다. ... 실험의 목적(Purpose of this Lab)Xilinx 프로그램으로 HDL 중 하나인 verilog를 사용하여 카운터 회로를 만들고 이를 응용하여 segment, piezo에

  리포트 | 24페이지 | 1,500원 | 등록일 2016.01.14 | 수정일 2017.02.10

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  전자전기컴퓨터설계실험2(전전설2)7주차결과

  HDL project를 생성새 프로젝트를 생성할 때 프로젝트의 종류를 설정해주어야 한다. ... 실험의 목적(Purpose of this Lab)Xilinx 프로그램으로 HDL 중 하나인 verilog를 사용하여 순차회로를 이해하고 순차회로 중 플립플롭 회로에 대해 이해한다.2

  리포트 | 18페이지 | 1,500원 | 등록일 2016.01.14 | 수정일 2017.02.10

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  전자전기컴퓨터설계실험2(전전설2)7주차예비

  HDL project를 생성새 프로젝트를 생성할 때 프로젝트의 종류를 설정해주어야 한다. ... 실험의 목적(Purpose of this Lab)Xilinx 프로그램으로 HDL 중 하나인 verilog를 사용하여 순차회로를 이해하고 순차회로 중 플립플롭 회로에 대해 이해한다.2

  리포트 | 17페이지 | 1,500원 | 등록일 2016.01.14 | 수정일 2017.02.10

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  전자전기컴퓨터설계실험2(전전설2)5주차결과

  HDL project를 생성새 프로젝트를 생성할 때 프로젝트의 종류를 설정해주어야 한다. ... 실험의 목적(Purpose of this Lab)Xilinx 프로그램으로 HDL 중 하나인 verilog를 사용하여 조합회로 중 디코더, 인코더, 멀티플랙서를 구현하고 그 원리를 이해한다

  리포트 | 20페이지 | 1,500원 | 등록일 2016.01.14 | 수정일 2017.02.10

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  ASM-자기소개서-국문

  기본적인 회로설계, C++/C 프로그래밍뿐만 아니라 VHDL Verilog, SOC, 영상처리, 그리고 임베디드 소프트웨어 설계 및 실습과 같은 과목을 통해 전공분야에서 Generalist로써 ... 특히 많은 프로젝트 수행을 통해 기른 S/W와 H/W로 구성된 시스템에 대한 심오한 분석력은 문제 해결에 있어 가장 합리적인 솔루션을 제공하였습니다. ... 만들기를 하면서 많은 흥미를 느꼈고, 공학자가 되겠다는 비전을 갖고 전자공학을 전공하였습니다.학창시절 학점보다는 실력이라는 저의 철학을 실천하기 위해 많은 프로젝트를 진행하였습니다.

  자기소개서 | 2페이지 | 3,000원 | 등록일 2016.04.04 | 수정일 2018.05.16

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  전자전기컴퓨터설계실험2(전전설2)6주차결과

  HDL project를 생성새 프로젝트를 생성할 때 프로젝트의 종류를 설정해주어야 한다. ... 실험의 목적(Purpose of this Lab)Xilinx 프로그램으로 HDL 중 하나인 verilog를 사용하여 순차회로를 이해하고 순차회로 중 플립플롭 회로에 대해 이해한다.2

  리포트 | 13페이지 | 1,500원 | 등록일 2016.01.14 | 수정일 2017.02.10

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  전자전기컴퓨터설계실험2(전전설2)4주차결과

  HDL project를 생성새 프로젝트를 생성할 때 프로젝트의 종류를 설정해주어야 한다. ... 실험의 목적(Purpose of this Lab)Xilinx 프로그램으로 HDL 중 하나인 verilog를 사용하여 가산기 구현의 응용인 감산기를 구현하고 또한 비교기를 구현한다.2

  리포트 | 19페이지 | 1,500원 | 등록일 2016.01.14 | 수정일 2017.02.10

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  [Verilog] Inverse Quentization을 수행하는 코드

  프로젝트 계획 및 회의록1. 조원별 역할 분담2. 프로젝트 계획3. 회의록II. 설계 계획 및 배경 이론1. 설계 계획2. 배경 이론III. Verilog 코드1. ... 설계 계획- 프로젝트 착안점이번 Project의 첫번째 Main Point는 Verilog HDL의 응용이다. ... Verilog 코드1.

  리포트 | 26페이지 | 1,500원 | 등록일 2010.09.09

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  SK하이닉스 합격 자기소개서

  그리고 이후, 심화된 전공지식을 쌓기 위해 3학년 때에는 전공 선택과목으로 디지털시스템설계 과목을 수강하였고, 프로젝트 과제로 Verilog를 이용한 Mu0 및 Clock 설계를 수행하면서 ... [휴대폰 애플리케이션을 이용한 자율 주행 RC카]저는 대학교 4학년 종합설계과제로 팀 프로젝트를 수행한 경험이 있습니다. ... 그리고 관련 과목들의 프로젝트나 과제를 수행하면서 모르는 것이 생기면 포기하지 않고, 시간이 날 때마다 그 부분을 공부를 하거나 교수님께 물어보며 문제를 해결해왔습니다.

  자기소개서 | 6페이지 | 3,000원 | 등록일 2018.08.18

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  전자회로실습 텀프로젝트 - 자동 매너모드 전환 시스템

  자동 매너모드 전환 시스템조이름 :목차연구동기 연구개념 구현방법 Block Diagram Verilog Simultion 구현결과 결론연구동기수업 시간 중 휴대폰 벨 소리로 인해 수업분위기가

  리포트 | 12페이지 | 1,500원 | 등록일 2011.05.21

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  SK고용디딤돌 반도체 과정 합격 자소서

  [마음이 맞는 사람]2학년 학기 말 프로젝트로 CPU를 구현했습니다. 팀을 구성하는데 있어 다른 조와 달리 평소 마음이 잘 맞는 친구들과 조를 편성했습니다. ... 이 후 SOC lab에 들어가 설계과목을 수강하며 다양한 회로를 반도체 칩 위에 구현해 보았습니다. 3학년 2학기에는 반도체 공학 및 제조 실습 과목을 수강하며 Verilog 언어를

  자기소개서 | 2페이지 | 3,000원 | 등록일 2016.11.20 | 수정일 2016.11.24

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  4층 elevator controller 설계, 엘레베이터 베릴로그 설계 엘리베이터

  < 전기전자기초실험 >설계 프로젝트Ⅱ.◈ 4층 elevator controller 설계 ◈< 제 목 >4층 엘리베이터 컨트롤러 설계 실습< 목 표 >엘리베이터 컨트롤러 설계 실습을 ... ; 4F; 7'b0110011;afbgecdafbgecdafbgecdStop(S): 7'b1011011; Up(U): 7'b0111110; Down(D): 7'b1111110;* verilog ... NS+1;end// 이동 상태가 Down이면 다음 층수는 현재 층수에 1을 뺀 것과 같다.else if(SUD==2'b10) beginNS=NS-1;endendendmodule4. verilog

  리포트 | 12페이지 | 4,000원 | 등록일 2007.11.13

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  [추천][합격 자기소개서] 2019 SK텔레콤 IT(네트워크, 통신시스템개발, 솔루션기획개발) 합격자기소개서, 네트워크 합격자소서, IT분야 합격자기소개서, 면접족보

  VERILOG언어를 사용한 프로젝트를 수행하면서 밤샘작업도 마다하지 않았습니다. 개인 과제로 주도적으로 과제를 수행하면서 학우들과 협력하였습니다. ... VERILOG언어를 학습하면서 시간을 두고 적응하리라 예상했던 학교생활에 바로 적응할 수 있었던 기회가 되었습니다. ... 자신감과 끈기를 가지고 도전하였고 제출기한보다 빠른 시일 내에 프로젝트를 완성하였습니다.

  자기소개서 | 6페이지 | 3,100원 (15%↓) 2635원 | 등록일 2015.02.11 | 수정일 2020.03.18

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  modelsim velilog로 구현한 mips pipelining

  컴퓨터구조프로젝트(MIPS Pipeline 설계)MIPS Pipeline 설계: 본 프로젝트는 다음과 같은 과정을 따라 수행하였다.목표: Modelsim을 이용하여 Verilog HDL ... 언어로 MIPS Pipelining를 설계한다.(1) Verilog HDL로 각 단계별 Module 설계(2) Pipeling 설계(3) 주어진 Data를 연산 후 Pipelining ... Verilog HDL을 이용한 Module 설계(1) Instruction Fetch ( IF stage )- Instruction memorymodule instrom(pc ,inst

  리포트 | 9페이지 | 5,000원 | 등록일 2010.07.22 | 수정일 2015.07.17

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